[发明专利]多个模数转换器的低功耗同步在审

专利信息
申请号: 201910109830.0 申请日: 2019-02-11
公开(公告)号: CN110120815A 公开(公告)日: 2019-08-13
发明(设计)人: N·D·卡马特 申请(专利权)人: 亚德诺半导体无限责任公司
主分类号: H03M1/12 分类号: H03M1/12
代理公司: 中国国际贸易促进委员会专利商标事务所 11038 代理人: 刘倜
地址: 百慕大群岛(*** 国省代码: 百慕大群岛;BM
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摘要:
搜索关键词: 感测节点 控制节点 串行通信信道 模数转换器 低功耗 发送电路 接收电路 控制信号 微控制器 耦合到 发送 共享
【权利要求书】:

1.一种用于同步两个或多个模数转换器电路的系统,该系统包括:

第一处理电路,包括第一计时器;

第二处理电路,包括第二计时器;和

控制电路,其耦合到所述第一处理电路和所述第二处理电路,使用第一电导体发送数据和第二电导体以接收数据,所述控制电路:

使用所述第一电导体同时向所述第一处理电路和所述第二处理电路发送触发脉冲,以使所述第一处理电路和所述第二处理电路分别使用所述触发脉冲同步所述第一计时器和所述第二计时器,

使用所述第二电导体接收来自所述第一处理电路的第一串行数据,所述第一串行数据包括模拟信号的第一数字样本和时间戳以指示捕获所述数字样本的时间,所述时间戳使用所述第一计时器的值确定。

2.权利要求1所述的系统,其中所述控制电路进一步:

使用所述第二电导体接收来自所述第二处理电路的第二串行数据,所述第二串行数据包括模拟信号的第二数字样本和第二时间戳以指示捕获所述第二数字样本的时间,所述第二时间戳使用所述第二计时器的值确定;

使用所述第一时间戳和所述第二时间戳同步所述第一串行数据和所述第二串行数据。

3.权利要求1所述的系统,其中,使所述第一计时器和所述第二计时器同步的同步是使所述第一处理电路和所述第二处理电路将初始时间戳存储在存储器存储电路中,在接收所述触发脉冲之后,在阈值时间使用所述第一定时器或所述第二定时器的值确定初始时间戳。

4.权利要求1所述的系统,其中接收第一串行数据使所述第一处理电路产生数字样本是:

使所述第一处理电路:

触发第一模数转换器电路以将第一模拟信号的第一样本转换为第一数字样本,和

使用第一样本通信信道从所述第一模数转换器电路接收所述第一数字样本。

5.权利要求4所述的系统,其中接收第一串行数据是使所述第一处理电路:

以第一采样率将所述第一模拟信号的第一样本转换为第一数字样本,所述第一采样率与所述第一样本通信信道的第一数据速率相关联;

将所述第一数字样本转换为第二采样率,所述第二采样率与所述串行通信信道的第二数据速率相关联;和

使用所述第二电导体将转换的第一数字样本发送到所述控制电路。

6.权利要求4所述的系统,其中所述第一处理电路触发第一模数转换器电路与所述第二处理电路触发第二模数转换器电路异步。

7.权利要求1所述的系统,其中,使用所述串行通信将所述触发脉冲同时发送到所述第一处理电路和所述第二处理电路是:

使用耦合到所述第一电导体的发送电路发送所述触发脉冲,所述发送电路耦合到所述第一处理电路和所述第二处理电路的每个处理电路的输入端口,所述输入端口被配置为响应于接收触发脉冲产生处理器中断,所述第一处理电路和所述第二处理电路的每个处理电路被配置为触发模数转换器电路,以响应于所述处理器中断将所述模拟信号的样本转换为数字样本。

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