[发明专利]数据中心中的可编程设备的安全性在审
| 申请号: | 201880081631.7 | 申请日: | 2018-09-27 |
| 公开(公告)号: | CN111512297A | 公开(公告)日: | 2020-08-07 |
| 发明(设计)人: | S·M·特里姆伯杰 | 申请(专利权)人: | 赛灵思公司 |
| 主分类号: | G06F15/78 | 分类号: | G06F15/78;G06F21/76;G06F30/34 |
| 代理公司: | 北京市金杜律师事务所 11256 | 代理人: | 傅远 |
| 地址: | 美国加利*** | 国省代码: | 暂无信息 |
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| 摘要: | |||
| 搜索关键词: | 数据中心 中的 可编程 设备 安全性 | ||
1.一种在计算机系统中配置可编程集成电路IC的方法,包括:
选择所述可编程IC的可编程组构的第一区域以用于外壳电路的实现,所述外壳电路被配置为与所述计算机系统的总线对接;
选择所述可编程组构的第二区域以用于应用电路的实现,所述应用电路被配置为与所述外壳电路对接;
提供围栏区域,所述围栏区域设置在所述第一区域与所述第二区域之间,所述围栏区域包括所述可编程组构的未配置瓦片集合;
生成用于电路设计的配置数据,所述电路设计具有所述第一区域、所述第二区域和所述围栏区域;以及
将所述配置数据加载到所述可编程IC。
2.根据权利要求1所述的方法,其中所述应用电路使用通过所述围栏区域的连接而耦合到所述外壳电路。
3.根据权利要求1所述的方法,其中所述应用电路的逻辑和布线被包含在所述第二区域内,其中所述外壳电路的逻辑和布线被包含在所述第一区域内,并且其中所述应用电路的输入/输出IO端口通过所述连接耦合到所述外壳电路的IO端口。
4.根据权利要求1所述的方法,还包括:
选择所述可编程组构的第三区域以实现全局时钟逻辑,所述全局时钟逻辑被配置为向所述外壳电路和所述应用电路提供时钟信号。
5.根据权利要求1所述的方法,其中所述外壳电路包括系统监测器,所述系统监测器被配置为监测所述可编程IC,并且响应于检测到误差条件而发信号通知所述计算机系统。
6.根据权利要求1所述的方法,其中所述外壳电路包括运行时间检查电路,所述运行时间检查电路被配置为回读所述可编程IC的配置数据,并且验证所述第一区域、所述第二区域和所述围栏区域的完整性。
7.根据权利要求6所述的方法,其中所述运行时间检查电路耦合到所述可编程IC的内部配置访问端口。
8.一种计算系统,包括:
处理系统;
硬件加速器,耦合到所述处理系统,所述硬件加速器包括:
可编程集成电路IC,配置有加速电路,所述加速电路具有:可编程组构的第一区域,所述第一区域用于外壳电路的实现,所述外壳电路被配置为与所述处理系统的总线对接;第二区域,所述第二区域用于应用电路的实现,所述应用电路被配置为与所述外壳电路对接;以及围栏区域,设置在所述第一区域与所述第二区域之间,所述围栏区域包括所述可编程组构的未配置瓦片集合;
软件平台,在所述处理系统上执行,所述软件平台包括能够由所述处理系统执行以与所述硬件加速器对接的程序代码。
9.根据权利要求8所述的计算系统,其中所述应用电路使用通过所述围栏区域的连接而耦合到所述外壳电路。
10.根据权利要求8所述的计算系统,其中所述应用电路的逻辑和布线被包含在所述第二区域内,其中所述外壳电路的逻辑和布线被包含在所述第一区域内,并且其中所述应用电路的输入/输出IO端口通过所述连接耦合到所述外壳电路的IO端口。
11.根据权利要求8所述的计算系统,其中所述外壳电路包括系统监测器,所述系统监测器被配置为监测所述可编程IC,并且响应于检测到误差条件而发信号通知所述计算机系统。
12.根据权利要求8所述的计算系统,其中所述外壳电路包括运行时间检查电路,所述运行时间检查电路被配置为回读所述可编程IC的配置数据,并且验证所述第一区域、所述第二区域和所述围栏区域的完整性。
13.根据权利要求12所述的计算系统,其中所述运行时间检查电路耦合到所述可编程IC的内部配置访问端口。
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