[发明专利]半导体电路及其控制方法在审

专利信息
申请号: 201880064733.8 申请日: 2018-09-25
公开(公告)号: CN111164892A 公开(公告)日: 2020-05-15
发明(设计)人: 平贺启三 申请(专利权)人: 索尼半导体解决方案公司
主分类号: H03K3/356 分类号: H03K3/356;H03K3/037
代理公司: 中国国际贸易促进委员会专利商标事务所 11038 代理人: 张小稳
地址: 日本*** 国省代码: 暂无信息
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摘要:
搜索关键词: 半导体 电路 及其 控制 方法
【权利要求书】:

1.一种半导体电路,包括:

易失性的第一存储部;

易失性的第二存储部,基于第一控制信号存储在所述第一存储部中存储的数据;

非易失性的第三存储部,基于第二控制信号存储与存储在所述第二存储部中的数据相应的数据,并且基于第三控制信号使得在自身中存储的数据存储于所述第一存储部;和

控制部,生成所述第一控制信号和所述第三控制信号,并且将存储在所述第一存储部中的数据和存储在所述第二存储部中的数据进行比较,以基于比较的结果生成所述第二控制信号。

2.根据权利要求1所述的半导体电路,其中

所述控制部在第一时段期间使用所述第三控制信号来使得在所述第三存储部中存储的数据存储于所述第一存储部,并且使用所述第一控制信号来使得在所述第一存储部中存储的数据存储于所述第二存储部,以及

在所述第一时段之后的第二时段期间,在所述比较的结果表明存储在所述第一存储部中的数据和存储在所述第二存储部中的数据彼此不同的情况下,所述控制部使用所述第二控制信号来使得与存储在所述第二存储部中的数据相应的数据存储于所述第三存储部。

3.根据权利要求2所述的半导体电路,其中

所述控制部在所述第二时段之后的第三时段期间使用所述第三控制信号来使得在所述第三存储部中存储的数据存储于所述第一存储部,以及

在所述第三时段之后的第四时段期间,在所述比较的结果表明存储在所述第一存储部中的数据和存储在所述第二存储部中的数据彼此一致的情况下,所述控制部使用所述第二控制信号来使得与存储在所述第二存储部中的数据相应的数据存储于所述第三存储部。

4.根据权利要求3所述的半导体电路,其中,所述控制部将在所述第四时段期间使得所述第三存储部存储与存储在所述第二存储部中的数据相应的数据的操作条件设置为与在所述第二时段期间使得所述第三存储部存储与存储在所述第二存储部中的数据相应的数据的操作条件不同的条件。

5.根据权利要求4所述的半导体电路,其中

所述第三存储部包括要被施加驱动信号的非易失性存储元件,

所述第二控制信号包括所述驱动信号,以及

所述控制部将在所述第二时段期间的所述驱动信号的幅度设置为第一电压,并且将在所述第四时段期间的所述驱动信号的幅度设置为第二电压。

6.根据权利要求5所述的半导体电路,其中,所述第二电压大于所述第一电压。

7.根据权利要求4所述的半导体电路,其中

所述第三存储部包括要被施加驱动信号的非易失性存储元件,

所述第二控制信号包括所述驱动信号,以及

所述控制部将在所述第二时段期间的所述驱动信号的脉冲宽度设置为第一脉冲宽度,并且将在所述第四时段期间的所述驱动信号的脉冲宽度设置为第二脉冲宽度。

8.根据权利要求7所述的半导体电路,其中,所述第二脉冲宽度比所述第一脉冲宽度宽。

9.根据权利要求3所述的半导体电路,其中,在所述第四时段期间,在所述比较的结果表明存储在所述第一存储部中的数据和存储在所述第二存储部中的数据彼此不同的情况下,所述控制部执行供电控制以停止向所述第一存储部和所述第二存储部供电。

10.根据权利要求3所述的半导体电路,其中,所述控制部重复所述第三时段期间的操作和所述第四时段期间的操作,直到所述比较的结果表明存储在所述第一存储部中的数据和存储在所述第二存储部中的数据彼此不同为止。

11.根据权利要求2所述的半导体电路,还包括第一电路和第二电路,其中

在所述第一时段和所述第二时段之间的第五时段中,所述第一存储部存储从所述第一电路供应的数据,并将所存储的数据供应给所述第二电路。

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