[发明专利]用于在微控制器和收发器组件之间通信的方法、微控制器和收发器组件有效
| 申请号: | 201880035714.2 | 申请日: | 2018-05-24 |
| 公开(公告)号: | CN110663229B | 公开(公告)日: | 2021-10-29 |
| 发明(设计)人: | F.哈特维希;S.沃克;A.穆特 | 申请(专利权)人: | 罗伯特·博世有限公司 |
| 主分类号: | H04L12/40 | 分类号: | H04L12/40 |
| 代理公司: | 中国专利代理(香港)有限公司 72001 | 代理人: | 张涛;刘春元 |
| 地址: | 德国斯*** | 国省代码: | 暂无信息 |
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| 摘要: | |||
| 搜索关键词: | 用于 控制器 收发 组件 之间 通信 方法 | ||
1.一种收发器组件(106),其特征在于,所述收发器组件(106)被构造为至少暂时地根据传输协议在所述收发器组件(106)的第一输入端(120)处接收用于数据总线的输出数据,其中所述第一输入端(120)被构造用于连接到微控制器(102)的第一引脚(110),其中所述收发器组件(106)被构造为至少暂时地根据所述传输协议在所述收发器组件(106)的第一输出端(122)处从所述数据总线发送用于所述微控制器(102)的输入数据,其中所述第一输出端(122)被构造用于连接到所述微控制器(102)的第二引脚(112),其中所述收发器组件(106)具有收发器(118),所述收发器(118)被构造为至少暂时地从所述第一输入端(120)接收所述输出数据并经由所述数据总线发送所述输出数据,其中所述收发器(118)被构造为至少暂时地从所述数据总线接收所述输入数据并经由所述第一输出端(122)发送所述输入数据,其中所述收发器组件(106)具有被构造为执行附加功能的附加功能装置(136),其中所述收发器组件(106)被构造为至少暂时地根据所述传输协议经由所述第一输入端(120)接收用于所述附加功能的附加数据,和/或至少暂时地根据所述传输协议经由所述第一输出端(122)发送用于所述附加功能的附加数据,其中所述收发器组件(106)包括第一收发器总线控制器(202),其中所述第一收发器总线控制器(202)具有第一通信输入端(146),所述第一通信输入端(146)能与所述收发器(118)的输出端(126)连接以接收所述附加数据,和/或其中第一收发器总线控制器(202)具有第一通信输出端(212),所述第一通信输出端(212)能与所述收发器(118)的第二输入端(124)连接以发送所述附加数据。
2.根据权利要求1所述的收发器组件(106),其特征在于,所述第一收发器总线控制器(202)具有第二通信输入端(144),所述第二通信输入端(144)能与所述第一输入端(120)连接以认证所述微控制器(102)。
3.根据权利要求1或2中的任一项所述的收发器组件(106),其特征在于,所述收发器组件(106)被构造为接收包含标识的第一消息,将接收的标识存储在非易失性存储器中,从所述非易失性存储器中读取存储的标识,并在所述数据总线上发送包含读取的标识的第二消息。
4.根据权利要求1或2中的任一项所述的收发器组件(106),其特征在于,所述收发器组件(106)被构造为产生标识,并在所述数据总线上的第一消息中发送所述标识。
5.根据权利要求3所述的收发器组件(106),其特征在于,所述收发器组件(106)被构造为与所述微控制器(102)或所述数据总线上的另一节点交换对称密码密钥,以及将所述对称密码密钥用于至少一个要发送的消息的密码认证或加密,和/或将所述对称密码密钥用于至少一个接收的消息的密码认证或解密。
6.根据权利要求1至2中的任一项所述的收发器组件(106 ),其特征在于,所述收发器组件(106 )包括第二收发器总线控制器(302),所述第二收发器总线控制器(302)被构造为根据所述传输协议经由所述数据总线发送至少一个消息或部分消息,其中所述收发器组件(106)包括第一逻辑组件(320),所述第一逻辑组件(320)被构造为选择性地启用或防止所述附加数据或所述至少一个消息或部分消息在外部数据总线(340)上的传输,其中所述第一收发器总线控制器(202)被构造为操控所述第二收发器总线控制器(302)和/或所述第一逻辑组件(320),以便至少暂时地在所述外部数据总线(340)上发送所述至少一个消息或部分消息,而同时所述收发器总线控制器(202)经由所述第一输入端(120)接收或经由所述第一输出端(122)发送所述附加数据。
7.根据权利要求6所述的收发器组件(106),其特征在于,所述收发器组件(106)包括第二逻辑组件(328),所述第二逻辑组件(328)被构造为选择性地启用或防止所述输入数据或所述附加数据在所述第一输出端(122)处的传输,其中所述第一收发器总线控制器(202)被构造为操控所述第二逻辑组件(328)以传输所述输入数据或所述附加数据。
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