[发明专利]无序像素着色器导出有效

专利信息
申请号: 201880007630.8 申请日: 2018-01-10
公开(公告)号: CN110192225B 公开(公告)日: 2020-12-29
发明(设计)人: 帕扎尼·皮拉伊;克里斯多夫·J·布伦南 申请(专利权)人: 超威半导体公司
主分类号: G06T15/00 分类号: G06T15/00;G06T15/40;G06T7/70;G06T15/80;G06T1/60;G06T7/50;G06T1/20
代理公司: 上海胜康律师事务所 31263 代理人: 樊英如;张华
地址: 美国加利*** 国省代码: 暂无信息
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摘要:
搜索关键词: 无序 像素 着色 导出
【说明书】:

公开了图形处理流水线的改进。所述图形处理流水线按照应用程序或其他实体的请求以特定顺序(应用程序编程接口顺序—“API顺序”)处理图形对象。然而,所述图形处理流水线内的某些部件,诸如像素着色器级,可无序地处理这些对象。本文提供了一种技术,以允许所述像素着色器级完成并无序地导出处理的片段。所述技术包括使用记分板来确定准备从像素着色器级导出的片段是否为API顺序中的最新片段。如果所述片段是API顺序中的所述最新片段,则导出所述片段。如果所述片段不是API顺序中的所述最新片段,则丢弃所述片段。

相关申请的交叉引用

本申请要求2017年1月27日提交的美国非临时申请号15/418,557以及2017年2月3日提交的欧洲专利申请号EP17154680.7的权益,所述申请的全部内容在此通过引用的方式并入,如同在本文中完整阐述一样。

技术领域

所公开的实施例总体上涉及图形处理流水线,并且具体地涉及无序像素着色器导出。

背景技术

三维图形处理流水线接受来自主机(诸如计算系统的中央处理单元)的命令并且处理这些命令以生成用于在显示装置上显示的像素。图形处理流水线包括执行单独任务的多个级,诸如变换顶点位置和属性、计算像素颜色等等。图形处理流水线正在不断开发和改进。

附图说明

从以下结合附图通过示例给出的描述中可得到更详细的理解,在附图中:

图1是可实现一个或多个公开的实施例的示例性装置的框图;

图2是图1的装置的展示了额外细节的框图;

图3是示出图2所示的图形处理流水线的额外细节的框图;

图4展示了根据一个示例的早z模式和晚z模式;

图5展示了无序导出块和记分板的细节,以及用于从像素着色器级执行无序导出的示例性操作;并且

图6是根据一个示例的用于无序地从图形处理流水线的像素着色器级导出片段的方法的流程图。

具体实施方式

本公开涉及图形处理流水线的改进。图形处理流水线按照应用程序或其他实体的请求以特定顺序(应用程序编程接口顺序—“API顺序”)处理图形对象。然而,图形处理流水线内的某些部件(诸如像素着色器级)可无序地处理这些对象。本文提供了一种技术,以允许像素着色器级完成并无序地导出处理的片段。所述技术包括使用记分板来确定准备从像素着色器级导出的片段是否为API顺序中的最新片段。如果片段是API顺序中的最新片段,则导出片段。如果片段不是API顺序中的最新片段,则丢弃片段。

图1是其中实现本公开的一个或多个方面的示例性装置100的框图。装置100包括例如计算机、游戏装置、手持装置、机顶盒、电视、移动电话或平板计算机。装置100包括处理器102、存储器104、存储装置106、一个或多个输入装置108以及一个或多个输出装置110。装置100还可选地包括输入驱动器112和输出驱动器114。应理解,装置100可包括图1中未示出的额外部件。

处理器102包括位于同一管芯上的中央处理单元(CPU)、图形处理单元(GPU)、CPU和GPU或者一个或多个处理器核心,其中每个处理器核心可为CPU或GPU。存储器104位于与处理器102相同的管芯上,或者可与处理器102分开定位。存储器104包括易失性或非易失性存储器,例如随机存取存储器(RAM)、动态RAM或高速缓存。

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