[实用新型]一种高中频雷达数字接收机有效
| 申请号： | 201822236800.X | 申请日： | 2018-12-28 |
| 公开（公告）号： | CN209673988U | 公开（公告）日： | 2019-11-22 |
| 发明（设计）人： | 蒋福生;李伟;李艳霞 | 申请（专利权）人： | 四川九洲电器集团有限责任公司 |
| 主分类号： | G01S7/285 | 分类号： | G01S7/285 |
| 代理公司： | 11386 北京天达知识产权代理事务所(普通合伙) | 代理人： | 胡时冶;和欢庆<国际申请>=<国际公布> |
| 地址： | 621000 四*** | 国省代码： | 四川;51 |
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| 摘要： | |||
| 搜索关键词： | 数字控制电路 本振信号产生电路 调理电路 射频信号 输出端 数字基带信号 输出端连接 输入端连接 接收机 混频电路 本实用新型 本振输入端 射频输入端 数字接收机 外部上位机 精准控制 镜频抑制 雷达通信 滤波组件 输出信号 射频 雷达 输出 | ||
1.一种高中频雷达数字接收机，其特征在于，包括射频信号调理电路、本振信号产生电路、混频电路和数字控制电路；其中，
混频电路的射频输入端与射频信号调理电路的输出端连接，其本振输入端与本振信号产生电路的输出端连接，其输出端与数字控制电路的输入端连接；数字控制电路的输出端一输出数字基带信号至外部上位机，其输出端二与本振信号产生电路输入端连接。
2.根据权利要求1所述的高中频雷达数字接收机，其特征在于，还包括中频信号调理电路；其中，
所述中频信号调理电路的输入端与混频电路的输出端连接，其输出端与数字控制电路的输入端连接。
3.根据权利要求1或2所述的高中频雷达数字接收机，其特征在于，所述射频信号调理电路包括自检频率源、耦合器一、限幅器、低噪声放大器、射频带通滤波器；其中，
耦合器一的输入端一接射频输入信号，其输入端二与自检频率源输出端连接，其输出端依次经限幅器、低噪声放大器与射频带通滤波器输入端连接；射频带通滤波器输出端与混频电路的射频输入端连接。
4.根据权利要求1或2所述的高中频雷达数字接收机，其特征在于，所述本振信号产生电路包括外本振源、内本振源、开关、耦合器二、耦合器三；其中，
耦合器二的输入端与内本振源输出端连接，其输出端一与数字控制电路本振输入端一连接，其输出端二与开关输入端一连接；耦合器三的输入端与外本振源输出端连接，其输出端一与数字控制电路本振输入端二连接，其输出端二与开关输入端二连接；开关输出端与混频电路的本振输入端连接；外本振源、内本振源的控制端与数字控制电路的输出端二连接。
5.根据权利要求2所述的高中频雷达数字接收机，其特征在于，所述中频信号调理电路包括依次连接的数控衰减器一、中频放大器一、数控衰减器二、中频滤波器一、中频放大器二、中频滤波器二和功分器。
6.根据权利要求4所述的高中频雷达数字接收机，其特征在于，所述数字控制电路包括检波器、比较器、隔离驱动器、FPGA、模数转换器、时钟管理芯片；其中，
检波器的输入端与耦合器二、耦合器三的输出端一连接，其输出端经比较器、隔离驱动器与FPGA输入端一连接；时钟管理芯片输出端与FPGA和模数转换器的时钟端连接；175MHz模拟中频输入信号经与模数转换器与FPGA输入端二连接；FPGA输出端一经隔离驱动器与外本振源、内本振源的控制端连接。
7.根据权利要求6所述的高中频雷达数字接收机，其特征在于，所述数字控制电路还包括网络模块、存储芯片、串口芯片；其中，
FPGA的网络端经网络模块或串口芯片与外部总线连接；
FPGA的数据端与存储芯片连接。
8.根据权利要求6或7所述的高中频雷达数字接收机，其特征在于，所述数字控制电路还包括温度传感器、电压监测模块；其中，
温度传感器、电压监测模块的输出端分别与FPGA数据端连接。
9.根据权利要求8所述的高中频雷达数字接收机，其特征在于，还包括电源转换模块；其中，
外部电源经电源转换模块与FPGA连接。
10.根据权利要求1-2、6-7、9之一所述的高中频雷达数字接收机，其特征在于，混频电路输出端输出的中频信号频率为175MHz；
所述外部上位机为二次雷达询问机。
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