[实用新型]一种基于H264的ZYNQ视频处理系统有效

专利信息
申请号: 201822103632.7 申请日: 2018-12-14
公开(公告)号: CN209517382U 公开(公告)日: 2019-10-18
发明(设计)人: 郭祥;蔡悦春;范旭龙;肖东树 申请(专利权)人: 南京华讯方舟通信设备有限公司
主分类号: H04N19/70 分类号: H04N19/70;H04N19/44
代理公司: 南京苏高专利商标事务所(普通合伙) 32204 代理人: 王恒静
地址: 210036 江苏省南京*** 国省代码: 江苏;32
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摘要:
搜索关键词: 芯片 视频处理系统 本实用新型 高清摄像头 红外摄像头 内存芯片 占用 视频编解码 视频流传输 单颗芯片 高清视频 视频存储 双向连接 芯片处理 芯片连接 芯片设计 占用空间 编解码 低延迟 视频流 功耗 外接 采集 传输
【权利要求书】:

1.一种基于H264的ZYNQ视频处理系统,其特征在于,包括:高清摄像头、红外摄像头、ZYNQ芯片、外接在ZYNQ芯片的内存芯片以及OLED显示屏;所述高清摄像头和红外摄像头将采集的视频流传输到所述ZYNQ芯片内,所述ZYNQ芯片和内存芯片双向连接,所述OLED显示屏与所述ZYNQ芯片连接,用于显示ZYNQ芯片处理后视频流。

2.根据权利要求1所述的基于H264的ZYNQ视频处理系统,其特征在于,所述ZYNQ芯片内封装二个H.264IP核编码器、一个H.264IP核解码器、OSD IP核以及AXI4-Stream to videoout IP核,所述H.264IP核编码器分别记为H.264_2,H.264_3,所述H.264_2和H.264_3分别对高清摄像头和红外摄像头采集的视频流进行编码,并分别通过ZYNQ的VDMA将视频流数据存储到所述内存芯片中,所述与所述内存芯片连接,用于对存储到内存芯片中的数据进行解码,所述OSD IP核与所述H.264IP核解码器相连,用于对解码后的数据与VDMA移出的QT数据流进行叠加处理,所述AXI4-Stream to video out IP核与所述OSD IP核连接,用于对叠加处理后的视频流数据进行输出处理。

3.根据权利要求2所述的基于H264的ZYNQ视频处理系统,其特征在于,所述ZYNQ芯片内还封装双OLED显示屏驱动IP核mdp02,其与AXI4-Stream to video out IP核的一个输出相连,作为视频显示的驱动。

4.根据权利要求2所述的基于H264的ZYNQ视频处理系统,其特征在于,所述ZYNQ芯片内还封装一个H.264IP核编码器,记为H.264_1,和RGB核,所述RGB核用于对输出的视频流数据进行标准RGB格式转换,其输入端与所述AXI4-Stream to video out IP核连接,输出端与H.264_1相连,所述H.264_1的输出端与所述内存芯片连接,用于对格式转换后的视频流数据进行编码,并将编码后的结果存储到所述内存芯片中以备QT应用所用。

5.根据权利要求4所述的基于H264的ZYNQ视频处理系统,其特征在于,所述ZYNQ芯片内还封装一个H.264IP核编码器,记为H.264_0和RGB2YUV核,所述RGB2YUV核的输入端与所述AXI4-Stream to video out IP核的输出端连接,用于将RGB格式转换成YUV格式,再通过所述H.264_0进行编码,所述H.264_0的输出端和所述内存芯片相连。

6.根据权利要求2-5任一项所述的基于H264的ZYNQ视频处理系统,其特征在于,所述H.264_0,H.264_1,H.264_2和H.264_3为相同型号的H.264 IP核编码器。

7.根据权利要求6所述的基于H264的ZYNQ视频处理系统,其特征在于,所述H.264 IP核包括用于访问内存总线和读取原始图像的S00_AXIS接口和M00_AXIS接口以及访问内部寄存器的S00_AXI接口。

8.根据权利要求7所述的基于H264的ZYNQ视频处理系统,其特征在于,所述S00_AXI接口类型为AXI_LITE,所述S00_AXIS接口和M00_AXIS接口类型为AXI4-Stream。

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