[发明专利]一种基于Probe的QTE联锁应用软件测试方法及装置有效

专利信息
申请号: 201811563629.1 申请日: 2018-12-20
公开(公告)号: CN109800155B 公开(公告)日: 2022-02-15
发明(设计)人: 王伟;郜春海 申请(专利权)人: 交控科技股份有限公司
主分类号: G06F11/36 分类号: G06F11/36
代理公司: 北京路浩知识产权代理有限公司 11002 代理人: 王莹;李相雨
地址: 100070 北京市丰台区*** 国省代码: 北京;11
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摘要:
搜索关键词: 一种 基于 probe qte 联锁 应用软件 测试 方法 装置
【权利要求书】:

1.一种基于Probe的QTE联锁应用软件测试方法,其特征在于,包括:

获取在目标应用软件对应的目标模型中加注的各Probe对应的相对路径;其中,Probe加注在所述目标模型中需进行中间变量测试的各目标逻辑模块上;

在QTE环境下,根据各目标逻辑模块之间的输入输出关系和各Probe对应的相对路径编写用于对各目标逻辑模块进行测试的测试脚本文件;

执行编写的测试脚本文件,得到对各目标逻辑模块进行测试的测试结果,输出由测试结果生成的测试报告。

2.根据权利要求1所述的方法,其特征在于,所述获取在目标应用软件对应的目标模型中加注的各Probe对应的相对路径,包括:

在Scade Suite环境下,在每一个目标逻辑模块的输入和输出位置均加注Probe,将加注Probe后得到的模型作为所述目标模型;

在由所述目标模型生成代码后,在Scade Suite环境下进行仿真运行,在仿真运行的过程中,查找各Probe对应的相对路径。

3.根据权利要求1所述的方法,其特征在于,所述在QTE环境下,根据各目标逻辑模块之间的输入输出关系和各Probe对应的相对路径编写用于对各目标逻辑模块进行测试的测试脚本文件,包括:

在QTE环境下,对于每一个Probe,根据设定的输入参数和各目标逻辑模块之间的输入输出关系确定与所述Probe对应的测试脚本文件中用于进行测试的输入数据;

将所述Probe对应的相对路径作为读取对所述Probe所在的目标逻辑模块进行测试的输出值的路径,设置对所述Probe所在的目标逻辑模块进行测试的期望输出值;

根据所述Probe对应的输入数据、相对路径和期望输出值生成与所述Probe对应的测试脚本文件,将生成的测试脚本文件按照各目标逻辑模块之间的输入输出关系在脚本控制程序中顺序排列。

4.根据权利要求3所述的方法,其特征在于,所述执行编写的测试脚本文件,得到对各目标逻辑模块进行测试的测试结果,输出由测试结果生成的测试报告,包括:

通过所述脚本控制程序执行与每一个Probe对应的测试脚本文件,得到与每一个Probe对应的输出值,根据每一个Probe对应的输出值和设定的期望输出值得到对Probe所在的目标逻辑模块进行测试的测试结果,生成包括各目标逻辑模块的测试结果的测试报告,输出所述测试报告。

5.根据权利要求2所述的方法,其特征在于,还包括:

针对任一个Probe对应的相对路径,若所述Probe的相对路径为通过所述Probe的名称查询到的文件夹,则所述probe不能用于对所述probe所在的目标逻辑模块进行测试,标记所述probe。

6.根据权利要求1所述的方法,其特征在于,所述QTE环境下用于对测试脚本文件进行编译的编译器与所述目标模型所在的Scade Suite环境中的编译器相同。

7.一种基于Probe的QTE联锁应用软件测试装置,其特征在于,包括:

获取模块,用于获取在目标应用软件对应的目标模型中加注的各Probe对应的相对路径;其中,Probe加注在所述目标模型中需进行中间变量测试的各目标逻辑模块上;

生成模块,用于在QTE环境下,根据各目标逻辑模块之间的输入输出关系和各Probe对应的相对路径编写用于对各目标逻辑模块进行测试的测试脚本文件;

测试模块,用于执行编写的测试脚本文件,得到对各目标逻辑模块进行测试的测试结果,输出由测试结果生成的测试报告。

8.一种电子设备,其特征在于,包括:

至少一个处理器、至少一个存储器、通信接口和总线;其中,

所述处理器、存储器、通信接口通过所述总线完成相互间的通信;

所述通信接口用于该电子设备和其它电子设备的通信模块之间的信息传输;

所述存储器存储有可被所述处理器执行的程序指令,所述处理器调用所述程序指令能够执行如权利要求1至6中任一项所述的方法。

9.一种非暂态计算机可读存储介质,其特征在于,所述非暂态计算机可读存储介质存储计算机指令,所述计算机指令使所述计算机执行如权利要求1至6任一项所述的方法。

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