[发明专利]一种高驱动电流半浮栅晶体管及其制备方法在审
| 申请号: | 201811539681.3 | 申请日: | 2018-12-17 |
| 公开(公告)号: | CN109742074A | 公开(公告)日: | 2019-05-10 |
| 发明(设计)人: | 张卫;陈琳;孙清清 | 申请(专利权)人: | 复旦大学 |
| 主分类号: | H01L27/108 | 分类号: | H01L27/108;H01L21/8242;H01L29/16 |
| 代理公司: | 上海正旦专利代理有限公司 31200 | 代理人: | 陆飞;陆尤 |
| 地址: | 200433 *** | 国省代码: | 上海;31 |
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| 摘要: | |||
| 搜索关键词: | 浮栅晶体管 栅极叠层 载流子 高驱动电流 栅极侧墙 衬底 制备 集成电路器件制造 衬底表面 驱动电流 有效质量 迁移率 源漏极 张应力 沟道 漏区 源区 引入 | ||
1.一种高驱动电流半浮栅晶体管,其特征在于,包括:
Si衬底,具有第一掺杂类型;
U型槽,形成于所述Si衬底中;
第一栅极叠层,包括第一栅介质层和浮栅,其中,所述第一栅介质层覆盖所述U型槽的表面并部分覆盖所述Si衬底表面,在所述Si衬底表面形成开口,所述浮栅覆盖所述第一栅介质层,在所述开口处与所述Si衬底表面相接触;
第二栅极叠层,包括第二栅介质层和多晶硅层,其中,所述多晶硅层具有第一掺杂类型,所述第二栅介质层覆盖所述浮栅表面和部分所述Si衬底表面,所述多晶硅层覆盖所述第二栅介质层;
栅极侧墙,位于所述第一栅极叠层和第二栅极叠层两侧;以及
源区和漏区,为第二掺杂类型的SiC,形成于所述Si衬底中,位于所述第一、第二栅极叠层两侧。
2.根据权利要求1所述的高驱动电流半浮栅晶体管,其特征在于,所述第一、第二栅介质层为SiO2。
3.根据权利要求1所述的高驱动电流半浮栅晶体管,其特征在于,所述浮栅为第一掺杂类型的多晶硅。
4. 根据权利要求1所述的高驱动电流半浮栅晶体管,其特征在于,所述第一种掺杂类型为p 型,所述第二种掺杂类型为n 型;或者,所述第一种掺杂类型为n 型,所述第二种掺杂类型为p 型。
5.根据权利要求1所述的高驱动电流半浮栅晶体管,其特征在于,所述Si衬底为体硅或绝缘体上硅。
6.一种高驱动电流半浮栅晶体管制备方法,其特征在于,包括以下步骤:
提供具有第一掺杂类型的Si衬底;
第一栅极叠层形成步骤,在所述Si衬底上形成第一绝缘介质层,刻蚀所述第一绝缘介质层和所述Si衬底形成U型槽,淀积第一绝缘介质层、第一多晶硅层,对所述第一绝缘介质层和第一多晶硅层进行刻蚀,形成开口,淀积第一多晶硅层,使所述第一多晶硅层在所述开口处与所述Si衬底接触,进行离子注入,形成具有第一掺杂类型的第一多晶硅层作为浮栅;
第二栅极叠层形成步骤,淀积第二绝缘介质层、第二多晶硅层,对所述第二绝缘介质层、第二多晶硅层进行刻蚀,使所述第二绝缘介质层覆盖所述第一掺杂类型的第一多晶硅层表面并延伸至所述Si衬底表面,所述第二多晶硅层覆盖所述第二绝缘介质层,对所述第二多晶硅层进行离子注入,形成具有第一掺杂类型的第二多晶硅层;
栅极侧墙形成步骤,在所述第一、第二栅极叠层两侧形成栅极侧墙;以及
源漏区形成步骤,在所述Si衬底中、所述第一、第二栅极叠层的两侧形成具有第二掺杂类型的SiC源漏区。
7.根据权利要求6所述的高驱动电流半浮栅晶体管制备方法,其特征在于,所述第一、第二绝缘介质层为SiO2。
8. 根据权利要求6所述的高驱动电流半浮栅晶体管制备方法,其特征在于,所述第一种掺杂类型为p 型,所述第二种掺杂类型为n 型;或者,所述第一种掺杂类型为n 型,所述第二种掺杂类型为p 型。
9.根据权利要求7所述的高驱动电流半浮栅晶体管制备方法,其特征在于,通过干氧氧化法形成所述第一绝缘介质层。
10.根据权利要求6所述的高驱动电流半浮栅晶体管制备方法,其特征在于,所述Si衬底为体硅或绝缘体上硅。
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H01L27-15 .包括专门适用于光发射并且包括至少有一个电位跃变势垒或者表面势垒的半导体组件
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