[发明专利]一种N级脉动直流电电荷移位及电压合并整流电路在审
申请号: | 201811450017.1 | 申请日: | 2018-11-30 |
公开(公告)号: | CN109275239A | 公开(公告)日: | 2019-01-25 |
发明(设计)人: | 王森;王勇 | 申请(专利权)人: | 常州拓晶照明科技有限公司 |
主分类号: | H05B33/08 | 分类号: | H05B33/08 |
代理公司: | 昆明润勤同创知识产权代理事务所(特殊普通合伙) 53205 | 代理人: | 曹玉存 |
地址: | 213200 江苏省*** | 国省代码: | 江苏;32 |
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摘要: | |||
搜索关键词: | 电压合并 电荷 脉动直流电 移位 移位单元电路 整流单元电路 整流电路 晶体管 电感 大体积元器件 直流电 脉冲直流电 二极管 电解电容 多组并联 负载电流 滤波电路 一致性好 体积小 电容 顺延 电阻 构建 脉动 集成电路 电路 生产能力 下级 | ||
1.一种N级脉动直流电电荷移位及电压合并整流电路,包括至少N级脉动直流电电荷移位单元电路和至少N+1级电压合并整流单元电路,其中每级脉动直流电电荷移位单元电路由一个电阻、一个电容、一个晶体管组成,每级电压合并整流单元电路由一个二极管和一个晶体管组成。
2.根据权利要求1所述的一种N级脉动直流电电荷移位及电压合并整流电路,其特征在于:所述脉动直流电电荷移位及电压合并整流电路包括一级脉动直流电电荷移位单元电路和二级电压合并整流单元电路,具体包括电阻R2、电容CJ1、二极管D1、D2,晶体管Q1、Q2、Q3,其中电阻R2、电容CJ1、晶体管Q2组成一级脉动直流电电荷移位单元电路,二极管D1、晶体管Q1组成第一级电压合并整流单元电路,二极管D2、晶体管Q3组成第二级电压合并整流单元电路;所述电阻R2的一端、晶体管Q2的源极、以及二极管D1的阳极外接脉动直流电Vin,所述电阻R2的另一端分别连接晶体管Q2的栅极和电容CJ1的一端,所述晶体管Q2的漏极连接电容CJ1的另一端、二极管D2的阳极,所述二极管D1的阴极分别连接晶体管Q1的源极和栅极;所述二极管D2的阴极分别连接晶体管Q3的源极和栅极;所述晶体管Q1的漏极和晶体管Q3的漏极相连接作为输出端Vout。
3.根据权利要求1所述的一种N级脉动直流电电荷移位及电压合并整流电路,其特征在于:所述脉动直流电电荷移位及电压合并整流电路包括九级脉动直流电电荷移位单元电路和十级电压合并整流单元电路,具体电路包括电阻R2、R4、R6、R8、R10、R12、R14、R16、R18,晶体管Q1、Q2、Q3、Q4、Q5、Q6、Q7、Q8、Q9、Q10、Q11、Q12、Q13、Q14、Q15、Q16、Q17、Q18、Q19,电容CJ1、CJ2、CJ3、CJ4、CJ5、CJ6、CJ7、CJ8、CJ9,以及二极管D1、D2、D3、D4、D5、D6、D7、D8、D9、D10;所述电阻R2的一端、晶体管Q2的源极、以及二极管D1的阳极外接脉动直流电Vin,所述电阻R2的另一端分别连接晶体管Q2的栅极和电容CJ1的一端,所述晶体管Q2的漏极连接电容CJ1的另一端、二极管D2的阳极、电阻R4的一端和晶体管Q4的源极,所述二极管D1的阴极分别连接晶体管Q1的源极和栅极;所述二极管D2的阴极分别连接晶体管Q3的源极和栅极;所述电阻R4的另一端分别连接晶体管Q4的栅极和电容CJ2的一端,所述晶体管Q4的漏极连接电容CJ2的另一端、二极管D3的阳极、电阻R6的一端和晶体管Q6的源极,所述二极管D3的阴极分别连接晶体管Q5的源极和栅极;所述电阻R6的另一端分别连接晶体管Q6的栅极和电容CJ3的一端,所述晶体管Q6的漏极连接电容CJ3的另一端、二极管D4的阳极、电阻R8的一端和晶体管Q8的源极,所述二极管D4的阴极分别连接晶体管Q7的源极和栅极;所述电阻R8的另一端分别连接晶体管Q8的栅极和电容CJ4的一端,所述晶体管Q8的漏极连接电容CJ4的另一端、二极管D5的阳极、电阻R10的一端和晶体管Q10的源极,所述二极管D5的阴极分别连接晶体管Q9的源极和栅极;所述电阻R10的另一端分别连接晶体管Q10的栅极和电容CJ5的一端,所述晶体管Q10的漏极连接电容CJ5的另一端、二极管D6的阳极、电阻R12的一端和晶体管Q12的源极,所述二极管D6的阴极分别连接晶体管Q11的源极和栅极;所述电阻R12的另一端分别连接晶体管Q12的栅极和电容CJ6的一端,所述晶体管Q12的漏极连接电容CJ6的另一端、二极管D7的阳极、电阻R14的一端和晶体管Q14的源极,所述二极管D7的阴极分别连接晶体管Q13的源极和栅极;所述电阻R14的另一端分别连接晶体管Q14的栅极和电容CJ7的一端,所述晶体管Q14的漏极连接电容CJ7的另一端、二极管D8的阳极、电阻R16的一端和晶体管Q16的源极,所述二极管D8的阴极分别连接晶体管Q15的源极和栅极;所述电阻R16的另一端分别连接晶体管Q16的栅极和电容CJ8的一端,所述晶体管Q16的漏极连接电容CJ8的另一端、二极管D9的阳极、电阻R18的一端和晶体管Q18的源极,所述二极管D9的阴极分别连接晶体管Q17的源极和栅极;所述电阻R18的另一端分别连接晶体管Q18的栅极和电容CJ9的一端,所述晶体管Q18的漏极连接电容CJ9的另一端、二极管D10的阳极,所述二极管D10的阴极分别连接晶体管Q19的源极和栅极;所述晶体管Q1的漏极、Q3的漏极、Q5的漏极、Q7的漏极、Q9的漏极、Q11的漏极、Q13的漏极、Q15的漏极、Q17的漏极和Q19的漏极相连接作为输出端Vout。
4.根据权利要求2或3所述的一种可集成的电源滤波电路,其特征在于:所述晶体管Q1、Q2、Q3、Q4、Q5、Q6、Q7、Q8、Q9、Q10、Q11、Q12、Q13、Q14、Q15、Q16、Q17、Q18、Q19为N沟道型MOS晶体管。
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