[发明专利]一种用于三维立体封装的叠层PCB结构在审

专利信息
申请号: 201811339853.2 申请日: 2018-11-12
公开(公告)号: CN109413841A 公开(公告)日: 2019-03-01
发明(设计)人: 颜军;王烈洋;龚永红;占连样;黄小虎 申请(专利权)人: 珠海欧比特电子有限公司
主分类号: H05K1/02 分类号: H05K1/02
代理公司: 广州嘉权专利商标事务所有限公司 44205 代理人: 俞梁清
地址: 519080 广东省珠*** 国省代码: 广东;44
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摘要:
搜索关键词: 三维立体封装 叠层 点焊 电装 基板 桥焊 测试 生产效率 返修 电测试 短路 开路 外围 生产
【说明书】:

发明公开了一种用于三维立体封装的叠层PCB结构包括基板和设置在基板上的至少一个测试点焊盘、至少一个引线桥焊盘、至少一个引线桥,所述引线桥的两端连接有所述引线桥焊盘,所述测试点焊盘设置在所述引线桥围成区域的外围,并与外侧的引线桥焊盘通过PCB走线连接。本发明的一种用于三维立体封装的叠层PCB结构,利用基板上的测试点焊盘,在叠层PCB板电装后进行完整的电测试,提前找到电装后PCB板是否存在开路或短路的问题,若有问题则进行电装返修,从而防止三维立体封装模块在工艺后期出现失效,节省成本,大大提高了生产效率和生产质量。

技术领域

本发明涉及印制电路板技术领域,特别涉及一种用于三维立体封装的叠层PCB结构。

背景技术

立体封装,是一项近几年来新兴的一种集成电路封装技术,现有的立体封装方法由以下工艺实现:叠层PCB板电装、叠层板堆叠、树脂灌封成型、切割成形、表面金属化处理、表面连线雕刻。目前,实现的小型化立体封装模块,在设计时,它的上下层互连由叠层PCB板四周的引线桥来实现电气互连。但是往往叠层PCB板的电子线路很是复杂,在电装时如果工艺控制不当或外部环境影响时,容易造成部分线路短路或开路的缺陷,而现有的叠层PCB板只有在立体封装成形后才可以进行电测试,检验电路是否连接正确,此时发现开路或短路的封装模块只能报废,极大浪费人力物力,由此带来的制作成本上升。

发明内容

为了克服上述现有技术的不足,本发明提供了一种用于三维立体封装的叠层PCB结构,应用此叠层PCB结构可以在现用的工艺上增加一道叠层PCB板电测试工艺来保证电装完整性,从而有效的避免了在模块制造后期才能发现电路开路或短路的情况。

本发明解决其技术问题所采用的技术方案为一种用于三维立体封装的叠层PCB结构,包括基板和设置在基板上的至少一个测试点焊盘、至少一个引线桥焊盘、至少一个引线桥,所述引线桥的两端连接有所述引线桥焊盘,所述测试点焊盘设置在所述引线桥围成区域的外围,并与外侧的引线桥焊盘通过PCB走线连接。

进一步,所述基板上还设置有切割外框和放置内框,所述切割外框的边线位置设置在所述引线桥上,所述放置内框设置在所述切割外框内部。

进一步,所述基板上设置有圆孔、凹槽,所述圆孔设置在所述切割外框内部的4个边角上,所述凹槽设置在所述切割外框的边线上。

进一步,所述基板边缘设置有若干通孔,具体的,所述基板左右两侧边缘各设3个通孔,基板4个角上各设置一个通孔。

本发明的有益效果在于:

本发明的一种用于三维立体封装的叠层PCB结构,利用基板上的测试点焊盘,在叠层PCB板电装后进行完整的电测试,提前找到电装后PCB板是否存在开路或短路的问题,若有问题则进行电装返修,从而防止三维立体封装模块在工艺后期出现失效,节省成本,大大提高了生产效率和生产质量。

附图说明

下面结合附图及具体实施例对本发明作进一步说明,其中:

图1是本发明实施例的结构示意图

图2是图1中A部的局部放大图。

具体实施方式

下面将参照附图对本发明的各个优选的实施方式进行描述。提供以下参照附图的描述,以帮助对由权利要求及其等价物所限定的本发明的示例实施方式的理解。其包括帮助理解的各种具体细节,但它们只能被看作是示例性的。因此,本领域技术人员将认识到,可对这里描述的实施方式进行各种改变和修改,而不脱离本发明的范围和精神。而且,为了使说明书更加清楚简洁,将省略对本领域熟知功能和构造的详细描述。

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