[发明专利]3D存储器件有效
申请号: | 201811139628.4 | 申请日: | 2018-09-28 |
公开(公告)号: | CN109192734B | 公开(公告)日: | 2020-10-16 |
发明(设计)人: | 胡斌;肖莉红 | 申请(专利权)人: | 长江存储科技有限责任公司 |
主分类号: | H01L27/11582 | 分类号: | H01L27/11582;H01L27/1157;H01L23/367 |
代理公司: | 北京成创同维知识产权代理有限公司 11449 | 代理人: | 范芳茗;岳丹丹 |
地址: | 430074 湖北省武汉市洪山区东*** | 国省代码: | 湖北;42 |
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摘要: | |||
搜索关键词: | 存储 器件 | ||
1.一种3D存储器件,包括:
栅叠层结构,所述栅叠层结构包括交替堆叠的多个栅极导体和多个层间绝缘层;
多个沟道柱,所述沟道柱贯穿所述栅叠层结构以形成晶体管;以及
多个导电通道,所述导电通道贯穿所述栅叠层结构以提供与外围电路的电连接,
其中,所述多个导电通道的至少一个导电通道连接有散热结构。
2.根据权利要求1所述的3D存储器件,其中,所述多个导电通道的至少一个导电通道内包括散热材料。
3.根据权利要求1所述的3D存储器件,还包括:
第一半导体衬底,所述第一半导体衬底的第一表面与所述栅叠层结构邻接;
位于所述第一半导体衬底的第二表面上的第二绝缘层,所述第一半导体衬底的第二表面与第一表面彼此相对;以及
覆盖所述栅叠层结构的第一绝缘层。
4.根据权利要求3所述的3D存储器件,其中,所述散热结构位于所述第一绝缘层。
5.根据权利要求3所述的3D存储器件,其中,所述散热结构位于所述第二绝缘层。
6.根据权利要求3所述的3D存储器件,还包括:至少部分围绕所述导电通道的绝缘衬里,用于将所述导电通道与所述栅叠层结构和所述第一半导体衬底彼此隔开。
7.根据权利要求3所述的3D存储器件,还包括:位于所述第一半导体衬底中的公共源区,所述导电通道的第一端延伸至所述公共源区,第二端连接至相应的外部焊盘。
8.根据权利要求3所述的3D存储器件,其中,所述导电通道从所述第一绝缘层的表面延伸至所述层间绝缘层的表面,从而提供贯穿接触通孔。
9.根据权利要求5所述的3D存储器件,还包括:位于所述第一绝缘层中的多个布线层,所述导电通道的第一端连接至所述多个布线层的相应布线层,第二端连接所述散热结构。
10.根据权利要求5所述的3D存储器件,还包括:在所述第一绝缘层的表面上横向延伸的凹槽,所述凹槽从所述栅叠层结构的第一侧壁到达第二侧壁,所述导电通道的第一端延伸至所述凹槽,第二端连接所述散热结构。
11.根据权利要求10所述的3D存储器件,还包括:位于所述凹槽中的导热条。
12.根据权利要求3所述的3D存储器件,还包括:
CMOS电路,所述CMOS电路通过连接结构键合至所述栅叠层结构,并且包括:
第二半导体衬底;
位于所述第二半导体衬底中的晶体管;以及
位于所述第二半导体衬底上的第三绝缘层。
13.根据权利要求12所述的3D存储器件,其中,所述栅叠层结构作为存储单元阵列,
所述存储单元阵列中的所述第一绝缘层的表面作为第一键合面,所述栅叠层结构还包括位于所述第一键合面上的第一外部焊盘,
所述CMOS电路中的所述第二绝缘层的表面作为第二键合面,所述CMOS电路还包括位于所述第二键合面上的第二外部焊盘,
其中,所述栅叠层结构的第一键合面与所述CMOS电路的第二键合面彼此接触,所述第一外部焊盘与所述第二外部焊盘彼此键合,从而实现所述栅叠层结构和所述CMOS电路之间的电连接。
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H01L 半导体器件;其他类目中不包括的电固体器件
H01L27-00 由在一个共用衬底内或其上形成的多个半导体或其他固态组件组成的器件
H01L27-01 .只包括有在一公共绝缘衬底上形成的无源薄膜或厚膜元件的器件
H01L27-02 .包括有专门适用于整流、振荡、放大或切换的半导体组件并且至少有一个电位跃变势垒或者表面势垒的;包括至少有一个跃变势垒或者表面势垒的无源集成电路单元的
H01L27-14 . 包括有对红外辐射、光、较短波长的电磁辐射或者微粒子辐射并且专门适用于把这样的辐射能转换为电能的,或适用于通过这样的辐射控制电能的半导体组件的
H01L27-15 .包括专门适用于光发射并且包括至少有一个电位跃变势垒或者表面势垒的半导体组件
H01L27-16 .包括含有或不含有不同材料结点的热电元件的;包括有热磁组件的