[发明专利]一种交织器映射和动态内存管理系统及方法有效
| 申请号: | 201810628634.X | 申请日: | 2018-06-19 |
| 公开(公告)号: | CN108845958B | 公开(公告)日: | 2022-05-17 |
| 发明(设计)人: | 苏航;武延军;赵琛 | 申请(专利权)人: | 中国科学院软件研究所 |
| 主分类号: | G06F12/02 | 分类号: | G06F12/02;G06F12/0802 |
| 代理公司: | 北京科迪生专利代理有限责任公司 11251 | 代理人: | 安丽;成金玉 |
| 地址: | 100190 *** | 国省代码: | 北京;11 |
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| 摘要: | |||
| 搜索关键词: | 一种 交织 映射 动态 内存 管理 系统 方法 | ||
本发明涉及一种交织器映射和动态内存管理系统及方法,包括交织器映射方法和动态内存管理方法;交织器映射方法包括:为经由两个或更多个相应的内存通道访问的两个或更多个内存设备配置内存地址映射使之具有交织区域和线性区域,所述交织区域包括用于高性能使用情况的交织地址空间,以及所述线性区域包括用于低功率使用情况的线性地址空间;从一个或多个客户端接收内存请求,所述内存请求包括对节电或性能的偏好;以及根据所述对节电或性能的偏好来向所述线性区域或所述交织区域分配所述内存请求。
技术领域
本发明实施例涉及内存数据处理技术,尤其涉及一种交织器映射和内存管理系统及方法。
背景技术
许多计算设备(包括诸如移动电话的便携式计算设备)包括片上系统(“SoC”)。SoC向内存设备(诸如,双数据速率(DDR)内存设备)要求不断增加的功率性能和容量。这些要求产生了更快的时钟速度和宽的总线,通常将宽的总线划分为多个较窄的内存通道,以便保持高效率。多个内存通道可以是地址交织在一起的,以在内存设备间均匀地分布内存业务和优化性能。通过向交替的内存通道分配地址来均匀地分布内存数据。这种技术通常被称为对称通道交织。
与对称内存通道交织相对应的普通内存空间排布被称为线性内存通道,在线性内存通道中,地址空间在单一内存通道中连续分布。针对高性能内存,通常使用对称内存通道交织技术,这是有意的并且是必要的以实现所期望的性能水平。针对低性能内存使用场景,线性内存通道则更为常见。
在实际应用场景中,常常出现同时需要使用高性能内存和低性能内存的需求。这对这种需求,现有的技术手段CN201480043948-用于具有选择性功率或性能优化的内存通道交织的系统和方法,通常在系统的初始化期间,通过设置配置文件或硬编码代码的方式,手工地静态划分交织内存空间和线性内存空间的大小,不能根据程序运行的实际情况来动态分配交织内存空间和线性内存空间大小,这导致功率浪费和空间使用上的低效率。因此,本领域中仍然存在对用于提供动态混合内存空间的系统和方法的需求。
发明内容
本发明技术解决问题:克服现有技术的不足,提供一种交织器映射和动态内存管理系统及方法,以解决现有的只能静态划分交织内存空间和线性内存空间的问题,以实现交织内存空间和线性内存空间的动态分配,优化计算机系统性能。
本发明技术解决方案为:一种交织器映射方法和动态内存管理系统,包括片上系统(SoC),内存地址映射和内存通道交织器。所述SoC包括一个或多个处理单元,其用于生成访问两个或更多个外部内存设备的内存请求,所述两个或更多个外部内存设备连接到所述SoC并且经由两个或更多个相应的内存通道来访问。所述内存请求包括对节电或性能的偏好。所述内存地址映射与所述外部内存设备相连接,以及包括交织区域和线性区域。所述交织区域包括用于相对较高的性能使用情况的交织地址空间。所述线性区域包括用于相对较低的功率使用情况的线性地址空间。所述内存通道交织器位于所述SoC上,以及被配置为根据所述对节电或性能的偏好来向所述线性区域或所述交织区域分配所述内存请求。内存通道交织器提供同时访问交织空间和线性空间的支持,使用软件的方法来保证分配出去的两种不同的内存空间不会发生冲突。
本发明的一种交织器映射和动态内存管理方法,包括:为经由两个或更多个相应的内存通道访问的两个或更多个内存设备配置内存地址映射使之具有交织区域和线性区域,所述交织区域包括用于相对较高的性能使用情况的交织地址空间,以及所述线性区域包括用于相对较低的功率使用情况的线性地址空间;从一个或多个客户端接收内存请求,所述内存请求包括对节电或性能的偏好;以及根据所述对节电或性能的偏好来向所述线性区域或所述交织区域分配所述内存请求。本内存管理方法通过改进现有的内存管理算法,避免了线性区域和交织区域在内存分配时出现的空间冲突问题,并实现了混合内存空间的动态分配。
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