[发明专利]降低OFDM系统峰均功率比的加性扰码方法及其发射系统在审

专利信息
申请号: 201810438681.8 申请日: 2018-05-09
公开(公告)号: CN108737315A 公开(公告)日: 2018-11-02
发明(设计)人: 王灵垠;王玉泰;王清;张鲁 申请(专利权)人: 济南大学
主分类号: H04L27/26 分类号: H04L27/26;H04L27/34
代理公司: 济南圣达知识产权代理有限公司 37221 代理人: 董雪
地址: 250022 山东*** 国省代码: 山东;37
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摘要:
搜索关键词: 加性 原始OFDM信号 候选信号 扰码序列 扰码 二进制序列 发生器模块 峰均功率比 发射系统 加权 快速傅里叶逆变换 二进制随机序列 基带频域信号 计算复杂度 加权因子 映射模块 映射 相加 传输
【权利要求书】:

1.一种降低OFDM系统峰均功率比的加性扰码方法,其特征是,包括以下步骤:

利用二进制随机序列发生器模块产生二进制序列,并利用BPSK映射模块将二进制序列映射为基带频域信号序列X;

对序列X进行快速傅里叶逆变换,获得原始OFDM信号x;

利用加性扰码序列发生器模块产生若干个加性扰码序列Si,i=1,2,…,C;

所述利用加性扰码序列发生器模块产生加性扰码序列Si,i=1,2,…,C,包括:

确定OFDM系统和加性扰码方法的相关参数,包括子载波数N、BPSK映射方式和加性扰码序列个数C;

利用二进制随机序列发生器模块产生C个长度为N的二进制序列;

将产生的C个二进制序列利用BPSK映射模块映射为序列Bi,i=1,2,…,C;

对映射后的序列Bi,i=1,2,…,C分别进行IFFT变换获得序列bi,i=1,2,…,C;

利用加权因子h分别对序列bi,i=1,2,…,C进行加权获得加性扰码序列Si,i=1,2,…,C,其中可表示为

Si=hbi,i=1,2,…,C

利用加权因子a对原始OFDM信号x进行加权,然后分别与每个加性扰码序列进行相加,获得若干个不同的OFDM候选信号yi,i=1,2,…,C;

从全部的OFDM候选信号中,选择PAPR值最小的候选信号进行传输。

2.根据权利要求1所述的降低OFDM系统峰均功率比的加性扰码方法,其特征是,所述利用加权因子a对原始OFDM信号x进行加权,然后分别与每个加性扰码序列进行相加,获得若干个不同的OFDM候选信号yi,i=1,2,…,C,包括:

利用加权因子a对原始OFDM信号x进行加权,其中

将加权后的OFDM信号x分别与每个加性扰码序列进行相加产生OFDM候选信号yi,i=1,2,…,C,可表示为

yi=ax+Si,i=1,2,…,C。

3.一种用于实现降低OFDM系统峰均功率比加性扰码方法的发射系统,其特征是,包括:

二进制随机序列发生器模块,用于产生二进制序列,并将其送入BPSK映射模块;

BPSK映射模块,用于将二进制序列映射为基带频域信号序列X,并将映射后的基带频域信号序列X送入IFFT模块;

IFFT模块,用于对基带频域信号序列X进行快速傅里叶逆变换,获得OFDM原始信号x,并将OFDM原始信号x送至加权模块a;

加权模块a,用于对原始OFDM信号进行加权,即将原始OFDM信号与加权因子a相乘,并将加权后的OFDM原始信号送入加法器模块;

加法器模块,用于将加权后的原始OFDM信号与每个加性扰码序列相加完成加扰过程,加法器模块同时与加性扰码序列发生器模块和最优候选信号选择模块相连接;

加性扰码序列发生器模块,用于产生加性扰码序列;

所述的加性扰码序列发生器模块,包括:

加性扰码序列二进制随机序列发生器模块,用于产生C个二进制序列,并将其送入加性扰码序列BPSK映射模块;

加性扰码序列BPSK映射模块,用于将C个二进制序列映射为序列Bi,i=1,2,…,C,并将映射后的序列Bi,i=1,2,…,C送入IFFT模块;

加性扰码序列IFFT模块,用于对映射后的序列Bi,i=1,2,…,C进行快速傅里叶逆变换,得到序列bi,i=1,2,…,C,并将序列bi,i=1,2,…,C送至加权模块h;

加权模块h,用于对序列bi,i=1,2,…,C进行加权产生加性扰码序列Si,i=1,2,…,C,即将加权因子h分别与序列bi,i=1,2,…,C相乘;

所述加性扰码序列二进制随机序列发生器模块与加性扰码序列BPSK映射模块相连接,所述加性扰码序列BPSK映射模块与加性扰码序列IFFT模块相连接,所述加性扰码序列IFFT模块与加权模块h连接;

最优候选信号选择模块,用于从所产生的全部OFDM候选信号中选出PAPR值最小的候选信号;

所述二进制随机序列发生器模块与BPSK映射模块相连接,所述BPSK映射模块与IFFT模块相连接,所述IFFT模块与加权模块a连接,所述的加权模块a与加法器模块相连接,所述的加法器模块同时与加性扰码序列发生器模块和最优候选信号选择模块相连接。

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