[发明专利]一种交直流B码自适应解析装置及方法有效
申请号: | 201810365531.9 | 申请日: | 2018-04-23 |
公开(公告)号: | CN108572544B | 公开(公告)日: | 2020-05-19 |
发明(设计)人: | 汤湘伟;夏继钢;王红敏;闫双山;朱文超;王轶;季静;经林;夏慧倩 | 申请(专利权)人: | 中电科技扬州宝军电子有限公司 |
主分类号: | G04G7/00 | 分类号: | G04G7/00 |
代理公司: | 北京轻创知识产权代理有限公司 11212 | 代理人: | 谈杰 |
地址: | 225003 *** | 国省代码: | 江苏;32 |
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摘要: | |||
搜索关键词: | 一种 直流 自适应 解析 装置 方法 | ||
1.一种交直流B码自适应解析方法,其特征在于:采用交直流B码自适应解析装置进行解析,所述交直流B码自适应解析装置包括电源模块、B码处理模块、背板模块和显控模块;
所述电源模块,通过所述背板模块对各模块进行供电,所述电源模块包括顺次连接的电源保护电路、直流滤波器、第一开关控制电路、第一DC/DC模块、第二开关控制电路,所述电源模块的第一DC/DC模块与第二开关控制电路之间设置有温控电路,所述温控电路包括热敏电阻、电压比较器以及MOS管,当环境温度到达75-85℃时,通过第二开关控制电路关闭电压输出,避免高温工作时设备发生损坏;
所述B码处理模块,通过所述背板模块与所述显控模块相连,所述B码处理模块包括顺次连接的变压器、数控衰减器和AD采集芯片和交直流转换电路,所述交直流转换电路相互连接FPGA处理电路,所述FPGA处理电路相互连接ARM处理电路,所述FPGA处理电路的输入端连接电平转换电路,输出端连接所述数控衰减器,所述电平转换电路的输入端连接保护电路;
所述背板模块,通过板载的高速插座将上述各模块之间互联;
所述显控模块,通过所述背板模块与所述B码处理模块相连,包括信息处理模块及显示模块,所述信息处理模块用于接收各模块的状态及所需要显示的信息,所述显示模块用于显示所述信息处理模块所接收的B码解析的时间以及状态信息;
所述交直流B码自适应解析装置还包括交换机模块,所述交换机模块包括8网口的扩展,所述交换机模块的其中5个网口通过所述背板模块与各模块互联,另外3个网口用来完成与外部设备的数据通信;
所述电源模块的第二控制电路的输出端设置有第二DC/DC模块和第三DC/DC模块,用于后续扩展交流B码输出功能;
所述显示模块为低温串口液晶显示模块;
所述交直流B码自适应解析装置进行解析的具体步骤如下:
步骤一、高电平时间统计:对输入的直流信号进行高电平计时,得到2ms、5ms、8ms的冗余计数;
步骤二、整秒验证:对整秒时刻的8ms进行判断验证,通过则表明输入信号有效,将解析的秒脉冲进行延时参数修正,从而得到正确的秒脉冲信号,同时将计时得出的计数写入FPGA处理电路的FIFO空间进行数据缓存,并通知ARM处理电路进行读取解析;
步骤三、ARM处理电路根据B码的标准协议完成信息层的解析,并将时间数据通过背板模块发送给显控模块及外部设备;
所述输入的直流信号为交流B码输入生成的直流信号,具体过程为:从外部输入的交流B码进入变压器进行隔离后进入数控衰减器进行幅度自适应控制;然后进入AD采集芯片进行交流信号数据的采集;对交流信号通过信号调理电路进行信号调理,通过FPGA处理电路内部采样的AD数据,判断采样值是否超过设定的最大门限,如果超过,控制数控衰减器增加衰减,直至满足幅度要求;如果峰值过小,控制数控衰减器减小衰减量,直至幅度满足要求或者衰减量到达最小为止,使AD采样值始终处于最佳值域;然后将调整后的采样值进行运算得到零位电压及高低电平判决门限,从而根据零位电压估计出输入信号的过零点及峰值位置,在峰值时刻根据判决门限能够将采样的交流B码信号转换为直流B码信号,并且根据峰值位置处的采样值判断出输入信号的极性是否正确,若极性不一致则将得到的直流B码信号进行反向即可。
2.根据权利要求1所述的一种交直流B码自适应解析方法,其特征在于:所述输入的直流信号为直流B码输入生成的直流信号,具体过程为:从外部输入的直流B码信号通过保护电路及电平转换电路后送入FPGA处理电路进行处理。
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