[发明专利]多路服务器及其信号处理方法有效

专利信息
申请号: 201810192556.3 申请日: 2014-12-16
公开(公告)号: CN108345562B 公开(公告)日: 2022-03-29
发明(设计)人: 程龙飞 申请(专利权)人: 超聚变数字技术有限公司
主分类号: G06F15/163 分类号: G06F15/163
代理公司: 深圳市深佳知识产权代理事务所(普通合伙) 44285 代理人: 王仲凯
地址: 450046 河南省郑州市郑*** 国省代码: 河南;41
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摘要:
搜索关键词: 服务器 及其 信号 处理 方法
【说明书】:

发明公开了一种多路服务器及其信号处理方法,所述多路服务器包括多个CPU、多个PBI板,以及关键信号处理板,每个PBI板监控至少两个CPU。各个PBI板的输出端分别连接关键信号处理板的输入端,各个PBI板的输入端分别连接关键信号处理板的输出端。所述多路服务器通过关键信号处理板接收各个PBI板发出的关键信号,然后,同时向相应的PBI板发送与所述关键信号对应的回应信号,从而保证CPU收到的回应信号满足多路服务器的要求。由上述内容可知,各个PBI板直接与关键信号处理板连接,不需要切换开关进行串联,减少切换开关的数量,结构简单、可靠性高。而且减少了信号所经过的切换开关的数量,提高了信号质量。

技术领域

本发明涉及服务器技术领域,特别是涉及一种多路服务器及其信号处理方法。

背景技术

多路服务器是指服务器内物理CPU的数量有多个,服务器中物理CPU的数量决定服务器中“多路”的数量,例如,服务器中包含16个物理CPU,则为16路服务器。多路服务器中物理CPU的数量越多,其处理数据的能力越高,因此,16路和32路的服务器成为多路服务器的发展趋势。

若实现32路服务器,必须实现32路内信号全互联,且对时序要求极为严格。例如,在多路服务器开机时,所有的CPU收到表示电源正常的Powergood信号的时间差必须监控在10ns以内,并记录该时刻为T0;在实现CPU热插拔、online或offline时,新上线的CPU(IntelIvybridge处理器)收到Powergood的信号时间必须为T0+864bclks(若采用Intel Haswell处理器,则为T0+384bclks)。而Intel公司只给出了8路及以下的服务器中关键信号(例如,Caterr、PMSYNC、Powergood、TSC等信号)的处理方式,对于8路以上的服务器没有给出任何推荐方案。

假设采用Intel给出的8路服务器对关键信号的处理方式实现16路及以上的服务器,由于8路服务器是通过切换开关将不同基本单板(每个基本单板上设置有多个CPU,所述单板上的CPU数量是最小硬分区的单位)串联在一起,需要切换开关数量多,当传递关键信号时,需要控制相应的切换开关联动才能实现,实现过程极其复杂、可靠性差,且经过多级带有内阻的切换开关后,信号质量变得很差。

发明内容

本发明实施例中提供了一种多路服务器及其信号处理方法,以解决现有技术中的方案复杂、可靠性差集信号质量差的问题。

为了解决上述技术问题,本发明实施例公开了如下技术方案:

第一方面,本发明提供一种多路服务器,包括:多个CPU、多个南桥基板管理监控器输入输出PBI板,以及关键信号处理板,其中,一个PBI板监控至少两个CPU;

所述PBI板连接自身监控的CPU;

各个PBI板的输出端连接所述关键信号处理板的输入端,各个PBI板的输入端连接所述关键信号处理板的输出端,所述关键信号处理板接收所述PBI板发送的关键信号,并向所述PBI板返回与所述关键信号相对应的回应信号;

接收到所述回应信号的PBI板将所述回应信号分别发送给自身监控的CPU。

结合第一方面,在第一方面的第一种可能的实现方式中,所述关键信号处理板接收所述PBI板发送的关键信号,并向所述PBI板返回与所述关键信号相对应的回应信号,包括:

当所述多路服务器作为一个服务器进行上电时,所述关键信号处理板接收到所述多路服务器内的全部PBI板分别发送的第一类电源上电信号后,同时向所述全部PBI板发送作为与所述第一类电源上电信号相对应的回应信号的第二类电源上电信号,以使所述多路服务器内的全部CPU接收到第二类电源上电信号的时间差满足预设时间要求;

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