[发明专利]数据处理设备和用于制造该设备的方法有效
| 申请号: | 201780041261.X | 申请日: | 2017-06-15 |
| 公开(公告)号: | CN109416634B | 公开(公告)日: | 2023-07-18 |
| 发明(设计)人: | 托马斯·克里斯多夫·格鲁卡特 | 申请(专利权)人: | ARM有限公司 |
| 主分类号: | G06F9/30 | 分类号: | G06F9/30 |
| 代理公司: | 北京东方亿思知识产权代理有限责任公司 11258 | 代理人: | 林强 |
| 地址: | 英国*** | 国省代码: | 暂无信息 |
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| 摘要: | |||
| 搜索关键词: | 数据处理 设备 用于 制造 方法 | ||
1.一种数据处理设备,其包含:
一组向量寄存器,每个向量寄存器被布置为存储包括多个部分的向量,所述一组向量寄存器在逻辑上被划分为多列以使得每个向量跨过所述多列中不止一列分布,其中每列被布置为存储各向量的一部分,所述一部分在各向量中的位置是相同的;以及
寄存器存取电路,用于存取所述各向量的一部分中的每一者,所述寄存器存取电路包括多个存取块,每个存取块能够存取所述各向量的一部分的子集,其中
能够由每个存取块存取的所述各向量的一部分的子集包括在不同列和不同向量寄存器中的部分;并且
所述寄存器存取电路被布置为同时存取以下任一项中的多个被存取部分:所述向量寄存器之一和所述列之一。
2.根据权利要求1所述的设备,其中,所述一组向量寄存器包括至少一个区段,其中,每个区段包括不同的列;以及
该设备包括用于每个区段的寄存器存取电路,每个寄存器存取电路被布置为存取与该寄存器存取电路相关联的区段中的部分。
3.根据权利要求2所述的设备,其中,每个存取块被布置为当存取所述向量寄存器之一时而不是当存取数量等于每个区段中包括的列数减一的多个其他向量寄存器时,存取不同列中的部分。
4.根据权利要求1至3中任一项所述的设备,其中,第一存取块被布置为存取第一向量寄存器的第一列并存取第二向量寄存器的第二列;并且第二存取块被布置为存取所述第一向量寄存器的第二列并存取所述第二向量寄存器的第一列。
5.根据权利要求2至3中任一项所述的设备,其中,每个区段在逻辑上被划分为N列;
所述N列在逻辑上被布置为具有log2(N)等级的嵌套结构,其中N大于或等于4并且是2的整数次幂;
在第一等级,所述N列在第一等级的第一组的至少一列与第一等级的第二组的至少一列之间被相等地分割;
每个父等级中的每组的至少一列被相等地再次分割为针对对应子等级的第一组的至少一列和针对该对应子等级的第二组的至少一列;
针对每个向量寄存器配置每个存取块以访问一列,该一列通过以下约束被唯一地标识:针对每个等级,在针对预定数量的向量寄存器的一半访问第二组的至少一列之前,针对预定数量的向量寄存器的一半访问第一组的至少一列;以及
预定数量等于2X,其中X在每个等级上不同并且在1到log2(N)的范围内。
6.根据权利要求5所述的设备,其中,所述一组向量寄存器包括2个区段;并且
N的值为4。
7.根据权利要求1至3中任一项所述的设备,其中,所述寄存器存取电路包括用于输出存储在所述向量寄存器中的数据元素的读取存取电路;以及
所述寄存器存取电路包括用于将数据元素输入到所述向量寄存器的写入存取电路。
8.根据权利要求7所述的设备,其中,所述读取存取电路包括用于所述多列中的每列的一个存取块。
9.根据权利要求7所述的设备,其中,所述读取存取电路包括用于所述多列中的每列的至多一个存取块。
10.根据权利要求7所述的设备,其中,所述读取存取电路中的所述存取块包括多路器。
11.根据权利要求7所述的设备,其中,所述一组向量寄存器包括至少一个区段,其中每个区段包括不同的列;
该设备包括用于每个区段的寄存器存取电路,每个寄存器存取电路被布置为存取与该寄存器存取电路相关的区段中的部分;以及
对于每个区段,所述读取存取电路包括用于重新排列来自所述读取存取电路中的每个存取块的输出的重新排列电路。
12.根据权利要求11所述的设备,其中,所述重新排列电路是交叉多路器。
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