[发明专利]用于多核处理器的同步操作的方法有效

专利信息
申请号: 201780038482.1 申请日: 2017-06-01
公开(公告)号: CN109313581B 公开(公告)日: 2022-06-24
发明(设计)人: U.埃克尔曼-温特 申请(专利权)人: 西门子交通有限公司
主分类号: G06F9/50 分类号: G06F9/50;G06F11/16;G06F9/54
代理公司: 北京市柳沈律师事务所 11105 代理人: 孙宛晨;张贵东
地址: 德国*** 国省代码: 暂无信息
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摘要:
搜索关键词: 用于 多核 处理器 同步 操作 方法
【权利要求书】:

1.一种用于多个多核处理器(MC1,MC2)的同步操作的方法,具有如下步骤:

a)提供第一多核处理器(MC1)和第二多核处理器(MC2),每个包括:

-主处理器内核(A1,A2),

-用于执行实用程序的至少一个二级处理器内核(B1,B2,B3,B4);

b)第一多核处理器(MC1)与第二多核处理器(MC2)以这种方式同步,使得仅第一多核处理器(MC1)的相应的主处理器内核(A1)与第二多核处理器(MC2)的主处理器内核(A2)同步;

c)借助于每个多核处理器(MC1,MC2)中的相应的主处理器内核(A1,A2)控制至少一个二级处理器内核(B1,B2,B3,B4);

d)借助于至少一个二级处理器内核(B1,B2,B3,B4)处理实用程序,并生成对相同的多核处理器(MC1,MC2)的相应的主处理器内核(A1,A2)可用的输出;以及

e)借助于相应的主处理器内核(A1,A2)同步输出来自多个多核处理器(MC1,MC2)的输出。

2.如权利要求1所述的方法,其中输入/输出仅经由相应的主处理器内核(A1,A2)进行。

3.如前述权利要求之一所述的方法,其中主处理器内核(A1,A2)和至少一个二级处理器内核(B1,B2,B3,B4)之间的通信借助于经由共享存储器(MC1,MC2)的消息产生。

4.如权利要求1或2所述的方法,其中主处理器内核(A1,A2)将时钟时间增量(I1,I2)传送到相应的多核处理器(MC1,MC2)的至少一个相应的二级处理器内核(B1,B2,B3,B4)。

5.如权利要求1或2所述的方法,其中在实用程序或操作系统中实现重复的系统调用。

6.如权利要求5所述的方法,其中,在相应的至少一个二级处理器内核(B1,B2,B3,B4)中的系统调用执行第一处理阶段,在第一处理阶段中,执行至少一个二级处理器内核(B1,B2,B3,B4)与相应的主处理器内核(A1,A2)之间的消息的接收和发送,并且在这种情况下中断第二处理阶段,在第二处理阶段中,在至少一个二级处理器内核中执行实用程序。

7.如权利要求6所述的方法,其中第一处理阶段在同步时间点执行在至少一个二级处理器内核(B1,B2,B3,B4)和相应的主处理器内核(A1,A2)之间的消息的接收和发送。

8.如前述权利要求6或7之一所述的方法,其中,第一处理阶段基于在两个时钟时间增量(I1,I2)之间计数的系统调用,在对每个主处理器内核(A1,A2)的至少一个二级处理器内核(B1,B2,B3,B4)中的时钟时间增量(I1,I2)的反应中生成延迟。

9.如前述权利要求1和2之一所述的方法,其中,在二级处理器(B1,B2,B3,B4)中执行实用程序,并且其输出在大于实用程序的运行时间的延迟时间之后被同步地传送到主处理器内核(A1,A2)。

10.如权利要求1或2所述的方法,其中至少一个二级处理器内核(B1,B2,B3,B4)被设计为超线程内核。

11.一种多核处理器系统(10),包括多个多核处理器(MC1,MC2),每个多核处理器包括:

-主处理器内核(A1,A2),以及

-用于执行实用程序的至少一个二级处理器内核(B1,B2,B3,B4),

其特征在于

所述多核处理器系统(10)被设计成执行如前述权利要求之一所述的用于多个多核处理器(MC1,MC2)的同步操作的方法。

12.一种计算机程序,一旦将其加载到数据处理设备的存储器装置中,就使所述数据处理设备能够执行如权利要求1至10之一所述的用于多个多核处理器(MC1,MC2)的同步操作的方法。

13.一种用于存储程序的计算机可读存储介质,所述程序一旦被加载到数据处理设备的存储器装置中,就使所述数据处理设备能够执行如权利要求1至10之一所述的用于多个多核处理器(MC1,MC2)的同步操作的方法。

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