[实用新型]一种基于PCIE结构的双网口数据聚合接收装置有效
| 申请号： | 201721925178.2 | 申请日： | 2017-12-29 |
| 公开（公告）号： | CN207652460U | 公开（公告）日： | 2018-07-24 |
| 发明（设计）人： | 夏传玉;肖金明;张乐乐;王辉;李阳;方春伟;李一峰 | 申请（专利权）人： | 烟台易尚电子科技有限公司 |
| 主分类号： | H04L12/28 | 分类号： | H04L12/28 |
| 代理公司： | 烟台上禾知识产权代理事务所(普通合伙) 37234 | 代理人： | 刘志毅 |
| 地址： | 264000 山东省烟台市*** | 国省代码： | 山东;37 |
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| 摘要： | |||
| 搜索关键词： | 数据聚合 控制逻辑 网口 接口芯片 千兆网 两路 双网 本实用新型 逻辑连接 数据传送 依次连接 总线 外接 | ||
1.一种基于PCIE结构的双网口数据聚合接收装置，其特征在于，包括：FPGA、第一路千兆网接口芯片、第二路千兆网接口芯片、SDRAM以及EEPROM，其中，
所述FPGA包括：第一LAN数据接收逻辑、第二LAN数据接收逻辑、SDRAM控制逻辑及数据聚合逻辑、网口MAC IP配置逻辑以及PCI-E IP，其中，所述第一LAN数据接收逻辑、第二LAN数据接收逻辑皆连接至所述SDRAM控制逻辑及数据聚合逻辑，所述SDRAM控制逻辑及数据聚合逻辑连接至所述PCI-E IP；所述第一LAN数据接收逻辑、第二LAN数据接收逻辑亦皆连接至所述网口MAC IP配置逻辑，所述网口MAC IP配置逻辑亦连接至所述PCI-E IP；所述PCI-EIP通过PCI-E总线与外接PC进行数据传送；所述网口MAC IP配置逻辑还与所述EEPROM相连接，所述SDRAM控制逻辑及数据聚合逻辑还与所述SDRAM相连接；
所述第一路千兆网接口芯片中设有依次连接的：第一RJ45、第一88E1111以及第一AX88180，所述第一AX88180连接至所述FPGA中的第一LAN数据接收逻辑；
所述第二路千兆网接口芯片中设有依次连接的：第二RJ45、第二88E1111以及第二AX88180，所述第二AX88180连接至所述FPGA中的第二LAN数据接收逻辑；
两路千兆网接口芯片中的RJ45、88E1111及AX88180相同。
2.根据权利要求1所述的基于PCIE结构的双网口数据聚合接收装置，其特征在于，所述FPGA为Altera Cyclone IV EP4CGX150DF31C7N芯片。
3.根据权利要求1或2所述的基于PCIE结构的双网口数据聚合接收装置，其特征在于，所述SDRAM为MT48LC4M32B2。
4.根据权利要求1或2所述的基于PCIE结构的双网口数据聚合接收装置，其特征在于，所述EEPROM为AT24C64。
5.根据权利要求1或2所述的基于PCIE结构的双网口数据聚合接收装置，其特征在于，所述PCI-E IP采用PCI-E x4模式。
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