[实用新型]一种周界入侵防护系统有效

专利信息
申请号: 201721239487.4 申请日: 2017-09-26
公开(公告)号: CN207302264U 公开(公告)日: 2018-05-01
发明(设计)人: 赵麟杰;钱伟勇;李士寒;刘伟;宋培城 申请(专利权)人: 中国铁路通信信号上海工程局集团有限公司;上海中铁通信信号测试有限公司
主分类号: G08B13/12 分类号: G08B13/12;G08B13/181
代理公司: 上海金盛协力知识产权代理有限公司31242 代理人: 王松
地址: 200436 *** 国省代码: 上海;31
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摘要:
搜索关键词: 一种 周界 入侵 防护 系统
【权利要求书】:

1.一种周界入侵防护系统,其特征在于,所述周界入侵防护系统包括:高清摄像机、振动光纤探测设备、电子围栏探测设备、光波对射探测设备、声光电报警设备、中心服务器、管理终端;

所述中心服务器分别连接高清摄像机、振动光纤探测设备、电子围栏探测设备、光波对射探测设备、声光电报警设备;

所述管理终端分别连接高清摄像机、振动光纤探测设备、电子围栏探测设备、光波对射探测设备、声光电报警设备;

所述振动光纤探测设备包括监控器、主控仪、传感器、传感光缆和外部组件;其中,监控器、主控仪位于监控室内,引导光缆、传感光缆和外部组件安装于室外;

所述电子围栏探测设备用以对入侵时产生的脉冲信号进行探测;电子围栏探测设备包括电子围栏主机、前端配件、后端控制单元,后端控制单元连接电子围栏主机,电子围栏主机连接前端配件;

所述光波对射探测设备用以使用光波对射对入侵进行探测;光波对射探测设备包括光波发射器、光波接收器,光波发射器用来发送光波信号,光波接收器用来接收所述光波发射器发射的光波信号;所述声光电报警设备用以发出报警信号。

2.根据权利要求1所述的周界入侵防护系统,其特征在于:

所述振动光纤探测设备包括监控器、主控仪、传感器、传感光缆和外部组件;其中,监控器、主控仪位于监控室内,引导光缆、传感光缆和外部组件安装于室外。

3.根据权利要求1所述的周界入侵防护系统,其特征在于:

所述中心服务器通过无线通讯的方式分别连接高清摄像机、振动光纤探测设备、电子围栏探测设备、光波对射探测设备、声光电报警设备。

4.根据权利要求1所述的周界入侵防护系统,其特征在于:

所述管理终端通过无线通讯的方式分别连接高清摄像机、振动光纤探测设备、电子围栏探测设备、光波对射探测设备、声光电报警设备。

5.根据权利要求1所述的周界入侵防护系统,其特征在于:

所述周界入侵防护系统还包括现场告警模块,用于告警信息的采集控制和传输。

6.根据权利要求1所述的周界入侵防护系统,其特征在于:

所述周界入侵防护系统包括主控电路,主控电路包括通信控制电路、信号采集电路、信号转换电路、信号输出电路、指示灯电路;信号采集电路连接信号转换电路,通信控制电路分别连接信号转换电路、信号输出电路、指示灯电路。

7.根据权利要求6所述的周界入侵防护系统,其特征在于:

所述通信控制电路包括第二芯片U2、第三芯片U3、第一晶振Y1、第五芯片U5、第六芯片U6、第九芯片U9、第十一芯片U11、第十二芯片U12、第十六芯片U16、第十七芯片U17、第十八芯片U18、第十九芯片U19、第二十芯片U20、第三十六电阻R36、第三十七电阻R37、第三十八电阻R38、第三十九电阻R39、第四十电阻R40、第四十一电阻R41、第四十三电阻R43;

其中第十二芯片U12为8位两端口的总线开关驱动芯片,第十一芯片U11、第十二芯片U12为8路同相三态双向总线收发器,能双向传输数据,作为信号驱动器使用,第二芯片U2、第三芯片U3为串行通信控制器,实现局域网协议,也是一种独立的CAN总线控制器,通过并行总线与Intel和Motrorola的控制器接口;支持CAN规程2.0B标准,具有接收和发送功能并可完成报文滤波;

第十二芯片U12的第二引脚、第三引脚、第四引脚、第五引脚、第六引脚、第七引脚、第八引脚、第九引脚对应连接至第一接口J1的第六十九引脚、第七十一引脚、第七十三引脚、第七十五引脚、第七十七引脚、第七十九引脚、第八十一引脚、第八十三引脚上,第十二芯片U12的第十引脚接地,第十二芯片U12的第二十引脚接电源VCC,第十二芯片U12的第十一引脚、第十二引脚、第十三引脚、第十四引脚、第十五引脚、第十六引脚、第十七引脚、第十八引脚对应连接至第十一芯片U11的第二引脚、第三引脚、第四引脚、第五引脚、第六引脚、第七引脚、第八引脚、第九引脚上;

第十一芯片U11的第十引脚接地,第十一芯片U11的第二十引脚接电源VCC,第一芯片U1的第五引脚连接至第十八芯片U18的第十引脚上,第一芯片U1的第八十二引脚连接至第十八芯片U18的第十三引脚上,第十八芯片U18的第十引脚连接至第二十一芯片U21的第一引脚上,第十八芯片U18的第十二引脚连接至第二十一芯片U21的第二引脚上,第二十一芯片U21的第三引脚连接至第十七芯片U17的第十三引脚上,第十七芯片U17的第十二引脚连接至第十一芯片U11的第十九引脚上;

第十一芯片U11的第十一引脚、第十二引脚、第十三引脚、第十四引脚、第十五引脚、第十六引脚、第十七引脚、第十八引脚分别对应连接至第二芯片U2的第三十一引脚、第三十二引脚、第三十三引脚、第三十四引脚、第三十五引脚、第三十六引脚、第三十七引脚、第三十八引脚,同时对应连接至第三芯片U3的第三十一引脚、第三十二引脚、第三十三引脚、第三十四引脚、第三十五引脚、第三十六引脚、第三十七引脚、第三十八引脚,第三排阻RN3的第一引脚接地,第三排阻RN3的第二引脚、第三引脚、第四引脚、第五引脚、第六引脚、第七引脚、第八引脚、第九引脚对应连接至第三芯片U3的第三十一引脚、第三十二引脚、第三十三引脚、第三十四引脚、第三十五引脚、第三十六引脚、第三十七引脚、第三十八引脚;

第九芯片U9的第二引脚、第三引脚、第四引脚、第五引脚、第六引脚、第七引脚、第八引脚、第九引脚对应连接至第一接口J1的第十三引脚、第十五引脚、第十七引脚、第十九引脚、第二十一引脚、第二十三引脚、第二十五引脚、第二十七引脚上,第九芯片U9的第十引脚接地,第九芯片U9的第二十引脚连接至电源VCC,第九芯片U9的第十一引脚、第十二引脚、第十三引脚、第十四引脚、第十五引脚、第十六引脚、第十七引脚、第十八引脚对应连接至第三芯片U3的第四引脚、第三引脚、第二引脚、第四十三引脚、第四十二引脚、第四十一引脚、第四十引脚、第三十九引脚上,同时对应连接至第二芯片U2的第四引脚、第三引脚、第二引脚、第四十三引脚、第四十二引脚、第四十一引脚、第四十引脚、第三十九引脚上,第二芯片U2的第一引脚连接至电源VCC,第二芯片U2的第二十引脚、第二十三引脚接地,第三十七电阻R37连接至第二芯片U2的第十八引脚与第一晶振Y1的第一引脚之间,第一晶振Y1的第四引脚连接电源VCC,第一晶振Y1的第二引脚接地,第三十九电阻R39连接至电源VCC与第二芯片U2的第四十四引脚上;

第二芯片U2的第四十四引脚与第三十引脚相连接同时与第三芯片U3的第四十四引脚、第三十引脚连接,第二芯片U2的第二十九引脚连接至第一芯片U1的第二十三引脚上,同时连接至第三芯片U3的第二十九引脚上,第三十六电阻R36连接至第二芯片U2的第二十四引脚与电源VCC之间,第二芯片U2的第二十六引脚连接至第四接口J4的第二十二引脚上,第二芯片U2的第二十五引脚连接至第四接口J4的第二十一引脚上,第二芯片U2的第二十四引脚连接至第一芯片U1的第二十五引脚上,第二芯片U2的第二十一引脚、第二十二引脚连接至第四接口J4的第二十三引脚、第二十四引脚上,第三十八电阻R38连接至第三芯片U3的第十八引脚与第一晶振Y1的第一引脚之间,第三芯片U3的第一引脚接电源VCC;

第三芯片U3的第二十引脚、第二十三引脚接地,第四十三电阻R43连接至电源VCC与第三芯片U3的第二十四引脚之间,第三芯片U3的第二十四引脚连接至第一芯片U1的第十五引脚上,第三芯片U3的第二十一引脚、第二十二引脚、第二十五引脚、第二十六引脚对应连接至第三接口J3的第二十三引脚、第二十四引脚、第二十一引脚、第二十二引脚上;

第六芯片U6的第八引脚接地,第六芯片U6的第十六引脚接电源VCC,第六芯片U6的第十三引脚连接至第三芯片U3的第八引脚上,第六芯片U6的第一引脚连接至第十六芯片U16的第三引脚上;

第十八芯片U18的第五引脚连接至第三芯片U3的第九引脚上,第四十一电阻R41连接至电源VCC与第十八芯片U18的第五引脚之间,第十八芯片U18的第六引脚连接至第二十芯片U20的第五引脚之间;第二十芯片U20的第四引脚连接至第一芯片U1的第四引脚上,第二十芯片U20的第六引脚连接至第十九芯片U19的第九引脚上;第十九芯片U19的第八引脚连接至第二十芯片U20的第二引脚上,第十八芯片U18的第九引脚连接至第二芯片U2的第九引脚上,第十八芯片U18的第八引脚连接至第二十芯片U20的第九引脚上;第二十芯片U20的第十引脚连接至第一芯片U1的第八十二引脚上,第二十芯片U20的第八引脚连接至第十九芯片U19的第十引脚上;第十九芯片U19的第五引脚连接至第十一芯片U11的第一引脚上,第十九芯片U19的第四引脚连接至第一芯片U1的第三十八引脚上,第十九芯片U19的第六引脚连接至第十六芯片U16的第十引脚同时连接至第十六芯片U16的第一引脚与第二十芯片U20的第一引脚上,第十六芯片U16的第二引脚连接至第一芯片U1的第五引脚上,第二十芯片U20的第三引脚连接至第一芯片U1的第十四引脚上;

第十六芯片U16的第九引脚连接至第一芯片U1的第八十二引脚上,第十六芯片U16的第八引脚连接至第五芯片U5的第一引脚上;

第五芯片U5的第八引脚接地,第五芯片U5的第十六引脚接电源VCC,第五芯片U5的第十三引脚连接至第十九芯片U19的第十三引脚同时连接至第二芯片U2的第八引脚上;第十九芯片U19的第十二引脚连接至第一芯片U1的第三十八引脚上,第十九芯片U19的第十一引脚连接至第十六芯片U16的第十三引脚上;第十六芯片U16的第十一引脚连接至第二芯片U2的第七引脚上;第十九芯片U19的第二引脚连接至第三芯片U3的第八引脚,第十九芯片U19的第一引脚连接至第一芯片U1的第三十八引脚上,第十九芯片U19的第三引脚连接至第十六芯片U16的第四引脚上,第十六芯片U16的第六引脚连接至第三芯片U3的第七引脚上。

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