[实用新型]反应堆控制棒棒位格莱码发生装置有效
申请号: | 201720455960.6 | 申请日: | 2017-04-27 |
公开(公告)号: | CN206993093U | 公开(公告)日: | 2018-02-09 |
发明(设计)人: | 程星福;赵大威;张曙光;张洪伟;郑鹏尚;赵灿松 | 申请(专利权)人: | 中广核研究院有限公司北京分公司;中国广核集团有限公司;中国广核电力股份有限公司 |
主分类号: | H03M7/16 | 分类号: | H03M7/16;H03K23/40 |
代理公司: | 北京华夏正合知识产权代理事务所(普通合伙)11017 | 代理人: | 韩登营,张焕亮 |
地址: | 100086 北京市海淀区*** | 国省代码: | 北京;11 |
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摘要: | |||
搜索关键词: | 反应堆 控制棒 棒位格莱码 发生 装置 | ||
技术领域
本实用新型涉及核电控制技术领域,特别是涉及一种反应堆控制棒棒位格莱码发生装置。
背景技术
在核电站启堆、功率转换和停堆过程中,通过控制反应堆控制棒的提升、插入和保持运动,从而控制反应堆的反应性,保证反应堆始终工作在受控状态。
反应堆控制棒棒位测量柜(PME)获取棒位探测器信号,计算得到5位格莱码表示的棒位信息,送由处理柜(PPE)处理、监控该棒位信息,并将棒位信息发送至反应堆逻辑柜(CLE),逻辑柜生成相应的棒控命令并将棒控命令输送至反应堆电源柜(PWE),电源柜与控制棒驱动机构中的电磁线圈相连,依据相应的棒控命令生成对应的电磁线圈的驱动电流,从而驱动相应的电磁线圈动作,使得反应堆控制棒做出提升、插入和保持动作。
然而,在调试反应堆控制棒棒位测测量柜时,难以采用反应堆控制棒棒位测量柜(PME)获取实际的棒位探测器信号以计算出5位格莱码,由此导致调试过程受阻。
实用新型内容
本实用新型的主要目的在于提供一种反应堆控制棒棒位格莱码发生装置,包括格莱码发生模块;
所述格莱码发生模块包括依次连接的:
波形发生模块,用于依照预定波形和频率输出方波;
波形计数模块,用于将所述方波以二进制码值形式记录;
转码模块,用于将二进制码值转换为格莱码值,所述格莱码值与反应堆控制棒棒位相对应。
由上,反应堆控制棒棒位格莱码发生装置产生对应棒位的格莱码信号,由通信模块将格莱码信号输出给反应堆控制棒棒位测量柜,以实现对控制棒提升、插入过程中棒位信息的实时模拟,对测量柜进行完整的功能调试。
其中,所述波形发生模块包括依次连接的波形发生电路和脉冲延迟电路。
由上,波形发生电路输出测试方波,而脉冲延迟电路用于定时复位,保证波形正常输出。
其中,所述波形发生电路包括二进制串行分频器,与其连接的不同谐振频率的晶振以及至少一个十进制脉冲分配器。
由上,波形信号经二进制串行分频器进行若干次分频后,输出不同频率的方波信号,该不同频率方波信号再经过十进制脉冲分配器进行分频后得到最终的方波信号。例如连接谐振频率为30.72KHz的晶振,波形信号经二进制串行分频器进行九次分频后,输出60Hz频率信号。再经过串联连接的两十进制脉冲分配器进行一次十分频和一次五分频,得到1.2Hz方波信号,以用于后续的格莱码转码。
其中,所述波形计数模块包括:
二进制加减计数器;
非与门电路,与所述二进制加减计数器连接;
脉冲延迟电路,与所述非与门电路连接;
触发器,其信号输入端连接于所述脉冲延迟电路的输出端,其信号输出端连接至所述二进制加减计数器的加减控制端口。
由上,二进制加减计数器起始为加计数,当二进制计数达到预设的最后一位时,将加计数转换为减计数,通过非与门电路实现逻辑电平的触发。该触发信号经过脉冲延迟电路以及触发器后,传输给二进制加减计数器的加减设置端口,如此实现循环计数。
其中,所述转码模块包括:
异或门电路,用于对所述二进制码值从最右一位起,依次与其左边一位进行异或逻辑运算;
反相缓冲器,与所述异或门电路连接,用于将异或逻辑运算后的码值进行反相;
与非门电路,与所述反相缓冲器连接,用于将反相后的码值进行与非逻辑运算,以转码为格莱码。
其中,还包括格莱码手动控制开关。
由上,通过手动选择,可以仅对于某一棒位进行测试,从而不必如自动测试时需要对所有情况进行测试,由此可以节约测试时间。
其中,还包括与所述格莱码手动控制开关一一对应的指示灯。
其中,还包括与所述格莱码发生模块连接的显示模块,所述显示模块包括依次连接的:主控芯片、晶体管和LED组成的数字灯条;
所述主控芯片用于接收来自所述转码模块输出的格莱码值,并依据该值输出控制电压至晶体管,由晶体管驱动数字灯条显示。
其中,还包括与所述格莱码发生模块连接的串口通信模块。
其中,所述装置包括壳体以及在壳体顶部的提手,所述壳体和提手设置有核电级别保护涂层。
附图说明
图1为反应堆控制棒棒位格莱码发生装置的原理示意图;
图2为格莱码发生模块的原理示意图;
图3为波形发生模块的电路原理图;
图4中(A)为波形计数模块的电路原理图;
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