[实用新型]一种高速型信号处理板卡有效

专利信息
申请号: 201720419929.7 申请日: 2017-04-20
公开(公告)号: CN206920978U 公开(公告)日: 2018-01-23
发明(设计)人: 李国彬;符华阳 申请(专利权)人: 成都博宇利华科技有限公司
主分类号: G06F1/16 分类号: G06F1/16
代理公司: 成都顶峰专利事务所(普通合伙)51224 代理人: 赵正寅
地址: 610000 四川省成都市高新区*** 国省代码: 四川;51
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摘要:
搜索关键词: 一种 高速 信号 处理 板卡
【说明书】:

技术领域

实用新型涉及信号处理技术领域,具体地,涉及一种高速型信号处理板卡。

背景技术

信号处理板卡是一种广泛应用在医疗、军事和电气工程等领域的电路板,主要用于对低频信号进行采集和处理。随着待处理信号的类型越来越多,对信号处理板卡自身的要求也就越来越高,例如在存储、处理速度、传输速度、掉电处理等方面的要求越来越高。

在实际应用中,现有的信号处理板卡一般设计为ARM+FPGA模式或者单片机模式,但是前者存在不能满足高速处理需求的问题,即容易导致因处理速度慢而造成数据丢失等问题,影响信号处理的准确性;而后者则存在缓存不足、存储速度太慢、无法在线调试和程序固化无法灵活处理等问题,使得板卡往往不能获得最佳工作状态。因此有必要设计一款高速型的新型信号处理板卡。

实用新型内容

针对现有ARM+FPGA模式的信号处理板卡存在不能满足高速处理需求的问题,和现有单片机模式的信号处理板卡存在缓存不足、存储速度太慢、无法在线调试和程序固化无法灵活处理等问题,本实用新型提供了一种高速型信号处理板卡。

本实用新型采用的技术方案,提供了一种高速型信号处理板卡,包括电路板,在所述电路板上布置有FPGA芯片、FPGA时钟电路、FPGA配置芯片、FPGA缓存器、DSP芯片、DSP时钟电路、DSP配置芯片、DSP缓存器、存储器、以太网接口、PCIE接口、第一JTAG接口、第二JTAG接口、整板状态控制模块和复位按键;所述FPGA芯片分别通信连接所述FPGA时钟电路、所述FPGA配置芯片、所述FPGA缓存器和所述第一JTAG接口,所述DSP芯片分别通信连接所述DSP时钟电路、所述DSP配置芯片、所述DSP缓存器、所述存储器和所述第二JTAG接口;所述FPGA芯片通过内置的高速串行收发器分别通信连接所述以太网接口和所述PCIE接口,所述FPGA芯片通过EMIF总线分别通信连接所述DSP芯片和所述整板状态控制模块,所述FPGA芯片还通过SRIO总线通信连接所述DSP芯片,所述整板状态控制模块还通信连接所述复位按键。

优化的,在所述电路板上还布置有RS232接口和RS232电平与TTL电平转换电路;所述DSP芯片的UART接口引脚通过所述RS232电平与TTL电平转换电路通信连接所述RS232接口。具体的,所述RS232电平与TTL电平转换电路为采用MAX232芯片的转换电路。

优化的,在所述电路板上还布置有板卡总电源、FPGA电源电路和DSP电源电路;所述板卡总电源的电能输出端分别电连接所述FPGA电源电路和所述DSP电源电路的电能输入端,所述FPGA电源电路的电能输出端电连接所述FPGA芯片的电源端,所述DSP电源电路的电能输出端电连接所述DSP芯片的电源端;所述整板状态控制模块还分别通信连接所述FPGA电源电路和所述DSP电源电路的受控端。

具体的,所述FGPA芯片采用型号为XC7K410T-2FFG900的FPGA芯片,所述DSP芯片采用型号为TMS320C6678的DSP芯片。

具体的,所述整板状态控制模块采用CPLD器件。

具体的,所述FPGA缓存器采用容量为4GB的DDR3内存条,所述DSP缓存器采用容量为2GB的DDR3内存条。

具体的,所述FPGA配置芯片采用FLASH闪存卡,所述DSP配置芯片采用异步NOR-FLASH非易失性闪存卡。

具体的,所述以太网接口采用RJ45接口。

具体的,所述存储器采用E2PROM存储芯片。

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