[实用新型]一种数字量输入合并单元测试系统有效

专利信息
申请号: 201720389959.8 申请日: 2017-04-14
公开(公告)号: CN206945946U 公开(公告)日: 2018-01-30
发明(设计)人: 朱全聪;翟少磊;朱梦梦;林聪 申请(专利权)人: 云南电网有限责任公司电力科学研究院
主分类号: G01R35/04 分类号: G01R35/04;G01R31/00
代理公司: 北京弘权知识产权代理事务所(普通合伙)11363 代理人: 逯长明,许伟群
地址: 650217 云南省昆*** 国省代码: 云南;53
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摘要:
搜索关键词: 一种 数字 输入 合并 单元测试 系统
【说明书】:

技术领域

本申请涉及智能电网的测试技术领域,特别涉及一种数字量输入合并单元测试系统。

背景技术

合并单元作为一个独立运行的自动化装置出现,负责完成一个时间间隔内多支互感器输出的模拟量实时数据采集,数据同步,数据的处理和发送,以及其他必要的开关量采集和自检等功能。合并单元担负着电能计量与信息数字化传输的重任,合并单元的现场测试在保证智能变电站计量系统的电能计量准确性和网络化信息传输的可靠、准确和安全等方面,显得尤为重要。

合并单元测试系统是对合并单元这一运行设备进行功能和性能检测的系统,是对应用合并单元数据的间隔层保护、计量、监控和故障录波等装置把关的检测系统,其主要功能包括检测合并单元的所有数据通道的比差、角差、复合误差、绝对延时时间、信噪比、暂态最大峰值误差和衰减时间常数等指标,以及合并单元报文抖动时间、同步守时精度等功能。

现有的测试系统在现场实际运行时,只能对数字量输入合并单元进行单一信号的测试,耗时长,最终导致测试效率低。

实用新型内容

本申请的目的在于提供一种数字量输入合并单元测试系统,以解决现有技术中合并单元测试效率低的问题。

根据本申请的实施例,提供一种数字量输入合并单元测试系统,包括:上位机、通信器、中央处理器、多路采集器、光接收器、同步信号器及数字信号源;

所述多路采集器、所述光接收器、所述同步信号器和所述数字信号源分别与所述中央处理器连接;

所述上位机通过所述通信器与所述中央处理器连接;

所述光接收器和所述数字信号源连接;

所述中央处理器包括驱动单元、接收单元和计算单元;

所述驱动单元的一端与所述通信器连接,所述驱动单元的另一端与所述数字信号源连接;所述多路采集器、所述光接收器及所述数字信号源分别与所述接收单元连接;所述计算单元的一端与所述通信器连接,所述计算单元的另一端与所述接收单元连接。

可选的,所述数字量输入合并单元测试系统中,所述通信器包括光纤通信器、串行通信器及以太网通信器中的任意两种。

可选的,所述数字量输入合并单元测试系统中,所述通信器包括光纤通信器、串行通信器及以太网通信器。

可选的,所述数字量输入合并单元测试系统中,所述系统还包括数模转换器,所述数模转换器与所述中央处理器连接。

可选的,所述数字量输入合并单元测试系统中,所述系统还包括脉冲收发器,所述脉冲收发器与所述中央处理器连接。

由以上技术方案可知,本申请实施例提供一种数字量输入合并单元测试系统,包括:上位机、通信器、中央处理器、多路采集器、光接收器、同步信号器及数字信号源;所述多路采集器、所述光接收器、所述同步信号器和所述数字信号源分别与所述中央处理器连接;所述上位机通过所述通信器与所述中央处理器连接;所述光接收器和所述数字信号源连接;所述中央处理器包括驱动单元、接收单元和计算单元;所述驱动单元的一端与所述通信器连接,所述驱动单元的另一端与所述数字信号源连接;所述多路采集器、所述光接收器及所述数字信号源分别与所述接收单元连接;所述计算单元的一端与所述通信器连接,所述计算单元的另一端与所述接收单元连接;本申请实施例基于随机函数生成的随机序列算法,实现对多路采集器输出的数字量信号的离散异步发送,实现对数字量输入合并单元进行多个信号的测试,解决目前在测试数字量输入合并单元的信号稳定性与可靠性低的问题,提高测试效率。另外,光接收器接收到数字信号源的信号后完成数据帧接收和时标标定,再将数据帧发送给中央处理器,由中央处理器完成数据帧解析和处理,实现对被测数字量输入合并单元的闭环测试及测试系统发送数据的高精度回采。

附图说明

为了更清楚地说明本申请实施例或现有技术中的技术方案,下面将对实施例中所需要使用的附图作简单地介绍,显而易见地,下面描述中的附图仅仅是本申请的一些实施例,对于本领域普通技术人员来讲,在不付出创造性劳动的前提下,还可以根据这些附图获得其他的附图。

图1为根据实施例示出的一种数字量输入合并单元测试系统的结构示意图;

图2为根据实施例示出的另一种数字量输入合并单元测试系统的结构示意图;

图3为根据实施例示出的中央处理器结构示意图;

图4为根据实施例示出串行通信器的电路图;

图5为根据实施例示出的又一种数字量输入合并单元测试系统的结构示意图;

图6为根据实施例示出的脉冲收发器的电路图;

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