[实用新型]收发器系统有效
申请号: | 201720206969.3 | 申请日: | 2017-03-03 |
公开(公告)号: | CN206472133U | 公开(公告)日: | 2017-09-05 |
发明(设计)人: | 卡西克·戈帕拉克里希南;贾迈勒·里亚尼;阿伦·蒂鲁维尔 | 申请(专利权)人: | 颖飞公司 |
主分类号: | H04B10/40 | 分类号: | H04B10/40;H04B10/524;H04L7/033 |
代理公司: | 北京康信知识产权代理有限责任公司11240 | 代理人: | 梁丽超,陈鹏 |
地址: | 美国加利*** | 国省代码: | 暂无信息 |
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摘要: | |||
搜索关键词: | 收发 系统 | ||
技术领域
本实用新型涉及通信系统,更具体地,涉及一种收发器系统。
背景技术
在过去几十年,爆炸性使用通信网络。在互联网初期,流行的应用限于电子邮件、公告栏以及主要是基于信息和文本的网页浏览,并且传输的数量通常较小。如今,互联网和移动应用需要大量带宽来传输照片、视频、音乐以及其他多媒体文件。例如,诸如脸书(Facebook)等社交网每天处理500TB以上的数据。由于对数据和数据传输的这种高度需求,所以需要提高现有数据通信系统以解决这些需求。对于高速数据通信应用,经常使用脉冲幅度调制(PAM)技术。除此之外,PAM(2n,n>1)提供改善的频谱效率,这允许在通信介质上具有更高的数据吞吐量。
在过去,具有多种类型的通信系统和方法。遗憾的是,这些通信系统和方法对于各种应用来说是不充分的。因此,需要改进的系统和方法。
实用新型内容
根据一实施例,本实用新型提供了一种收发器系统,其特征在于,包括:输入端,用于接收输入数据流,通过第一频率表征所述输入数据流;时钟生成模块,被配置为基于至少一个所述输入数据流生成时钟信号;调节器,耦合到电源,所述调节器被配置为衰减与所述电源相关联的噪声;第一电压增益放大器,被配置为生成第一驱动信号;跟踪和保持模块,包括第一多个跟踪和保持电路,所述第一多个跟踪和保持电路由所述第一驱动信号控制,用于以第二频率保持所述输入数据流;移位和保持缓冲器,包括与所述第一多个跟踪和保持电路相对应的第一多个缓冲单元,所述第一多个缓冲单元被配置为基于所述输入数据流存储第一多个样本;ADC模块,包括被配置为转换所述第一多个样本的第一多个ADC电路;数字信号处理器,被配置为基于至少一个所述第一多个样本生成输出数据流;以及输出端,用于发送所述输出数据流。
根据实施例的收发器系统,其特征在于,还包括用于生成定时相位的分数延迟锁定环。
根据实施例的收发器系统,其特征在于,所述第二频率为所述第一频率的约一半。
根据实施例的收发器系统,其特征在于,还包括被配置为生成第二驱动信号的第二电压增益放大器。
根据实施例的收发器系统,其特征在于,所述数字信号处理器包括用于校准所述第一多个样本的偏斜控制模块。
根据实施例的收发器系统,其特征在于,多个ADC电路对应于单个移位和保持缓冲单元。
根据实施例的收发器系统,其特征在于,所述数字信号处理器包括用于执行信道均衡的一组并行前馈均衡器。
根据实施例的收发器系统,其特征在于,还包括调制器,所述调制器用于对所述输出数据流进行调制以通过光通信链路传输。
根据实施例的收发器系统,其特征在于,所述输出数据流以PAM4格式被调制。
根据实施例的收发器系统,其特征在于,所述调节器执行用于衰减所述噪声的前馈注入。
根据实施例的收发器系统,其特征在于,由至少12dB的增益范围表征所述第一电压增益放大器。
根据实施例的收发器系统,所述时钟生成模块包括使用所述输入数据流用于执行时钟恢复的锁相环电路。
根据实施例的收发器系统,其特征在于,所述第一电压增益放大器包括第一均衡器电路。
根据实施例的收发器系统,其特征在于,所述ADC电路中的每一个包括逐次逼近寄存器。
根据另一实施例,本实用新型提供了一种收发器系统,其特征在于,包括:输入端,用于接收输入数据流,通过第一频率表征所述输入数据流;时钟生成模块,被配置为基于至少一个所述输入数据流生成时钟信号;第一电压增益放大器,被配置为生成第一驱动信号;跟踪和保持模块,包括第一多个跟踪和保持电路,所述第一多个跟踪和保持电路由所述第一驱动信号控制,用于以第二频率保持所述输入数据流;移位和保持缓冲器,包括与所述第一多个跟踪和保持电路相对应的第一多个缓冲单元,所述第一多个缓冲单元被配置为基于所述输入数据流存储第一多个样本;ADC模块,包括被配置为转换所述第一多个样本的第一多个ADC电路;数字信号处理器,被配置为基于至少一个所述第一多个样本生成输出数据流,所述数字信号处理器包括用于减少误差的判定反馈均衡器;以及输出端,用于发送所述输出数据流。
附图说明
图1是示出根据本实用新型的实施例的收发器系统的简化图。
图2A是示出具有多个数据通道的收发器系统的简化图。
图2B是示出根据本实用新型的实施例的集成EQ-VGA模块的简化图。
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