[实用新型]交换机芯片的可缩放低延迟网状互连有效

专利信息
申请号: 201720121428.0 申请日: 2017-02-09
公开(公告)号: CN206602540U 公开(公告)日: 2017-10-31
发明(设计)人: S·阿努博吕;M·卡尔昆特 申请(专利权)人: 安华高科技通用IP(新加坡)公司
主分类号: H04L12/933 分类号: H04L12/933
代理公司: 北京律盟知识产权代理有限责任公司11287 代理人: 林斯凯
地址: 新加坡*** 国省代码: 暂无信息
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摘要:
搜索关键词: 交换机 芯片 缩放 延迟 网状 互连
【说明书】:

相关申请案的交叉参考

本申请案主张2016年2月9日申请的题为“交换机芯片的可缩放低延迟网状互连”的第62/293,287号美国临时专利申请案的优先权,将其完整结合在此作为参考用于所有目的。

技术领域

本实用新型描述大体上涉及一种可缩放低延迟网,其包含用于交换机装置的交换机芯片的可缩放低延迟网状互连。

背景技术

在企业交换机市场中,每个交换机芯片的带宽每十八个月翻倍。由于带宽的增加,功率密度也在增加,同时成本在减小。为了支持企业交换机市场,需要有效的冷却技术来支持芯片上单系统(SoC)实施方案的持续发展。但是,使用多个交换机芯片来缩放系统的有效方式可容许减少冷却和/或功率需求。

实用新型内容

在一实施例中,本申请案涉及一种装置,其包括:存储器管理单元,其经配置以缓冲第一单元以用于传输;出口单元电路,其包括至少第一队列和第二队列,所述出口单元电路经配置以:使来自所述存储器管理单元的所述第一单元在所述第一队列中排队;使来自另一装置的另一存储器管理单元的第二单元在所述第二队列中排队;及调度来自所述第一队列的所述第一单元和来自所述第二队列的第二单元以用于经由出口处理器传输;及所述出口处理器,其经配置以在至少一个第一端口上传输所述第一和第二单元。

在另一实施例中,本申请案涉及一种装置,其包括:入口处理器,其经配置以接收第一单元且提供所述第一单元到存储器管理单元;所述存储器管理单元,其经配置以缓冲所述第一单元以用于传输;出口处理器,其经配置以在至少一个第一端口上传输所述第一单元的至少一部分;传输电路,其以通信的方式耦合到另一装置的另一传输电路,所述传输电路经配置以:从所述另一装置的所述另一传输电路接收对所述第一单元中的至少一些第一单元的请求;经由所述存储器管理单元的读取端口检索来自所述存储器管理单元的所述第一单元中的所述至少一些第一单元;及将所述第一单元中的所述至少一些第一单元传输到所述另一装置的所述另一传输电路以用于经由所述另一装置的至少一个第二端口上的另一出口处理器传输,所述第一单元中的所述至少一些第一单元绕开所述装置的所述出口处理器。

附图说明

本技术的某些特征在所附的权利要求书中阐述。但是,出于解释的目的,本技术的若干实施例在下列图中阐述。

图1图示说明实例网络环境,其中实施交换机芯片的可缩放低延迟网状互连的交换机装置可根据一或多个实施方案实施。

图2图示说明根据一或多个实施方案的实施两个交换机芯片的可缩放低延迟网状互连的实例交换机装置。

图3图示说明根据一或多个实施方案的实施三个交换机芯片的可缩放低延迟网状互连的实例交换机装置。

图4图示说明根据一或多个实施方案的实施交换机芯片的可缩放低延迟网状互连的交换机装置的实例交换机芯片的实例传输先进先出(fifo)。

图5图示说明根据一或多个实施方案的实施交换机芯片的可缩放低延迟网状互连的交换机装置的实例交换机芯片的实例出口单元fifo。

图6图示说明根据一或多个实施方案的实施交换机芯片的可缩放低延迟网状互连的交换机装置的实例交换机芯片的传输fifo的实例过程的流程图。

图7图示说明根据一或多个实施方案的实施交换机芯片的可缩放低延迟网状互连的交换机装置的实例交换机芯片的出口单元fifo的实例过程的流程图。

图8在概念上图示说明实例电子系统,可使用所述电子系统实施本技术的一或多个实施方案。

具体实施方式

下文阐述的具体实施方式意欲作为本技术的各种配置的描述且并不意欲表示其中可实践本技术的唯一配置。所附图式被并入本文中并构成具体实施方式的部分。具体实施方式包含用于提供对本技术的通透理解的特定细节。但是,本技术不限于本文阐述的特定细节且可使用一或多个实施方案来实践。在一或多个实例中,以框图的形式展示结构和组件以避免掩盖本技术的概念。

图1图示说明实例网络环境100,其中实施交换机芯片的可缩放低延迟网状互连的交换机装置110可根据一或多个实施方案实施。但是,并不使用所有描绘的组件,且一或多个实施方案可包含图中没有展示的额外组件。在不脱离本文阐述的权利要求书的精神或范围的情况下可进行组件的布置和类型的变化。可提供额外组件、不同组件或更少的组件。

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