[实用新型]自适应高速图像压缩系统有效
申请号: | 201720023646.0 | 申请日: | 2017-01-10 |
公开(公告)号: | CN206341334U | 公开(公告)日: | 2017-07-18 |
发明(设计)人: | 黄海;谢光辉;高俊锋;杨光;刘志伟 | 申请(专利权)人: | 哈尔滨理工大学 |
主分类号: | H04N19/423 | 分类号: | H04N19/423 |
代理公司: | 哈尔滨东方专利事务所23118 | 代理人: | 陈晓光 |
地址: | 150080 黑龙江省哈*** | 国省代码: | 黑龙江;23 |
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摘要: | |||
搜索关键词: | 自适应 高速 图像 压缩 系统 | ||
技术领域:
本实用新型涉及一种自适应高速图像压缩系统。
背景技术:
图像是对客观事物的一种相似性的,生动的描述,它包含了被描述对象的有关信息,是人们主要的信息源。但是,图像数字化后的数据量是很大,大数据量的图像信息会给存储器的存储容量、通信干线信道的带宽以及计算机的处理速度增加极大的压力单纯靠增加存储器容量,提高信道带宽以及计算机的处理速度等方法这个问题是不现实的,这时就需要压缩。在需要实时处理图像数据的系统中,图像的高速压缩越来越来收到人们的关注。随着光学传感器技术、电子与通信技术以及空间技术的日益发展,一个图像处理系统获得的图像的分辨率以及获得的帧数不断增加,这个不仅给存储带来了极大的负担,还给数据的实时处理带来了巨大挑战,高速的压缩系统不仅可以缓解存储压力,还可以给实时处理节省时间,使实时处理系统能在最短的时间内响应。
发明内容:
本实用新型的目的是提供一种自适应高速图像压缩系统。
上述的目的通过以下的技术方案实现:
一种自适应高速图像压缩系统,其组成包括:数据输入部分、图像压缩部分和数据输出部分,所述的数据输入部分具有双端口的RAM存储器、RAM控制器、USB OTG 控制器和USB 控制器,所述的图像压缩部分具有压缩电路,所述的数据输出部分具有FIFO存储器、FIFO控制器、所述的USB OTG控制器和所述的USB控制器。
所述的自适应高速图像压缩系统,所述的RAM控制器通过地址线和控制线与所述的双端口的RAM存储器连接,所述的双端口的RAM存储器与所述的USB OTG 控制器连接,所述的USB OTG 控制器通过OTG控制总线和OTG终端产生总线与所述的USB控制器连接,所述的USB OTG控制器可以作为主机和外围USB设备的控制器。
所述的自适应高速图像压缩系统,所述的压缩电路具有蝶形运算装置,所述的蝶形运算装置与CORDIC运算装置连接,所述的CORDIC运算装置与控制装置连接,所述的控制装置与JND运算装置连接,所述的JND运算装置与所述的蝶形运算装置连接。
所述的自适应高速图像压缩系统,所述的FIFO控制器通过地址线和控制线与所述的FIFO存储器连接,所述的FIFO存储器与所述的USB OTG控制器连接,所述的USB OTG控制器通过OTG控制总线和OTG中断产生总线与所述的USB控制器连接。
所述的自适应高速图像压缩系统,所述的CORDIC运算装置为坐标旋转数字计算机运算装置,所述的JND运算装置为恰可觉察失真运算装置。
本实用新型的有益效果:
1.本实用新型的数据输入部分利用高读写速率的双端口RAM,有效提高硬件压缩的速度,RAM中的图像数据可以从不同类型的上位机获得,然后通过RAM 控制器将所得数据载入到图像压缩部分。图像压缩部分算法是以JND为判断依据对不同图像内容选择不同压缩标准的选择性压缩图像的算法,可以实现图像压缩比和图像质量的最优化。数据输出部分是将压缩后的数据再重新装入RAM后,通过USB传回上位机。本专利使用的USB OTG 控制器符合USB 2.0规范。USB host 和 USB device 的控制器符合通用串行总线规范2.0,支持数据传输在全速12Mbit/s。
本实用新型根据图像不同部分频率的差异,选择不同精度离散余弦变换(DCT)进行处理,采用典型测试图片“Camera man”、“Lena”、“Peppers”、“Board”,大小为256×256,进行测试。这四幅图片具有的低频部分依次下降,当JND阈值取“4”时,这四幅图片所得的简化比分别为40%、36%、23%、1%,可以看出,按照该算法进行数据压缩,含低频成分越多的图片可以近似压缩的比例越大,符合实际图像的频率特性。
本实用新型具有较高的运行速度,为了实现高速压缩,所有存储模块使用双端口的RAM,数据的下载与上传的过程,不影响压缩电路部分数据的读取和存储,可以充分利用流水线式压缩电路的高吞吐率,达到高速处理。
附图说明:
附图1是本实用新型的系统结构示意图。
附图2是数据输入部分电路连接示意图。
附图3是压缩电路功能框图。
附图4是压缩电路部分的电路连接示意图。
附图5是数据输出部分电路连接示意图。
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