[发明专利]一种Nand flash元件及其通信控制方法和装置在审
申请号: | 201711449651.9 | 申请日: | 2017-12-27 |
公开(公告)号: | CN108363549A | 公开(公告)日: | 2018-08-03 |
发明(设计)人: | 庄开锋 | 申请(专利权)人: | 北京兆易创新科技股份有限公司 |
主分类号: | G06F3/06 | 分类号: | G06F3/06;G06F11/10 |
代理公司: | 北京润泽恒知识产权代理有限公司 11319 | 代理人: | 莎日娜 |
地址: | 100083 北京市海淀*** | 国省代码: | 北京;11 |
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摘要: | |||
搜索关键词: | 方法和装置 通信控制 主控制器 内核 封装 内部控制器 管理 地址映射 固件模块 坏块管理 损耗均衡 有效解决 封装体 体内 | ||
本发明实施例提供了一种Nand flash元件及其通信控制方法和装置,该Nand flash元件具体包括一个封装体,封装体内封装有Nand flash内核和内部控制器。并具体通过产品固件模块实现对Nand flash内核进行ECC校验管理、坏块管理、地址映射管理或损耗均衡管理,这样一来也就无需通过片外的主控制器实现上述管理,从而有效解决了主控制器负担较重的问题。
技术领域
本发明涉及内存技术领域,特别是涉及一种Nand flash元件及其通信控制方法和装置。
背景技术
Nand flash是flash存储器的一种,其内部采用非线性宏单元模式,为固态大容量内存的实现提供了廉价有效的解决方案。Nand flash有容量较大,改写速度快等优点,适用于大量数据的存储,因而在业界得到了越来越广泛的应用,如嵌入式产品中包括数码相机、MP3随身听记忆卡、体积小巧的U盘等。
Nand flash的数据是以bit的方式保存在memory cell中,一般来说,每个cell中只能存储一个bit;这些cell以8个或者16个为单位,连成bit line,形成所谓的byte(x8)/word(x16),这就是NAND Device的位宽。这些bit line再组成Page,根据厂商或型号的不同,每页的bit line数也不同;多个page形成一个Block,例如32个page。具体一片Nandflash上有多少个Block视需要所定。
Nand flash需要控制器管理其功能,例如ECC校验、坏块管理、地址映射、损耗均衡等,然而一般的Nand flash在其封装体内均没有设置相应的内部控制器,因此,上述对其功能的管理均依赖相应的主控制器去实现,从而增加了相应主控制器的负担。
发明内容
有鉴于此,本发明提供了一种Nand flash元件及其通信控制方法和装置,以解决Nand flash元件因需要依赖主控制器对其进行管理而导致主控制器负担较重的问题。
为了解决上述问题,本发明公开了一种Nand flash元件,包括一个封装体,所述封装体内封装有Nand flash内核和内部控制器,其中:
所述内部控制器用于对所述Nand flash内核进行ECC校验管理、坏块管理、地址映射管理或损耗均衡管理。
另外,还提供了一种通信控制方法,应用于如上所述的Nand flash元件的内部控制器,其特征在于,所述通信控制方法包括步骤:
当所述内部控制器的基础加载模块处于Debug模式时,接收上位机发送的数据和命令;
根据所述数据和命令对所述Nand flash元件的Nand flash内核进行读写擦操作。
可选的,所述接收上位机发送的数据和命令,包括:
通过所述Nand flash元件的串行接口接收所述上位机发送的数据和命令;
或者,通过所述Nand flash元件的SPI接口接收所述上位机发送的数据和命令。
可选的,所述通过所述Nand flash元件的串行接口接收所述上位机发送的数据和命令,包括:
与所述上位机建立连接;
依次接收所述上位机发送的多个所述数据和命令,所述数据和命令包括包头和数据部分,所述包头包括命令类型、命令号和传输参数等;
依次存储所接收的所述数据和命令;
当所述上位机发送完毕后,解除所述连接。
可选的,所述通过所述Nand flash元件的SPI接口接收所述上位机发送的数据和命令,包括:
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