[发明专利]指令处理方法及使用所述方法的储存控制器有效
申请号: | 201711237957.8 | 申请日: | 2017-11-30 |
公开(公告)号: | CN109857331B | 公开(公告)日: | 2022-03-25 |
发明(设计)人: | 詹克伟;吴迪贤;谢宏志 | 申请(专利权)人: | 深圳大心电子科技有限公司 |
主分类号: | G06F3/06 | 分类号: | G06F3/06 |
代理公司: | 深圳壹舟知识产权代理事务所(普通合伙) 44331 | 代理人: | 寇闯 |
地址: | 518057 广东省深圳市南山*** | 国省代码: | 广东;44 |
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摘要: | |||
搜索关键词: | 指令 处理 方法 使用 储存 控制器 | ||
1.一种指令处理方法,适用于储存控制器,所述储存控制器用于存取储存媒体并耦接至主机系统,其特征在于,所述指令处理方法包括:
接收多个输入输出指令;
根据所述多个输入输出指令的处理器使用指数,将所述多个输入输出指令分类成多个群组;
从所述多个群组中选择第一群组,重置计时器并根据所述第一群组的所述多个输入输出指令来获得对应所述第一群组的到期时间,并执行所述第一群组的所述多个输入输出指令;以及
当所述第一群组的所述到期时间到期时,从所述多个群组中选择第二群组并重置所述计时器,
其中当所述第一群组的所述处理器使用指数小于门槛值时,在所述到期时间到期之前降低所述处理器的时脉。
2.根据权利要求1所述的指令处理方法,其特征在于,其中所述多个群组包括第三群组,当所述第三群组的所述多个输入输出指令的所述处理器使用指数都小于第一值且所述第一值小于所述门槛值时,所述处理器在所述第三群组的所述到期时间到期之前将所述处理器的原始时脉降低为所述原始时脉乘以所述第一值。
3.根据权利要求1所述的指令处理方法,其特征在于,其中所述储存控制器通过主机接口与所述主机系统沟通,且所述主机接口支持乱序执行功能。
4.根据权利要求1所述的指令处理方法,其特征在于,其中所述处理器使用指数为处理器输入输出指令执行时间除以对应的数据传输时间。
5.根据权利要求4所述的指令处理方法,其特征在于,其中所述门槛值为1。
6.根据权利要求4所述的指令处理方法,其特征在于,其中所述处理器输入输出指令执行时间为所述多个输入输出指令的其中之一所对应的多个函式的所述处理器的执行时间,所述多个函式直接相关于所述多个输入输出指令的所述其中之一的数据传输。
7.根据权利要求4所述的指令处理方法,其特征在于,其中所述数据传输时间为所述多个输入输出指令的其中之一的估计数据传输时间。
8.根据权利要求1所述的指令处理方法,其特征在于,其中所述储存控制器通过查找表将所述多个输入输出指令的传输方向及大小映射到所述多个群组的群组索引上,并通过指令排序器来查找所述查找表,其中所述指令排序器将所述多个输入输出指令分类成所述多个群组。
9.根据权利要求4所述的指令处理方法,其特征在于,其中所述储存控制器通过查找表将所述多个输入输出指令的传输方向及大小映射到所述数据传输时间上,并通过每个所述群组所对应的指令队列管理器来查找所述查找表。
10.根据权利要求9所述的指令处理方法,其特征在于,其中所述到期时间为所述第一群组的所述多个输入输出指令的所述数据传输时间的总合,其中所述数据传输时间从所述查找表来获得。
11.一种储存控制器,用于存取储存媒体并耦接至主机系统,其特征在于,所述储存控制器包括:
指令排序器;
多个指令队列管理器,耦接到所述指令排序器;
仲裁器,耦接到所述多个指令队列管理器;
计时器,耦接到所述仲裁器;以及
处理器,耦接到所述指令排序器、所述多个指令队列管理器及所述仲裁器的至少其中之一,其中
所述指令排序器从所述主机系统接收多个输入输出指令,
所述指令排序器根据所述多个输入输出指令的处理器使用指数,将所述多个输入输出指令分类成多个群组,
所述仲裁器从所述多个群组中选择第一群组,重置所述计时器并根据所述第一群组的所述多个输入输出指令来获得对应所述第一群组的到期时间,并由所述处理器执行所述第一群组的所述多个输入输出指令,
当所述第一群组的所述到期时间到期时,所述仲裁器从所述多个群组中选择第二群组并重置所述计时器,
其中当所述第一群组的所述处理器使用指数小于门槛值时,在所述到期时间到期之前降低所述处理器的时脉。
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