[发明专利]共模电感器、磁芯配方及共模电感器的制作工艺在审
申请号: | 201711181072.0 | 申请日: | 2017-11-23 |
公开(公告)号: | CN107863233A | 公开(公告)日: | 2018-03-30 |
发明(设计)人: | 王胜勇;王海;朱建华;黄寒寒;钟景高;王上衡;罗光猛 | 申请(专利权)人: | 深圳振华富电子有限公司;中国振华(集团)科技股份有限公司 |
主分类号: | H01F27/30 | 分类号: | H01F27/30;H01F27/28;H01F27/24;H01F1/11;H01F41/00;C04B35/26;C04B35/622 |
代理公司: | 深圳中一专利商标事务所44237 | 代理人: | 官建红 |
地址: | 518000 广东省深圳*** | 国省代码: | 广东;44 |
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摘要: | |||
搜索关键词: | 电感器 配方 制作 工艺 | ||
技术领域
本发明属于电感器技术领域,更具体地说,是涉及一种共模电感器、磁芯配方及共模电感器的制作工艺。
背景技术
电感器是能够把电能转化为磁能而存储起来的元件。其中,共模电感器,也叫共模扼流圈,常用于电脑的开关电源中过滤共模的电磁干扰信号。常规的共模电感器的制作方法为,在磁芯上直接绕制漆包线,绕制在磁芯上的线引出端直接焊接,电感器成插接式结构。但随着表贴技术的兴起,各种电子电气设备产品对表贴电子元器件的需求越来越大,常规的共模电感器已不能满足市场的要求。目前,常规的表贴共模电感器采用两个磁芯,分别在两磁芯上绕制漆包线,如此,导致整个共模电感器的体积偏大,不满足表贴技术的小型化、片式化的要求。
发明内容
本发明的目的在于提供一种共模电感器,以解决现有技术中存在的采用两个磁芯绕制漆包线导致共模电感器不满足表贴技术小型化、片式化要求的技术问题。
为实现上述目的,本发明采用的技术方案是:提供了一种共模电感器,包括:
磁芯;
第一绕线及第二绕线,所述第一绕线的线径与所述第二绕线的线径相同,且所述第一绕线及所述第二绕线双线并绕于所述磁芯上。
进一步地,所述磁芯包括用于供所述第一绕线及所述第二绕线缠绕的绕线部,以及分别设于所述绕线部相对两端并用于阻挡所述第一绕线及所述第二绕线超出所述绕线部的挡线部。
优选地,所述绕线部与所述挡线部一体成型。
进一步地,所述挡线部具有相对设置的第一侧及第二侧,所述第一侧及所述第二侧均突出于所述绕线部之外,所述第一侧设有焊盘,所述第一绕线及所述第二绕线均具有两引出端,所述引出端对应焊接于所述焊盘上。
进一步地,所述第二侧设有用于自动贴片的吸帽。
优选地,所述第一绕线及所述第二绕线均为扁平铜线。
优选地,所述第一绕线及所述第二绕线的引出端表面均设有镀锡铅层。
优选地,所述磁芯为镍锌铁氧体件。
本发明还提供了一种磁芯配方,包括下述原料:
Fe2O3:60~75%wt,ZnO:10~21%wt,CuO:5~10%wt,Ni2O3:5~10%wt,助烧剂:0.2~0.6%wt,矿化剂:0.2~0.5%wt;
其中,助烧剂为Bi2O3,矿化剂为Co2O3、SiO2、SnO2及LiOH,且Co2O3:0.1~0.16%wt、SiO2:0.1~0.15%wt、SnO2:0.05~0.1%wt、LiOH:0.02~0.1%wt。
本发明还提供了一种共模电感器的制作工艺,其包括以下步骤:
1)将Fe2O3:60~75%wt,ZnO:10~21%wt,CuO:5~10%wt,Ni2O3:5~10%wt,助烧剂(Bi2O3):0.2~0.6%wt,矿化剂(Co2O3、SiO2、SnO2、LiOH):0.2~0.5%wt等原料混合,采用二次还原烧结法或平衡气氛烧结法制备粉料;
2)将步骤1)中的所述粉料采用粉末冶金后冲压成型出所需的磁芯形状;
3)采用粉料假烧工艺,除去所述粉料中的杂质并形成初步的尖晶石结构;
4)在所述磁芯上对焊盘结构进行设计:通过对所述焊盘涂银、烘银、烧银工艺及电镀作业,形成成品磁芯,所述焊盘结构分为三层:内层材料为Ag、中间层材料为Ni、外层材料为Sn/Pb;
5)在所述磁芯结构上进行第一绕线及第二绕线的双线并绕,通过热压焊将绕线焊接在所述焊盘上;
6)将流延成型的外壳通过环氧树脂粘结在绕有绕线的所述磁芯上,通过烘烤固化成型。
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