[发明专利]显示装置和驱动方法有效

专利信息
申请号: 201711108610.3 申请日: 2017-11-10
公开(公告)号: CN107799052B 公开(公告)日: 2021-02-09
发明(设计)人: 艾迪尔·艾比里;李锡烈 申请(专利权)人: 友达光电股份有限公司
主分类号: G09G3/20 分类号: G09G3/20
代理公司: 北京市立康律师事务所 11805 代理人: 梁挥;孟超
地址: 中国台湾新竹科*** 国省代码: 台湾;71
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摘要:
搜索关键词: 显示装置 驱动 方法
【权利要求书】:

1.一种显示装置,其特征在于,包含:

多个像素,设置于一像素矩阵,且该像素矩阵包含多行和多列;

一上数据驱动电路和一下数据驱动电路,分别设置于该显示装置相对的两侧;以及

多对数据线,沿着一垂直方向延伸,且每对数据线包含一上数据线和一下数据线,其中该上数据线电性耦接于该上数据驱动电路,该下数据线电性耦接于该下数据驱动电路;

其中,该像素矩阵包含一上部区域、一中间区域和一下部区域,且每对数据线的该上数据线和该下数据线部分重叠于该中间区域;

其中,在该像素矩阵的每一行中,

位于该上部区域的每个像素皆电性耦接于该对相应的数据线中的该上数据线;

位于该下部区域的每个像素皆电性耦接于该对相应的数据线中的该下数据线;

位于该中间区域的每个像素皆包含一上子像素和一下子像素,该上子像素电性耦接于该对相应的数据线中的该上数据线并具有一第一权重因数,该下子像素电性耦接于该对相应的数据线中的该下数据线并具有一第二权重因数,其中该上子像素的该第一权重因数和该下子像素的该第二权重因数的一总和为百分之百;以及

从该中间区域的一顶部至一底部,该多个上子像素的该第一权重因数逐渐减少,该多个下子像素的该第二权重因数逐渐增加;

其中,于该中间区域的每个像素中,该上子像素接收到的一上数据电压的大小与该第一权重因数成正相关,且该下子像素接收到的一下数据电压的大小与该第二权重因数成正相关,从该中间区域的该顶部至该底部,该中间区域依序包含:

一第一列,该第一列中的每个像素皆包含一第一上子像素和一第一下子像素;

一第二列,该第二列中的每个像素皆包含一第二上子像素和一第二下子像素;

一第三列,该第三列中的每个像素皆包含一第三上子像素和一第三下子像素;以及

一第四列,该第四列中的每个像素皆包含一第四上子像素和一第四下子像素。

2.根据权利要求1所述的显示装置,其特征在于:

该第一列中的每个像素的第一上子像素的第一权重因数为80%,第一下子像素的第二权重因数为20%;

该第二列中的每个像素的第二上子像素的第一权重因数为60%,第二下子像素的第二权重因数为40%;

该第三列中的每个像素的第三上子像素的第一权重因数为40%,第三下子像素的第二权重因数为60%;以及

该第四列中的每个像素的第四上子像素的第一权重因数为20%,第四下子像素的第二权重因数为80%。

3.一种显示装置,其特征在于,包含:

多个像素,设置于一像素矩阵,且该像素矩阵包含多行和多列;

一上数据驱动电路和一下数据驱动电路,分别设置于该显示装置相对的两侧;以及

多对数据线,沿着一垂直方向延伸,且每对数据线包含一上数据线和一下数据线,其中该上数据线电性耦接于该上数据驱动电路,该下数据线电性耦接于该下数据驱动电路,且该像素矩阵的每一行中的像素电性耦接于一对相应的数据线;

其中,该像素矩阵包含一上部区域、一中间区域和一下部区域,且每对数据线中的该上数据线和该下数据线部分重叠于该中间区域;

其中,该中间区域包含由像素组成的许多列;以及

其中在该像素矩阵的每一行中,

位于该中间区域的每个像素皆包含一上子像素和一下子像素,该上子像素电性耦接于该对相应的数据线中的上数据线并具有一第一权重因数,该下子像素电性耦接于该对相应的数据线中的下数据线并具有一第二权重因数;以及

从该中间区域的一顶部至一底部,该多个上子像素的该第一权重因数呈现一逐渐减少的变化方式,该多个下子像素的该第二权重因数呈现一逐渐增加的变化方式;

其中,于该中间区域的每个像素中,该上子像素接收到的一上数据电压的大小与该第一权重因数成正相关,且该下子像素接收到的一下数据电压的大小与该第二权重因数成正相关。

4.根据权利要求3所述的显示装置,其特征在于,于该像素矩阵的每一行中,

位于该上部区域的每个像素皆电性耦接于该对相应的数据线中的该上数据线;

位于该下部区域的每个像素皆电性耦接于该对相应的数据线中的该下数据线。

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