[发明专利]存储设备及其写入和读取方法、以及存储系统有效

专利信息
申请号: 201710930601.6 申请日: 2017-10-09
公开(公告)号: CN108417233B 公开(公告)日: 2021-12-07
发明(设计)人: 权敬桓 申请(专利权)人: 爱思开海力士有限公司
主分类号: G11C7/10 分类号: G11C7/10
代理公司: 北京三友知识产权代理有限公司 11127 代理人: 李辉;刘久亮
地址: 韩国*** 国省代码: 暂无信息
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摘要:
搜索关键词: 存储 设备 及其 写入 读取 方法 以及 存储系统
【权利要求书】:

1.一种存储设备,该存储设备包括:

半导体存储器件;以及

存储控制器,所述存储控制器被配置为控制所述半导体存储器件,

其中,所述半导体存储器件包括:

存储单元,所述存储单元包括多个存储芯片;以及

接口芯片,所述接口芯片将从所述存储控制器接收的串行数据重新调整为并行数据,并将所述并行数据传送至所述多个存储芯片中的每一个,

其中,所述接口芯片包括:数据重新调整电路,所述数据重新调整电路将从所述存储控制器接收的写入数据传送至所述多个存储芯片当中的第一存储器和第二存储器,其中,在所述写入数据中依次重复偶数据和奇数据。

2.根据权利要求1所述的存储设备,其中,所述数据重新调整电路包括:

数据串行器和解串器,所述数据串行器和解串器响应于第一定时信号从所述存储控制器接收所述写入数据;以及

定时信号处理器,所述定时信号处理器生成第二定时信号,以将所述偶数据与所述奇数据分开。

3.根据权利要求2所述的存储设备,其中,所述数据串行器/解串器在从所述第一定时信号延迟了预定时间或周期的信号的下降沿将所述偶数据存储在第一锁存器中,并且在从所述第一定时信号延迟了预定时间或周期的信号的上升沿将所述奇数据存储在第二锁存器中。

4.根据权利要求3所述的存储设备,其中,所述第二定时信号的周期是所述第一定时信号的周期的一半,并且

所述数据重新调整电路基于芯片使能信号按照与所述第二定时信号同步的方式将存储在所述第一锁存器和所述第二锁存器中的所述偶数据和所述奇数据分别传送至所述第一存储器和所述第二存储器。

5.根据权利要求1所述的存储设备,其中,所述数据重新调整电路根据从所述多个存储芯片当中的所述第一存储器和所述第二存储器分别接收的所述偶数据和所述奇数据来生成读取数据,并将所述读取数据传送至所述存储控制器,其中,在所述读取数据中依次重复所述偶数据和所述奇数据。

6.根据权利要求5所述的存储设备,其中,所述数据重新调整电路包括:

数据串行器/解串器,所述数据串行器/解串器按照与第三定时信号同步的方式并且响应于读取使能信号而从所述第一存储器和所述第二存储器接收所述偶数据和所述奇数据;以及

定时信号处理器,所述定时信号处理器生成定时信号,以根据所述偶数据和所述奇数据来生成所述读取数据。

7.根据权利要求6所述的存储设备,其中,所述定时信号处理器将通过使从所述存储控制器接收的第四定时信号反相而获得的第五定时信号传送给所述数据串行器/解串器,并且

所述数据串行器/解串器在所述第五定时信号的上升沿将所述偶数据输入至寄存器,并在所述第五定时信号的下降沿将所述奇数据存储在所述寄存器中。

8.根据权利要求7所述的存储设备,其中,所述定时信号处理器生成第六定时信号,所述第六定时信号的频率是所述第三定时信号的频率的两倍。

9.根据权利要求8所述的存储设备,其中,所述数据重新调整电路根据所述第六定时信号将存储在所述寄存器中的数据传送至所述存储控制器。

10.根据权利要求1所述的存储设备,其中,所述存储单元包括第一存储芯片组和第二存储芯片组,

所述第一存储芯片组和所述第二存储芯片组中的每一个均包括相等数量的堆叠存储芯片,

所述第一存储器是包括在所述第一存储芯片组中的存储芯片,并且

所述第二存储器是包括在所述第二存储芯片组中的存储芯片。

11.根据权利要求1所述的存储设备,其中,所述第一存储器和所述第二存储器是从所述存储单元中所包括的所述多个存储芯片当中选择的单个存储芯片的不同平面中所包括的存储单元。

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