[发明专利]一种LTE-A Pro的OFDM调制装置及方法有效

专利信息
申请号: 201710810106.1 申请日: 2017-09-11
公开(公告)号: CN107612862B 公开(公告)日: 2020-06-09
发明(设计)人: 张黎明;凌云志 申请(专利权)人: 中国电子科技集团公司第四十一研究所
主分类号: H04L27/26 分类号: H04L27/26
代理公司: 青岛智地领创专利代理有限公司 37252 代理人: 种艳丽
地址: 233010 *** 国省代码: 安徽;34
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摘要:
搜索关键词: 一种 lte pro ofdm 调制 装置 方法
【权利要求书】:

1.一种LTE-A Pro的OFDM调制方法,其特征在于:采用一种LTE-A Pro的OFDM调制装置,该装置包括基于DSP处理的3GPP TS36.211/2协议设计模块、基于FPGA处理的3GPPTS36.211协议设计模块以及辅助触发同步信号的Rapid IO接口设计模块;

基于DSP处理的3GPP TS36.211/2协议设计模块、辅助触发同步信号的Rapid IO接口设计模块、基于FPGA处理的3GPP TS36.211协议设计模块通过线路依次连接;

辅助触发同步信号的Rapid IO接口设计模块,包括位于DSP平台上的LTE-AdvancedPro数据发送部分和位于FPGA平台上的LTE-Advanced Pro数据接收部分;该方法包括如下步骤:

步骤1:基于DSP处理的3GPP TS36.211/2协议设计;具体包括如下步骤:

步骤1.1:DSP中内核1的MAC传输块经过编码形成码字;

步骤1.2:码字经过扰码形成码片;

步骤1.3:码片经过调制映射形成符号;

步骤1.4:符号经过层映射形成层符号;

步骤1.5:层符号经过预编码形成端口符号;

步骤1.6:端口符号经过资源映射形成子载波符号;

步骤1.7:子载波符号暂存在DSP的外部存储器DDR中,并在DDR中开辟用于进行数据乒乓切换的缓冲区;

步骤1.8:DSP中的内核2根据外部触发同步信号搜寻到帧头位置;

步骤1.9:对DDR进行乒乓读数;

步骤1.10:交替进行取数据、发送给RapidIO函数接口并把内核1中的数据写入DDR中;

步骤2:基于FPGA处理的3GPP TS36.211协议设计;具体包括如下步骤:

步骤2.1:FPGA从内部RapidIO接口接收DSP发过来的频域LTE-Advanced Pro信号,并将此信号拆解分成多路LTE-Advanced Pro频域单载波信号;

步骤2.2:通过IFFT信号链路控制逻辑电路对每一路LTE-Advanced Pro频域单载波信号均进行IFFT处理,得到时域子载波符号;

步骤2.3:对时域子载波符号进行加CP处理,形成多路LTE-Advanced Pro时域基带OFDM调制信号;

步骤2.4:通过数字滤波插值控制逻辑电路对每路LTE-Advanced Pro时域基带OFDM调制信号单独进行数据插值和滤波处理;

步骤2.5:通过数字上变频控制逻辑电路对基带OFDM调制信号进行数字上变频处理;

步骤2.6:通过D/A转换电路转换成LTE-Advanced Pro模拟信号;

步骤3:辅助触发同步信号的Rapid IO接口设计;具体包括如下步骤:

步骤3.1:在DSP平台中,DSP的内核2根据FPGA发送的辅助触发同步信号搜寻帧头位置;

步骤3.2:搜寻到帧头位置后,对外部DDR进行乒乓切换,将内核1数据写入DDR,同时利用间隙时分将数据取出来送给RapidIO写函数,使底层DSP的RapidIO驱动全速率发送数据发送给RapidIO函数接口,发送完1ms后,等待下一次发包帧头控制的触发信号;

步骤3.3:循环执行步骤3.1-步骤3.2,按照辅助触发同步信号的周期性执行,永不停止;

步骤3.4:在FPGA平台中,设计一个10ms定时器,产生周期为10ms的触发高电平脉冲信号,根据10ms定时信号,进行接口寄存器复位;

步骤3.5:设计接口应用层数据接收状态机;

步骤3.6:将DSP数据包保存到双口RAM中,同时双口RAM进行数据位宽的64bit到32bit的转换;

步骤3.7:根据双口RAM控制逻辑电路,将多载波混合数据进行拆分,还原出发送端原有的多路LTE-Advanced Pro频域单载波信号;

步骤3.8:通过IFFT信号链路控制逻辑电路对每一路LTE-Advanced Pro频域单载波信号均进行IFFT处理。

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