[发明专利]一种流控忆感器的等效模拟电路在审

专利信息
申请号: 201710805073.1 申请日: 2017-09-08
公开(公告)号: CN107526897A 公开(公告)日: 2017-12-29
发明(设计)人: 王光义;吴泽炎;丘嵘;周玮 申请(专利权)人: 杭州电子科技大学
主分类号: G06F17/50 分类号: G06F17/50
代理公司: 杭州奥创知识产权代理有限公司33272 代理人: 王佳健
地址: 310018 浙*** 国省代码: 浙江;33
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摘要:
搜索关键词: 一种 流控忆感器 等效 模拟 电路
【说明书】:

技术领域

发明属于电路设计技术领域,涉及一种忆感器数学模型及其等效模拟电路,具体涉及一种实现符合忆感器磁通-电流(韦-安)关系的模拟等效电路。

背景技术

2008年5月,HP实验室宣布制造了第一个物理实现的忆阻器,同年11月定义了忆容器和忆感器两种记忆器件,它们与忆阻器的相同之处是都具有记忆能力,不同之处在于这两种器件能存储能量。这些新的记忆器件在电子领域出现,展现了一个新的未知的领域,将有可能导致一系列的变革,同时也提供了一个新的工具,可以从一个新的角度来观察旧的科学问题。

目前,相对于忆阻器,忆容器和忆感器的电路模拟研究还较少,而且大部分忆容器和忆感器的模拟器都是基于忆阻器实现的,主要原因是忆容器和忆感器的数学模型还不够完善,且物理可实现的实际忆容器尚未出现。因此,设计实现忆感器的等效模型对忆感器研究具有重要应用。目前,虽已报道了少量的忆感器电路模型,但这些数学模型和电路模型对应的是忆感器电流I与磁通的关系。而本发明提出了一种流控即电流控制的忆感器数学模型,并设计实现了该模型的等效电路,该等效电路可作为忆感器的一种仿真器,替代尚未实现的忆感器,在理论和应用研究中模拟实际忆感器器件的韦-安特性。

发明内容

针对现有技术存在的上述不足,本发明提供了一种实现忆感器特性的模拟电路,用以模拟忆感器的韦安特性,替代实际忆感器进行实验和应用及研究。

本发明解决技术问题所采取的技术方案如下:

本发明包括集成运算放大器U1、U2和U3,和乘法器A以及受控电流源L,集成运算放大器U1和受控电流源分别连接输入端(A、B,即忆感器的电压u和磁通的测试端),集成运算放大器U1、U2、U3分别用于反向运算、积分运算、反相运算;集成运算放大器U1与集成运算放大器U2、乘法器A相连,集成运算放大器U3与乘法器的输出组合实现等式运算,乘法器A实现信号的相乘。

为了取得更好的性能,所述集成运算放大器U1的第1引脚与电阻R2相连后再与其第2引脚共同接入U1(t)电压源,然后第3引脚的一支路接地构成跟随器,第4引脚为VCC端,第6引脚与第7引脚之间接入一个电容然后与接地的第5引脚共同构成一个积分器,由于本模拟电路中只用到了三个运算放大器,故第8、9、10引脚都悬空,而第11引脚为VEE,第13引脚与第14引脚相连,再结合接地的第12引脚构成了反相器,且积分器的输出端与跟随器的输出端分别作为乘法器的输入端。

再进一步优选的,乘法器A的X1引脚和Y1引脚分别接跟随器与积分器的输出端,而为了实现纯增益的功能X2引脚与Y2引脚也分别接地,VS+引脚接电源VCC,VS-引脚接电源VEE,Z引脚接地。

本发明设计了一种能够实现忆感器韦安特性的模拟等效电路,该模拟电路只含3个集成运放和1个乘法器,结构简洁,本发明用集成运算电路实现忆感器特性中的相应运算,其中,集成运算放大器U1、U2主要用以实现电压的差分运算、电压积分运算、反相放大运算,模拟乘法器A用以信号的相乘,集成运算放大器U3用以实现两边的变量比较与等式的构建。

附图说明

图1是本发明的电路结构框图。

图2是本发明实现忆感器特性的模拟电路原理图。

具体实施方式

下面结合附图对本发明进行详细说明。

本发明的理论出发点是流控忆感器韦安特性的一般表达式:

如图1所示,本实例忆感器模拟等效电路包括集成运算放大器U1、U2、U3和乘法器A,集成运算放大器用于反相运算、积分运算、求和运算;集成运算放大器U1与U2、乘法器A相连,乘法器A实现信号的相乘。集成运算放大器采用LF347N,乘法器A采用AD633JN。LF347N、AD633JN为现有技术。

如图2所示,LF347N的第5、6引脚构成积分器的输入端,忆感器的磁通量在集成运算放大器U3与乘法器A的输出端相比较。

集成运算放大器LF347N内有4个运算放大器,在本发明中只用了其中的三个,如图2所示,第1、2、3引脚对应的运算放大器与外围电阻R2构成电压跟随器,用以实现后面电压的积分,即Out1引脚的电压为:

u=u1-u2

集成运算放大器LF347N的第12、13、14引脚与电容C1、电阻R6以及前面的跟随电路实现对流经其电流i(t)的积分电路,其输出端也就是乘法器A的X1端输入为而乘法器的另一输入端口Y1并未经过积分器故保持原样,故其输入乘法器Y1端的值仍未i(t)。

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