[发明专利]一种算术加法掩码转布尔异或掩码的防护电路在审
| 申请号： | 201710788468.5 | 申请日： | 2017-09-05 |
| 公开（公告）号： | CN107689863A | 公开（公告）日： | 2018-02-13 |
| 发明（设计）人： | 李军;饶金涛;何卫国 | 申请（专利权）人： | 成都三零嘉微电子有限公司 |
| 主分类号： | H04L9/00 | 分类号： | H04L9/00 |
| 代理公司： | 成都九鼎天元知识产权代理有限公司51214 | 代理人： | 邓世燕 |
| 地址： | 610041 四川省成都市高新区云华*** | 国省代码： | 四川;51 |
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| 摘要： | |||
| 搜索关键词： | 一种 算术 加法 掩码 布尔 防护 电路 | ||
【权利要求书】：
1.一种算术加法掩码转布尔异或掩码的防护电路，其特征在于：设A为需要被掩盖的敏感数据，M为随机数掩码，输入信号为T和M，输入信号T分别接入第一非门和并行前缀加法器的输入端，输入信号M接入第二非门后接入并行前缀加法器的另一个输入端，并行前缀加法器的每一级进位输出和第一非门的输出接入异或门，并输出最终结果。
2.根据权利要求1所述的一种算术加法掩码转布尔异或掩码的防护电路，其特征在于：所述第一非门对输入信号A+M进行非运算得到
3.根据权利要求2所述的一种算术加法掩码转布尔异或掩码的防护电路，其特征在于：所述第二非门对输入信号M进行非运算得到
4.根据权利要求3所述的一种算术加法掩码转布尔异或掩码的防护电路，其特征在于：所述并行前缀加法器对输入信号A+M和进行进位计算得到每一级进位信号。
5.根据权利要求4所述的一种算术加法掩码转布尔异或掩码的防护电路，其特征在于：所述异或门对进位信号和进行异或运算得到输出
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