[发明专利]流量回放方法、装置及存储介质在审
申请号: | 201710733539.1 | 申请日: | 2017-08-24 |
公开(公告)号: | CN107659463A | 公开(公告)日: | 2018-02-02 |
发明(设计)人: | 申罕骥;万巍;龙春;付豫豪 | 申请(专利权)人: | 中国科学院计算机网络信息中心 |
主分类号: | H04L12/26 | 分类号: | H04L12/26 |
代理公司: | 北京知舟专利事务所(普通合伙)11550 | 代理人: | 刘晓晖 |
地址: | 100083 北京市*** | 国省代码: | 北京;11 |
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摘要: | |||
搜索关键词: | 流量 回放 方法 装置 存储 介质 | ||
技术领域
本发明涉及,尤其涉及一种流量回放方法、装置及存储介质。
背景技术
随时网络技术的不断发展,测试是保障网络设备可靠性和稳定性的关键环节。流量回放方法是一种将真实网络流量存储记录并进行还原回放的网络测试方法,通过将捕获得到的真实网络流量还原回放到测试网络,可以再现实际的网络场景,达到考察被测系统在实际网络环境中的功能和性能的目的。流量回放方法是一种能对各类网络/安全设备进行客观、全面、系统测试的重要方法。
目前,通过文件预取、内核定时优化和可剥夺内核调度机制,将数据包发送时间误差降低到微秒级,并通过只发送数据包头部的方式实现了100MB线速网络流量回放。该数据包发送时间误差和数据包发送线速仍不能满足高性能数据回放的需求。
发明内容
本发明实施例提供了一种流量回放方法、装置及存储介质。
本发明实施例的第一方面提供一种流量回放方法,应用于流量回放系统,所述流量回放系统包括专用集成电路ASIC和内存;所述方法包括:
获取待发送数据包;
将所述待发送数据包存储在所述内存中;
基于所述ASIC读取所述内存中存储的所述待发送数据包;
将所述待发送数据包发送至网络端口。
结合第一方面,在第一方面的第一种实现方式中,所述内存包括:静态随机存储器SRAM、同步动态随机存储器SDRAM、内容可寻址存储器CAM中的任意一项或任意组合。
结合第一方面,在第一方面的第二种实现方式中,所述ASIC包括现场可编程门阵列FPGA。
结合第一方面的第二种实现方式,在第一方面的第三种实现方式中,所述将所述待发送数据包存储在所述内存中,包括:
通过外设部件互连标准PCI总线,将所述待发送数据包存储在所述内存中,所述内存位于所述FPGA的板卡上。
结合第一方面,在第一方面的第四种实现方式中,所述ASIC用于对数据包进行以下处理:过滤处理、模式匹配处理、采样处理、状态检测处理、数据流加密处理、数据流解密处理、哈希处理中的任意一项或者任意组合。
结合第一方面,或第一方面的第一种实现方式,或第一方面的第二种实现方式,或第一方面的第三种实现方式,或第一方面的第四种实现方式,在第一方面的第五种实现方式中,所述待发送数据包占用的空间大于1GB。
本发明实施例的第二方面提供了一种流量回放装置,应用于流量回放系统,所述流量回放系统包括专用集成电路ASIC和内存;所述装置包括:
获取模块,用于获取待发送数据包;
存储模块,用于将所述待发送数据包存储在所述内存中;
读取模块,用于基于所述ASIC读取所述内存中存储的所述待发送数据包;
发送模块,用于将所述待发送数据包发送至网络端口。
结合第二方面,在第二方面的第一种实现方式中,
所述内存包括:静态随机存储器SRAM、同步动态随机存储器SDRAM、内容可寻址存储器CAM中的任意一项或任意组合。
结合第二方面,在第二方面的第二种实现方式中,
所述ASIC包括现场可编程门阵列FPGA。
结合第二方面的第二种实现方式,在第二方面的第三种实现方式中,
所述存储模块,包括:
存储子模块,用于通过外设部件互连标准PCI总线,将所述待发送数据包存储在所述内存中,所述内存位于所述FPGA的板卡上。
结合第二方面,在第二方面的第四种实现方式中,
所述ASIC用于对数据包进行以下处理:过滤处理、模式匹配处理、采样处理、状态检测处理、数据流加密处理、数据流解密处理、哈希处理中的任意一项或者任意组合。
结合第二方面,或第二方面的第一种实现方式,或第二方面的第二种实现方式,或第二方面的第三种实现方式,或第二方面的第四种实现方式,在第二方面的第五种实现方式中,
所述获取模块获取的所述待发送数据包占用的空间大于1GB。
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