[发明专利]一种实现数据传输处理的方法及装置有效

专利信息
申请号: 201710724453.2 申请日: 2017-08-22
公开(公告)号: CN109428669B 公开(公告)日: 2021-04-27
发明(设计)人: 杨林;王喆 申请(专利权)人: 深圳市中兴微电子技术有限公司
主分类号: H04L1/00 分类号: H04L1/00
代理公司: 北京天昊联合知识产权代理有限公司 11112 代理人: 姜春咸;冯建基
地址: 518055 广东省深*** 国省代码: 广东;44
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摘要:
搜索关键词: 一种 实现 数据传输 处理 方法 装置
【权利要求书】:

1.一种实现数据传输处理的方法,其特征在于,包括:

当通用公共无线电接口CPRI协议支持的速率大于预设速率时,分离接收到的下行数据为两路或两路以上下行分离数据;

对分离的每一路下行分离数据分别进行下行链路处理;

合并所有完成下行链路处理的下行分离数据为一路下行合并数据。

2.根据权利要求1所述的方法,其特征在于,所述方法还包括:

当CPRI协议支持的速率小于或等于预设速率时,将接收到的所述下行数据直接通过一路下行链路进行所述下行链路处理。

3.根据权利要求1所述的方法,其特征在于,所述分离接收到的下行数据为两路下行分离数据包括:

将所述下行数据中包含的样点按照奇偶进行分离后,获得包含奇数样点的一路下行分离数据和包含偶数样点的一路下行分离数据。

4.根据权利要求1~3任一项所述的方法,其特征在于,所述分别进行下行链路处理包括:

对分离的每一路下行分离数据,分别在对应的下行链路上进行截位处理、交织处理。

5.根据权利要求1~3任一项所述的方法,其特征在于,所述方法还包括:

对合并获得的所述下行合并数据进行组帧处理;

对组帧后的所述下行合并数据进行跨时钟域处理,以将下行合并数据从系统时钟域转换至串行器的随路时钟域;

在随路时钟域对下行合并数据进行加扰处理和控制字相关处理,并发往串行器。

6.一种实现数据传输处理的方法,其特征在于,包括:

分离完成解帧处理的上行数据为两路或两路以上上行分离数据;

将分离的每一路上行分离数据分别进行上行链路处理;

对上行链路处理后的上行分离数据进行排列并合并输出;

其中,所述上行数据包括:通用公共无线电接口CPRI协议支持的速率大于预设速率时传输的数据。

7.根据权利要求6所述的方法,其特征在于,所述方法还包括:

当CPRI协议支持的速率小于或等于预设速率时,将完成解帧处理的上行数据直接通过一路上行链路进行所述上行链路处理。

8.根据权利要求6所述的方法,其特征在于,所述完成解帧处理的上行数据包括:

在随路时钟域对来自串行器的上行数据进行数据同步、控制字相关处理和解扰处理;

将所述解扰处理后的上行数据由随路时钟域转换至系统时钟域;

对转换至系统时钟域的上行数据进行解帧处理,获得所述完成解帧处理的上行数据。

9.根据权利要求6所述的方法,其特征在于,所述分别进行上行链路处理包括:

对分离的每一路上行分离数据,分别在对应的上行链路上进行解交织处理和补位处理。

10.根据权利要求6~9任一项所述的方法,其特征在于,所述分离完成解帧处理的上行数据为两路或两路以上上行分离数据包括:

将完成解帧处理的所述上行数据中包含的样点按照奇偶进行分离后,获得包含奇数样点的一路上行分离数据和包含偶数样点的一路上行分离数据。

11.一种实现数据传输处理的装置,其特征在于,包括:交叉路由单元、下行链路处理单元和合并处理单元;其中,

交叉路由单元用于:当通用公共无线电接口CPRI协议支持的速率大于预设速率时,分离接收到的下行数据为两路或两路以上下行分离数据;

下行链路处理单元用于:对分离的每一路下行分离数据分别进行下行链路处理;

合并处理单元用于:合并所有完成下行链路处理的下行分离数据为一路下行合并数据。

12.根据权利要求11所述的装置,其特征在于,所述下行链路处理单元还用于:

当CPRI协议支持的速率小于或等于预设速率时,将接收到的所述下行数据直接通过一路下行链路进行所述下行链路处理。

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