[发明专利]金属膜镀制方法、薄膜晶体管和阵列基板的制作方法在审
| 申请号: | 201710668127.4 | 申请日: | 2017-08-07 |
| 公开(公告)号: | CN107369614A | 公开(公告)日: | 2017-11-21 |
| 发明(设计)人: | 高东子 | 申请(专利权)人: | 深圳市华星光电技术有限公司 |
| 主分类号: | H01L21/02 | 分类号: | H01L21/02;H01L21/336;H01L21/77;H01L27/12;C23C14/14;C23C14/16;C23C14/34 |
| 代理公司: | 深圳市铭粤知识产权代理有限公司44304 | 代理人: | 孙伟峰,武岑飞 |
| 地址: | 518132 广东*** | 国省代码: | 广东;44 |
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| 摘要: | |||
| 搜索关键词: | 金属膜 方法 薄膜晶体管 阵列 制作方法 | ||
1.一种金属膜镀制方法,其特征在于,包括步骤:
提供一基板;
在所述基板上镀制形成第一金属膜层;
暂停预定时间之后,在所述第一金属膜层上镀制形成第二金属膜层;其中,所述第一金属膜层的镀制材料与所述第二金属膜层的镀制材料相同。
2.根据权利要求1所述的金属膜镀制方法,其特征在于,所述预定时间为10秒至20秒。
3.一种薄膜晶体管的制作方法,其特征在于,包括步骤:
提供一基板:
在所述基板上形成第一栅极金属层;
暂停预定时间之后,在所述第一栅极金属层上制作形成第二栅极金属层;
对所述第二栅极金属层和所述第一栅极金属层进行曝光、显影及刻蚀处理,以形成栅极;
在所述基板和所述栅极上形成栅极绝缘层;
在所述栅极绝缘层上形成与所述栅极相对的有源层;
在所述有源层和所述栅极绝缘层上形成彼此间隔的源极和漏极。
4.根据权利要求3所述的薄膜晶体管的制作方法,其特征在于,所述“在所述有源层和所述栅极绝缘层上形成彼此间隔的源极和漏极”的方法包括步骤:
在所述有源层和所述栅极绝缘层上形成第一源漏极金属层;
暂停预定时间之后,在所述第一源漏极金属层上形成第二源漏极金属层;
对所述第一源漏极金属层和所述第二源漏极金属层进行曝光、显影及刻蚀处理,以形成所述源极和所述漏极。
5.根据权利要求3或4所述的薄膜晶体管的制作方法,其特征在于,所述预定时间为10秒至20秒。
6.一种由权利要求3至5任一项所述的薄膜晶体管的制作方法制作的薄膜晶体管。
7.一种阵列基板的制作方法,其特征在于,包括步骤:
提供一基板:
在所述基板上形成第一栅极金属层;
暂停预定时间之后,在所述第一栅极金属层上制作形成第二栅极金属层;
对所述第二栅极金属层和所述第一栅极金属层进行曝光、显影及刻蚀处理,以形成栅极;
在所述基板和所述栅极上形成栅极绝缘层;
在所述栅极绝缘层上形成与所述栅极相对的有源层;
在所述有源层和所述栅极绝缘层上形成彼此间隔的源极和漏极;
在所述有源层、所述栅极绝缘层、所述源极和所述漏极上形成钝化层;
在所述钝化层中形成暴露所述漏极的过孔;
在所述钝化层上形成通过所述过孔与所述漏极接触的像素电极。
8.根据权利要求7所述的阵列基板的制作方法,其特征在于,所述“在所述有源层和所述栅极绝缘层上形成彼此间隔的源极和漏极”的方法包括步骤:
在所述有源层和所述栅极绝缘层上形成第一源漏极金属层;
暂停预定时间之后,在所述第一源漏极金属层上形成第二源漏极金属层;
对所述第一源漏极金属层和所述第二源漏极金属层进行曝光、显影及刻蚀处理,以形成所述源极和所述漏极。
9.根据权利要求7或8所述的阵列基板的制作方法,其特征在于,所述预定时间为10秒至20秒。
10.一种由权利要求7至9任一项所述的阵列基板的制作方法制作的阵列基板。
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H01L 半导体器件;其他类目中不包括的电固体器件
H01L21-00 专门适用于制造或处理半导体或固体器件或其部件的方法或设备
H01L21-02 .半导体器件或其部件的制造或处理
H01L21-64 .非专门适用于包含在H01L 31/00至H01L 51/00各组的单个器件所使用的除半导体器件之外的固体器件或其部件的制造或处理
H01L21-66 .在制造或处理过程中的测试或测量
H01L21-67 .专门适用于在制造或处理过程中处理半导体或电固体器件的装置;专门适合于在半导体或电固体器件或部件的制造或处理过程中处理晶片的装置
H01L21-70 .由在一共用基片内或其上形成的多个固态组件或集成电路组成的器件或其部件的制造或处理;集成电路器件或其特殊部件的制造





