[发明专利]一种串行数据解码的时钟恢复方法及系统在审

专利信息
申请号: 201710472764.4 申请日: 2017-06-21
公开(公告)号: CN107302355A 公开(公告)日: 2017-10-27
发明(设计)人: 周文闻 申请(专利权)人: 四川工业科技学院
主分类号: H03L7/08 分类号: H03L7/08
代理公司: 成都市集智汇华知识产权代理事务所(普通合伙)51237 代理人: 李华,温黎娟
地址: 618500 四*** 国省代码: 四川;51
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摘要:
搜索关键词: 一种 串行 数据 解码 时钟 恢复 方法 系统
【权利要求书】:

1.一种串行数据解码的时钟恢复方法,其特征在于,包括:

生成鉴相时钟信号,所述鉴相时钟信号周期为生成串行数据的设备可设置的最短时钟周期的1/N,N为大于1的正整数;

计算接收的串行数据中各同向信号跳变点之间的时间间隔包含的鉴相时钟信号周期的个数值并存储;

获取存储的个数值中的最小值,根据个数值中的最小值确定串行数据的时钟信号周期;

根据串行数据的时钟信号周期恢复串行数据的时钟信号。

2.根据权利要求1所述的串行数据解码的时钟恢复方法,其特征在于,所述同向信号跳变点为上升沿信号跳变点。

3.根据权利要求1所述的串行数据解码的时钟恢复方法,其特征在于,所述同向信号跳变点为下降沿信号跳变点。

4.根据权利要求1所述的串行数据解码的时钟恢复方法,其特征在于,所述根据个数值中的最小值确定串行数据的时钟信号周期步骤前,还包括将个数值中的最小值加入冗余误差的步骤。

5.根据权利要求1所述的串行数据解码的时钟恢复方法,其特征在于,所述根据串行数据的时钟信号周期恢复串行数据的时钟信号的方法,包括:

生成校准时钟信号,所述校准时钟信号周期为所述确定的串行数据的时钟信号周期的1/N,N为大于1的正整数;

当接收的串行数据出现信号跳变点时,控制校准时钟信号的周期计数器从0开始计数,且执行下述串行数据的时钟信号生成过程:当校准时钟信号的周期计数值为0到N/2-1,且接收的串行数据没有发生跳变时,控制校准时钟信号持续输出电平1;当校准时钟信号的周期计数值为N/2到N-1,且接收的串行数据没有发生跳变时,控制校准时钟信号持续输出电平0;

若校准时钟信号的周期计数值到N-1,控制校准时钟信号的周期计数器从0开始重新计数,返回执行上述串行数据的时钟信号生成过程。

6.根据权利要求5所述的串行数据解码的时钟恢复方法,其特征在于,所述根据串行数据的时钟信号周期恢复串行数据的时钟信号的方法,还包括:

若接收的串行数据发生跳变,则从接收的串行数据发生跳变的时刻,控制校准时钟信号的周期计数器从0开始重新计数,返回执行上述串行数据的时钟信号生成过程。

7.根据权利要求5或6所述的串行数据解码的时钟恢复方法,其特征在于,所述信号跳变点包括上升沿信号跳变点和下降沿信号跳变点。

8.一种串行数据解码的时钟恢复系统,其特征在于,包括:

生成模块,用于生成鉴相时钟信号,所述鉴相时钟信号周期为生成串行数据的设备可设置的最短时钟周期的1/N,N为大于1的正整数;

计算模块,用于计算接收的串行数据中各同向信号跳变点之间的时间间隔包含的鉴相时钟信号周期的个数值并存储;

获取模块,用于获取存储的个数值中的最小值;

确定模块,根据个数值中的最小值确定串行数据的时钟信号周期;

恢复模块,根据串行数据的时钟信号周期恢复串行数据的时钟信号。

9.根据权利要求1所述的串行数据解码的时钟恢复系统,其特征在于,还包括加入模块,用于在存储的个数值中的最小值中加入冗余误差。

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