[发明专利]存储器、电子设备及其防止侧信道攻击的加解密方法在审

专利信息
申请号: 201710434612.5 申请日: 2017-06-09
公开(公告)号: CN109039590A 公开(公告)日: 2018-12-18
发明(设计)人: 赵健;许明流 申请(专利权)人: 深圳九磊科技有限公司
主分类号: H04L9/08 分类号: H04L9/08;H04L9/00
代理公司: 深圳市瑞方达知识产权事务所(普通合伙) 44314 代理人: 张秋红;高瑞
地址: 518000 广东省深圳市南山区高新区南区华中科技大*** 国省代码: 广东;44
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摘要:
搜索关键词: 加解密 伪数据 电子设备 信道攻击 存储器 依序排列 随机数 伪密钥 密钥 替换 保证
【权利要求书】:

1.一种防止侧信道攻击的加解密方法,其特征在于,包括:

S10.产生n个伪数据及每个伪数据所对应的伪密钥,且将n个伪数据依序排列,n为大于等于2的自然数;

S20.产生一随机数k,并将第k个伪数据替换为真数据,其中,1≤k≤n;

S30.依序分别使用相应的密钥对n个数据进行加解密;

S40.将第k个加解密后的数据作为最终的加解密数据。

2.根据权利要求1所述的防止侧信道攻击的加解密方法,其特征在于,在所述步骤S10和所述步骤S20之间,还包括:

S50.产生随机数f,并根据所述随机数f对所述n个伪数据进行随机排列。

3.根据权利要求1所述的防止侧信道攻击的加解密方法,其特征在于,在所述步骤S10中,产生n个伪数据及每个伪数据所对应的伪密钥的步骤包括:

S11.产生随机数pi,并根据所述随机数pi生成第i个伪数据,i=1、2、…、n;

S12.产生随机数qi,并根据所述随机数qi生成第i个伪密钥,i=1、2、…、n。

4.根据权利要求3所述的防止侧信道攻击的加解密方法,其特征在于,在所述步骤S11中,根据所述随机数pi生成第i个伪数据的步骤为:

根据所述随机数pi、硬件标识和时间信息使用第一算法生成第i个伪数据;

在所述步骤S12中,根据所述随机数qi生成第i个伪密钥的步骤为:

根据所述随机数qi、硬件标识和时间信息使用第二算法生成第i个伪密钥。

5.一种电子设备,其特征在于,包括:

生成模块,用于产生n个伪数据及每个伪数据所对应的伪密钥,且将n个伪数据依序排列,n为大于等于2的自然数;

替换模块,用于产生一随机数k,并将第k个伪数据替换为真数据,其中,1≤k≤n;

加解密模块,用于依序分别使用相应的密钥对n个数据进行加解密;

提取模块,用于将第k个加解密后的数据作为最终的加解密数据。

6.根据权利要求5所述的电子设备,其特征在于,还包括:

排序模块,用于产生随机数f,并根据所述随机数f对所述n个伪数据进行随机排列。

7.根据权利要求5所述的电子设备,其特征在于,所述生成模块包括:

第一生成单元,用于产生随机数pi,并根据所述随机数pi生成第i个伪数据,i=1、2、…、n;

第二生成单元,用于产生随机数qi,并根据所述随机数qi生成第i个伪密钥,m=1、2、…、n。

8.根据权利要求7所述的电子设备,其特征在于,

所述第一生成单元,用于根据所述随机数pi、硬件标识和时间信息使用第一算法生成第i个伪数据;

所述第二生成单元,用于根据所述随机数qi、硬件标识和时间信息使用第二算法生成第i个伪密钥。

9.一种存储器,用于存储有程序指令,其特征在于,所述程序指令被处理器加载并执行时实现如权利要求1-4中任意一项所述方法的步骤。

10.一种电子设备,包括处理器和存储器,其特征在于,所述存储器用于存储程序指令,所述程序指令由所述处理器加载并执行实现如权利要求1-4任一项所述方法的步骤。

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