[发明专利]成形滤波器及其成形方法有效
申请号: | 201710156012.7 | 申请日: | 2017-03-16 |
公开(公告)号: | CN108631752B | 公开(公告)日: | 2021-12-24 |
发明(设计)人: | 邓海;万维逸 | 申请(专利权)人: | 航天信息股份有限公司 |
主分类号: | H03H17/02 | 分类号: | H03H17/02 |
代理公司: | 北京合智同创知识产权代理有限公司 11545 | 代理人: | 李杰 |
地址: | 100093 *** | 国省代码: | 北京;11 |
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摘要: | |||
搜索关键词: | 成形 滤波器 及其 方法 | ||
1.一种成形滤波器,所述成形滤波器的抽头系数的个数为N,其特征在于,包括:查找表模块,包括M个查找表,每个所述查找表存储有L个正抽头系数和L个负抽头系数,且N=M*L,N、M、L均为自然数,每一所述查找表用于根据高位地址信息和低位地址信息输出相应的部分积;
延时模块用于对输入序列进行延时处理以及给所述查找表模块提供高位地址信息;低位地址生成器用于给每一所述查找表提供低位地址信息;其中,所述延时模块包括M个依次串联的子延时模块,所述子延时模块用于对前级的所述子延时模块输出的输入序列进行延时输出,其中,第k个所述子延时模块的输出端与第k个所述查找表的高位地址输入端连接,用于给第k个所述查找表提供高位地址信息;
累加器,用于接收并累加每一所述查找表输出的部分积以输出成形的滤波后的输入序列。
2.根据权利要求1所述的滤波器,其特征在于,第k个所述查找表存储从h[(k-1)L]至h(kL-1)共L个正抽头系数hk(n),且第k个所述查找表存储从-h[(k-1)L]至-h(kL-1)共L个负抽头系数-hk(n),k为1至M中的正整数。
3.根据权利要求1所述的滤波器,其特征在于,所述子延时模块为D触发器;所述延时模块为由M个所述D触发器组成的M位移位寄存器。
4.根据权利要求1至3任一所述的滤波器,其特征在于,还包括:时序控制模块,用于给上述模块提供相应的时序控制信号,以使上述各模块按预设的时序工作。
5.一种成形滤波器的成形方法,所述成形滤波器的抽头系数的个数为N,其特征在于,包括:查找表模块,包括M个查找表,每个所述查找表存储有L个正抽头系数和L个负抽头系数,且N=M*L,N、M、L均为自然数,每一所述查找表根据高位地址信息和低位地址信息输出相应的部分积;
延时模块对输入序列进行延时处理以及给所述查找表模块提供高位地址信息;低位地址生成器给每一所述查找表提供低位地址信息;其中,所述延时模块包括M个依次串联的子延时模块;所述子延时模块对前级的所述子延时模块输出的输入序列进行延时输出,其中,第k个所述子延时模块的输出端与第k个所述查找表的高位地址输入端连接,给第k个所述查找表提供高位地址信息;
累加器接收并累加每一所述查找表输出的部分积以输出成形的滤波后的输入序列。
6.根据权利要求5所述的方法,其特征在于,第k个所述查找表存储从h[(k-1)L]至h(kL-1)共L个正抽头系数hk(n),且第k个所述查找表存储从-h[(k-1)L]至-h(kL-1)共L个负抽头系数-hk(n),k为1至M中的正整数。
7.根据权利要求5所述的方法,其特征在于,所述子延时模块为D触发器;所述延时模块为由M个所述D触发器组成的M位移位寄存器。
8.根据权利要求5至7任一所述的方法,其特征在于,还包括:
时序控制模块给上述模块提供相应的时序控制信号,以使上述各模块按预设的时序工作。
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