[发明专利]一种阵列基板及显示装置有效

专利信息
申请号: 201710096076.2 申请日: 2017-02-22
公开(公告)号: CN106773422B 公开(公告)日: 2018-08-03
发明(设计)人: 储浩;石跃;陈传宝 申请(专利权)人: 合肥京东方光电科技有限公司;京东方科技集团股份有限公司
主分类号: G02F1/1362 分类号: G02F1/1362;G02F1/1368;H01L27/12
代理公司: 北京润泽恒知识产权代理有限公司 11319 代理人: 苏培华
地址: 230011 安徽*** 国省代码: 安徽;34
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摘要:
搜索关键词: 一种 阵列 显示装置
【说明书】:

发明实施例提供了一种阵列基板及显示装置,涉及显示技术领域。本发明实施例中阵列基板包括形成在基板上的栅线、数据线以及由相邻栅线和相邻数据线限定的像素单元,所述栅线从驱动始端到驱动终端渐进变宽。阵列基板中栅线的驱动始端的宽度小于驱动终端的宽度,导致驱动始端的阻抗大于驱动终端的阻抗,减小驱动终端的RC delay较大造成的驱动始端与驱动终端的电压差,由此解决了驱动始端的电压高于驱动终端的电压,导致液晶显示装置中各个像素单元的显示亮度不均,液晶显示装置的显示效果差的问题,采用非等宽栅线,提高液晶显示装置中各个像素单元的显示亮度的均一性,提升液晶显示装置的品质与良率,提高液晶显示装置的显示效果。

技术领域

本发明涉及显示技术领域,特别是涉及一种阵列基板及显示装置。

背景技术

随着显示技术的不断发展,液晶显示技术广泛应用于电视、手机等其他显示装置中,人们也越来越重视液晶显示装置的显示效果。

目前,在液晶显示装置中,参照图1所示,阵列基板包括各行栅线、各列数据线以及由相邻栅线和相邻数据线限定的像素单元,各行栅线驱动始端与驱动终端的宽度相同。所述各行栅线包括:栅线11、栅线12、栅线13、栅线14、栅线15、栅线16、栅线17和栅线18,所述各列数据线包括:数据线21、数据线22、数据线23、数据线24、数据线25、数据线26和数据线27,各行栅线与各列数据线之间垂直交叉且绝缘,其中,栅线11被各列数据线遮挡住的区域与各列数据线之间垂直交叉且绝缘,栅线111、栅线112、栅线113、栅线114、栅线115、栅线116,以及被各列数据线遮挡住的区域均为栅线11的一部分,像素单元31由栅线11、栅线12与数据线21、数据线22限定,栅线11左侧的宽度d1与右侧的宽度d2相同,则栅线11的驱动始端和驱动终端的宽度相同。

在发明人应用在先技术时,发现在先技术对于阵列基板采用等宽栅线实现液晶显示装置的像素单元的驱动时,由于驱动终端的RC delay比驱动始端的RC delay大,所述RCdelay也可称为gate delay(栅极延迟),导致栅线对应的栅极信号的损失会相应增大,造成驱动始端的电压高于驱动终端的电压,使液晶显示装置中各个像素单元的显示亮度不均,液晶显示装置的显示效果差。

发明内容

鉴于上述问题,提出了本发明以便提供一种克服上述问题或者至少部分地解决上述问题的一种阵列基板及相应的显示装置。

依据本发明的一个方面,提供了一种阵列基板,包括形成在基板上的栅线、数据线以及由相邻栅线和相邻数据线限定的像素单元,所述栅线从驱动始端到驱动终端渐进变宽。

优选地,所述阵列基板中相邻两条栅线的驱动始端的方向相反。

优选地,所述阵列基板中相邻两条栅线的驱动始端的方向相同。

优选地,所述栅线的驱动终端侧的宽度与原始栅线宽度相同。

优选地,所述每个像素单元连接一条栅线和一条数据线。

优选地,所述像素单元包括像素电极、公共电极和薄膜晶体管。

优选地,所述薄膜晶体管位于所述像素单元的左上侧或左下侧或右上侧或右下侧。

优选地,所述薄膜晶体管的栅极与所述栅线连接,所述薄膜晶体管的源极与所述数据线连接,所述薄膜晶体管的漏极与所述像素电极连接。

优选地,所述栅线与所述数据线之间交叉且绝缘。

优选地,所述像素电极和所述公共电极的材料为氧化铟锡。

根据本发明的另一方面,提供了一种显示装置,所述显示装置包括上述的阵列基板。

相对在先技术,本发明具备如下优点:

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