[发明专利]具有可选择处理器核心的集成电路装置在审
申请号: | 201680046945.4 | 申请日: | 2016-08-22 |
公开(公告)号: | CN107924385A | 公开(公告)日: | 2018-04-17 |
发明(设计)人: | S·斯蒂德曼 | 申请(专利权)人: | 密克罗奇普技术公司 |
主分类号: | G06F15/78 | 分类号: | G06F15/78;G06F1/22 |
代理公司: | 北京律盟知识产权代理有限责任公司11287 | 代理人: | 沈锦华 |
地址: | 美国亚*** | 国省代码: | 暂无信息 |
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摘要: | |||
搜索关键词: | 具有 可选择 处理器 核心 集成电路 装置 | ||
相关申请案的交叉引用
本申请案要求2015年8月21日申请的共同拥有的第62/208,090号美国临时专利申请案的优先权,所述申请案特此出于所有目的以引用方式并入本文中。
技术领域
本发明涉及具有处理器核心的集成电路装置,且特定来说,涉及微控制器。
背景技术
微控制器包含集成电路装置,其包括中央处理单元(CPU)(也称为处理器核心)、存储器、输入/输出端口及多个外围装置。因此,这些装置形成几乎不需要任何外部组件的完整系统。在时间敏感应用中,外部晶体可与集成振荡器一起用于系统时钟产生。然而,较不敏感应用可无需此组件且可依赖于全集成RC振荡器,所述全集成RC振荡器可通过集成PLL电路提供高系统时钟。
发明内容
本发明的实施例包含一种集成电路装置。所述装置包含:至少两个处理核心,其各自可操作以处理不同指令集;外围装置;存储器;及切换电路,其取决于所述集成电路装置的配置设置而将所述存储器及所述外围装置与所述核心耦合。
本发明的实施例包含至少一种包含指令的非暂时性计算机可读媒体。所述指令在由集成电路装置加载且执行时致使所述集成电路装置:使用两个相应处理核心来处理不同指令集;及取决于所述集成电路装置的配置设置而选择性地将存储器及外围装置与所述核心耦合。
本发明的实施例包含一种方法。所述方法包含:使用两个相应处理核心来处理不同指令集;及取决于所述集成电路装置的配置设置而选择性地将存储器及外围装置与所述核心耦合。
附图说明
图1说明用于实施具有可选择处理器核心的装置的系统的实例实施例;
图2说明用于产生用于具有可选择处理器核心的装置的代码的系统的实例实施例;
图3说明用于建立使用可选择处理器核心的电子装置的系统的实例实施例;及
图4说明用于选择装置上的处理器核心的方法的实例实施例的框图。
具体实施方式
图1是用于实施具有可选择处理器核心的设备的系统100的实例实施例的说明。在一个实施例中,此装置可包含集成电路装置。此装置可包含例如微控制器。所述装置可包含多个处理器核心。此外,一或多个核心的使用可与一或多个其它核心相互排斥。可由系统100中待执行的软件选择使用优于其它核心的一或多个特定核心。举例来说,可基于系统100中的不同核心的不同可用架构而选择待用于由代码执行的核心。
在图1的实例中,装置可由电子装置104实施。电子装置104可包含处理器、微控制器、现场可编程门阵列、专用集成电路或任何适合的集成电路装置。电子装置104可包含两个或两个以上处理核心或CPU。举例来说,电子装置104可包含核心106及核心108。在一个实施例中,核心106、108可用不同架构实施。架构的差异可体现在例如处理字节或位的不同大小、不同指令集或其它机构方面。在另一实施例中,待在一个此架构上执行的代码可能与其它架构不兼容。因此,待在电子装置104上执行的目标代码114可在核心106、108中的一者上执行而不能在核心106、108中的另一者上执行。尽管图1中展示两个种类的核心作为实例,但是电子装置104可包含任何适合数目个不同种类的核心。此外,尽管图1中展示两个不同种类的架构的单个核心,但是电子装置104可包含核心106、108中的每一者的多个例子。在一个实施例中,核心106可用来自微芯科技(Microchip Technology)的PIC-16架构实施。在另一实施例中,核心108可用来自微芯科技的PIC-18架构实施。
与电子装置104的其它机构(例如剩余装置基础设施112,其可含总线、存储器、寄存器、输入及输出端口、高速缓存器、接口、外围设备等)相比,由核心106、108占据的空间的大小可相对较小。举例来说,核心106、108可仅构成电子装置104的总裸片大小的1到2%。因此,可将多个核心放置于电子装置104中而不会显著影响可用空间。核心的每一不同架构也可需要额外元件(例如裸片上外围设备、接口等),此可需要额外裸片空间。然而,基础设施的一些部分可由不同种类的核心重复使用。举例来说,PIC-16与PIC-18架构之间的基础设施中可存在相当大的重叠。可在电子装置104上实施的核心的不同种类的架构的数目可受裸片上可用空间的限制,前提考虑到核心及相关联接口以及支持基础设施的额外空间需求。
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