[发明专利]媒体中枢设备和高速缓存有效
申请号: | 201680016123.1 | 申请日: | 2016-02-26 |
公开(公告)号: | CN107408292B | 公开(公告)日: | 2022-03-15 |
发明(设计)人: | R·瑟苏拉曼;A·罗伊乔杜里;A·V·杜尔格;R·D·穆拉利达 | 申请(专利权)人: | 英特尔公司 |
主分类号: | G06T1/20 | 分类号: | G06T1/20;G06T1/60 |
代理公司: | 上海专利商标事务所有限公司 31100 | 代理人: | 李炜;黄嵩泉 |
地址: | 美国加利*** | 国省代码: | 暂无信息 |
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摘要: | |||
搜索关键词: | 媒体 中枢 设备 高速缓存 | ||
1.一种媒体中枢设备,包括:
媒体加速器,被配置用于对具有帧周期以及通过主结构接收自主存储器的媒体的当前帧执行操作;以及
所述媒体中枢设备的高速缓存,所述高速缓存用于向所述媒体加速器提供与所述当前帧的所述帧周期相关联的数据,
仲裁器,所述仲裁器用于将所述主结构通信地耦合至所述主存储器以及用于将中央处理单元CPU通信地耦合至所述主存储器,其中所述仲裁器用于仲裁所述媒体加速度器和所述CPU对所述主存储器的访问;
其中,所述媒体加速器是所述媒体中枢设备的多个媒体加速器中的一个,并且其中,所述多个媒体加速器通过所述高速缓存以及与所述主结构分开的媒体中枢结构来通信地耦合到彼此。
2.如权利要求1所述的媒体中枢设备,其中,至少两个媒体中枢加速器与所述媒体中枢的输入/输出(I/O)通信相关联,并且其中,所述至少两个媒体加速器通过所述高速缓存的缓冲器被通信地耦合。
3.如权利要求1-2的任一组合所述的媒体中枢设备,其中,所述媒体加速器是所述媒体中枢设备的多个媒体加速器中的一个,并且其中,所述多个媒体加速器中的至少两个通过除所述高速缓存以外的信道被通信地耦合。
4.如权利要求1-2的任一组合所述的媒体中枢设备,其中,所述媒体中枢设备是计算系统的部件,并且其中,在由所述媒体中枢的所述媒体加速器执行所述当前帧期间,通过从所述媒体中枢到所述计算系统的功率管理单元的指示,所述计算系统的一个或多个其他部件进入空闲状态。
5.如权利要求4所述的媒体中枢设备,其中,所述媒体中枢被配置用于减少与所述媒体加速器对所述计算系统的存储器部件的访问相关联的带宽消耗,如果所述数据先前不存在于所述媒体中枢设备的所述高速缓存中,则所述访问会发生。
6.如权利要求1-2的任一组合所述的媒体中枢设备,其中,所述媒体加速器包括与媒体处理相关联的部件,并且不集成在包括以下各项的部件内:
中央处理单元;
图形处理单元;或
中央处理单元和图形处理单元的任何组合。
7.如权利要求1-2的任一组合所述的媒体中枢设备,其中,所述高速缓存的大小基于媒体特定应用。
8.如权利要求1-2的任一组合所述的媒体中枢设备,其中,所述高速缓存是第二级高速缓存,所述媒体中枢设备进一步包括第一级高速缓存,其中,所述第一级高速缓存的至少一部分被集成在所述媒体加速器内。
9.如权利要求8所述的媒体中枢设备,其中,所述第二级高速缓存包括所述当前帧的区域,并且其中,所述第一级高速缓存包括作为所述区域的子集的搜索窗口。
10.一种用于处理媒体的方法,包括:在媒体中枢设备处通过主结构从主存储器接收具有帧周期的媒体的当前帧,其中仲裁器将所述主结构通信地耦合至所述主存储器以及将中央处理单元CPU通信地耦合至所述主存储器,其中所述仲裁器用于仲裁所述媒体加速度器和所述CPU对所述主存储器的访问;
通过媒体中枢设备执行与具有帧周期的媒体的当前帧有关的操作;
将与所述当前帧周期相关联的数据存储在所述媒体中枢设备的高速缓存中;以及
在执行期间将所述数据从所述高速缓存提供到所述媒体中枢设备的媒体加速器,其中将所述数据提供到所述媒体加速器包括通过与所述主结构分开的媒体中枢结构传递所述数据而无需访问存储器组件。
11.如权利要求10所述的方法,其中,所述媒体加速器是所述媒体中枢设备的多个媒体加速器中的一个,并且所述方法进一步包括:通过所述高速缓存通信地耦合所述多个媒体加速器中的至少两个。
12.如权利要求11所述的方法,其中,所述至少两个媒体中枢加速器与所述媒体中枢的输入/输出(I/O)通信相关联,并且其中,所述至少两个媒体加速器通过所述高速缓存的缓冲器被通信地耦合。
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