[实用新型]一种无源光网络突发模式接收机信号检测电路架构有效

专利信息
申请号: 201621219329.8 申请日: 2016-11-14
公开(公告)号: CN206259939U 公开(公告)日: 2017-06-16
发明(设计)人: 任军;苏黎;郑薇;伍莲洪;刘浩;李富民;童伟;胡柳林 申请(专利权)人: 成都嘉纳海威科技有限责任公司
主分类号: H04B10/079 分类号: H04B10/079;H04B10/291;H04B17/29;H04Q11/00
代理公司: 成都正华专利代理事务所(普通合伙)51229 代理人: 李林合
地址: 610016 四川省成都市*** 国省代码: 四川;51
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摘要:
搜索关键词: 一种 无源 网络 突发 模式 接收机 信号 检测 电路 架构
【说明书】:

技术领域

实用新型涉及信息检测电路,属于通信技术领域,具体涉及一种无源光网络突发信号的检测电路架构,可用于噪声、干扰和突发信号的鉴别检测。

背景技术

无源光网络(Passive Optical Network,PON)典型的上行传输采用时分多址(Time Division Multiplex Address,TDMA))方式,如图1所示,多个光网络终端(Optical Network Terminator,ONT)发出的光信号经光分配网络(Optical Distribution Network,ODN)后的合路信号进入光线路终端(Optical Line Terminator,OLT),由此可见OLT端接收机工作在突发模式。

典型OLT端接收机的电路架构,如图2所示,光电二极管把接收到的突发数据光信号转变成光电流,送入突发模式跨阻放大电路(BM-TIA),它的输出送入突发模式限幅放大电路(BM-LA)的输入端,BM-LA对信号进行限幅放大,同时检测信号(Signal Detect,SD)是否有效,最后,输出数据和SD信号到时钟和数据恢复电路(CDR)。

传统的BM-LA信号检测的算法,如图3所示,其原理是检测接收到信号的幅度,然后将其与预先设定的阈值电压进行比较,当检测到的信号幅值大于阈值,则输出检测到有效信号的逻辑电平;若小于阈值,则返回接收新的信号,输出保持未检测到有效信号逻辑。

传统的BM-LA信号检测的电路架构,如图4所示,BM-LA将接收到的信号首先经过放大模块(AMP)进行放大,然后输出到信号幅度检测模块(Signal Level Detect),检测放大后信号的幅值,并将其与预先设定的阈值(Siganl Level Seting)进行比较,比较结果(Level Detect)输出到信号检测判决模块(Signal Detect Decider),输出SD信号给外部接口;通常SD会接到BM-LA的JAM引脚,以使能输出驱动(BUF)模块。然而,由于光电二极管的热噪声、器件噪声以及外界的干扰,会使得在无信号输入情况下,在BM-LA的输入端接收到瞬时脉冲电压,很可能超过阈值电压,这样就会使得BM-LA在无信号输入条件下,发生检测到有效信号的错误判断,这样的错误逻辑输出给接收机系统,很可能导致OLT在TDMA工作时出现异常。目前多数应用为了降低错误的发生概率,只能把BM-LA设定的阈值电压调高,但这样会降低整个接收机的灵敏度,牺牲了光网络的传输距离。

实用新型内容

本实用新型所要解决的技术问题是提供一种用于无源光网络突发模式接收机信号鉴别的电路架构及方法,解决了传统BM-LA检测信号算法和电路架构在噪声和干扰的影响下,信号检测容易发生错误的问题,降低了有效信号检测错误发生的概率。

本实用新型解决上述技术问题的技术方案如下:

一种无源光网络突发模式接收机信号检测电路架构,包括放大模块、信号幅度检测模块、信号检测判决模块以及驱动模块,其特征在于,还包括信号鉴别模块;

所述信号幅度检测模块的输入端分别连接放大模块的输出端和驱动模块的输入端;所述信号幅度检测模块的输出端与信号检测判决模块的输入端连接;所述信号鉴别模块的输入端与放大模块的输出端连接或与信号幅度检测模块的输出端连接,所述信号鉴别模块的输出端与信号检测判决模块的输入端连接。

本实用新型的有益效果是:本实用新型由于在突发模式接收机BM-LA中增加了信号鉴别模块,通过比较噪声和前导码的不同,识别出有效信号,极大地降低了有效信号检测发生错误的概率,与传统方法通过调高BM-LA阈值电压相比,不会降低接收机灵敏度指标;并且由于本实用新型的信号鉴别是在前导码时段进行,最少仅需2bit时长,因此可以广泛应用在高速OLT突发模式接收机。

在上述技术方案的基础上,本实用新型还可以做如下改进。

进一步,所述信号鉴别模块包括积分器、第一触发器、第二触发器、第三触发器、第一延迟单元、第二延迟单元、比较器、第一或门以及第二或门;

所述积分器包括依次连接的恒定电流源、第一开关管和电容,以及与电容并联的第二开关管;

所述第一开关管的一端、VTH和VTL分别与比较器的三个输入端连接;

所述第二触发器的时钟沿输入端与所述第一延迟单元的一端连接,第二触发器的触发输入端接逻辑高电平,输出端连接第一或门的输入端,复位输入端连接第二延迟单元的一端,第一或门的输出端同时连接第二延迟单元的另一端及第二开关管的开关控制端;

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