[实用新型]多变量数字签名装置有效
| 申请号： | 201621108483.8 | 申请日： | 2016-10-10 |
| 公开（公告）号： | CN206332680U | 公开（公告）日： | 2017-07-14 |
| 发明（设计）人： | 易海博;范新灿 | 申请（专利权）人： | 深圳职业技术学院 |
| 主分类号： | H04L9/08 | 分类号： | H04L9/08 |
| 代理公司： | 北京国昊天诚知识产权代理有限公司11315 | 代理人： | 许志勇 |
| 地址： | 518055*** | 国省代码： | 广东;44 |
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| 摘要： | |||
| 搜索关键词： | 多变 数字签名 装置 | ||
1.一种多变量数字签名装置(10)，其特征在于，包括：
输入输出控制模块(11)，包括待签名文档数据及密钥输入端口(A、B)、时钟输入端口(clk)、复位端口(res)和数字签名输出端口(C)；
解码模块(12)，信号连接所述输入输出控制模块(11)且包括多类指令的解码电路；
整数计算模块(13)，信号连接所述解码模块(12)且包括整数加减法电路；
有限域计算模块(14)，信号连接所述解码模块(12)且包括有限域乘法器、有限域求逆器、有限域加法器、第一类移位器和第二类移位器；
寄存器模块(15)，信号连接所述解码模块(12)且包括多个寄存器；
RAM存储模块(16)，信号连接所述解码模块(12)；以及
ROM存储模块(17)，信号连接所述解码模块(12)。
2.根据权利要求1所述的多变量数字签名装置(10)，其特征在于，所述输入输出控制模块(11)中的所述待签名文档数据及密钥输入端口(A、B)为两个且宽度均为单字节，所述时钟输入端口(clk)和所述复位端口(res)的宽度均为单比特，所述数字签名输出端口(C)的宽度为单字节。
3.根据权利要求1所述的多变量数字签名装置(10)，其特征在于，所述解码模块(12)中的所述多类指令的解码电路为十四类指令的解码电路。
4.根据权利要求1所述的多变量数字签名装置(10)，其特征在于，所述整数计算模块(13)中的所述整数加减法电路为0到9范围内的整数加减法电路。
5.根据权利要求1所述的多变量数字签名装置(10)，其特征在于，所述有限域计算模块(14)中的所述有限域乘法器、所述有限域求逆器和所述有限域加法器分别为三个GF(24)乘法器、一个GF(24)求逆器和六个GF(24)加法器。
6.根据权利要求1所述的多变量数字签名装置(10)，其特征在于，所述寄存器模块(15)中的所述多个寄存器为三类特殊寄存器且单个特殊寄存器的空间为单字节。
7.根据权利要求1所述的多变量数字签名装置(10)，其特征在于，所述RAM存储模块(16)包括两个地址端口、一个数据输入端口、两个数据输出端口和两个使能信号端口。
8.根据权利要求1所述的多变量数字签名装置(10)，其特征在于，所述多变量数字签名装置(10)为专用集成电路器件。
9.根据权利要求1所述的多变量数字签名装置(10)，其特征在于，所述多变量数字签名装置(10)为可编程逻辑器件。
10.根据权利要求9所述的多变量数字签名装置(10)，其特征在于，所述可编程逻辑器件为FPGA器件。
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