[发明专利]一种并行数据处理系统在审
申请号: | 201611051147.9 | 申请日: | 2016-11-25 |
公开(公告)号: | CN106776011A | 公开(公告)日: | 2017-05-31 |
发明(设计)人: | 李燕芳 | 申请(专利权)人: | 李燕芳 |
主分类号: | G06F9/50 | 分类号: | G06F9/50;G06F15/78 |
代理公司: | 北京轻创知识产权代理有限公司11212 | 代理人: | 杨立,周玉婷 |
地址: | 542400 广西壮族自治区*** | 国省代码: | 广西;45 |
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摘要: | |||
搜索关键词: | 一种 并行 数据处理系统 | ||
技术领域
本发明涉及数据处理领域,尤其涉及了一种并行数据处理系统。
背景技术
随着科技的进步,越来越多的智能产品面世,数据处理系统需要处理的数据量越来越大,人们对数据处理系统有了更高的要求,现有的数据处理系统大多只能直接的对数据进行处理,不具备多个数据处理模块,也不能根据各模块的处理效率选择最合适的数据处理模块,提高数据处理的效率。
发明内容
本发明所要解决的技术问题是:目前的数据处理系统不能够同时进行多个数据处理,数据处理的效率不高。
为解决上述的技术问题,本发明提供了一种并行数据处理系统,该系统包括:
壳体;壳体内安置有数据接口模块;在壳体内分别设有第一数据处理模块、第二数据处理模块、第三数据处理模块、第四数据处理模块和主控面板模块;主控面板模块分别与第一数据处理模块、第二数据处理模块、第三数据处理模块、第四数据处理模块连接;第一数据处理模块与第二数据处理模块连接,相互之间调用数据;第三数据处理模块与第四数据处理模块相互连接,相互之间调用数据;第一数据处理模块、第二数据处理模块通过主控面板模块与第三数据处理模块、第四数据处理模块相互调用。
进一步,主控面板模块上还设置有第一数据处理效率测试电路、第二数据处理效率测试电路、第三数据处理效率测试电路、第四数据处理效率测试电路;第一数据处理效率测试电路、第二数据处理效率测试电路、第三数据处理效率测试电路、第四数据处理效率测试电路分别与所述的第一数据处理模块、第二数据处理模块、第三数据处理模块、第四数据处理模块对应连接,用于控制对应的数据处理模块。
进一步,该系统还包括:数据传输电路、数据处理效率对比电路和控制电路,第一数据处理效率测试电路、第二数据处理效率测试电路、第三数据处理效率测试电路和第四数据处理效率测试电路均与数据处理效率对比电路连接,所述数据处理效率对比电路与控制电路连接,控制电路与数据传输电路连接。
进一步,数据传输电路分别与数据采集电路、第一数据处理模块、第二数据处理模块、第三数据处理模块和第四数据处理模块连接。
进一步,数据采集电路与数据接口模块连接,将采集到的信息输出数据接口模块。有益效果:同时对多个数据流进行处理,也能够选择最适合的数据处理模块,结构简单,使用方便,成本低,效率高。
附图说明
图1为本发明的一种并行数据处理系统示意图。
具体实施方式
以下结合附图对本发明的原理和特征进行描述,所举实例只用于解释本发明,并非用于限定本发明的范围。
如附图1所示的,一种并行数据处理系统,该系统包括:
壳体;壳体内安置有数据接口模块;在壳体内分别设有第一数据处理模块、第二数据处理模块、第三数据处理模块、第四数据处理模块和主控面板模块;主控面板模块分别与第一数据处理模块、第二数据处理模块、第三数据处理模块、第四数据处理模块连接;第一数据处理模块与第二数据处理模块连接,相互之间调用数据;第三数据处理模块与第四数据处理模块相互连接,相互之间调用数据;第一数据处理模块、第二数据处理模块通过主控面板模块与第三数据处理模块、第四数据处理模块相互调用。
主控面板模块上还设置有第一数据处理效率测试电路、第二数据处理效率测试电路、第三数据处理效率测试电路、第四数据处理效率测试电路;第一数据处理效率测试电路、第二数据处理效率测试电路、第三数据处理效率测试电路、第四数据处理效率测试电路分别与所述的第一数据处理模块、第二数据处理模块、第三数据处理模块、第四数据处理模块对应连接,用于控制对应的数据处理模块。
该系统还包括:数据传输电路、数据处理效率对比电路和控制电路,第一数据处理效率测试电路、第二数据处理效率测试电路、第三数据处理效率测试电路和第四数据处理效率测试电路均与数据处理效率对比电路连接,所述数据处理效率对比电路与控制电路连接,控制电路与数据传输电路连接。
数据传输电路分别与数据采集电路、第一数据处理模块、第二数据处理模块、第三数据处理模块和第四数据处理模块连接。
数据采集电路与数据接口模块连接,将采集到的信息输出数据接口模块。
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