[发明专利]数据处理器有效
申请号: | 201611042355.2 | 申请日: | 2016-11-21 |
公开(公告)号: | CN107040259B | 公开(公告)日: | 2022-04-05 |
发明(设计)人: | 简·尼霍夫;沙衮·巴约里亚;穆罕默德·博拉特凯尔;罗伯特·鲁滕;吕西安·约翰内斯·布伦默斯;汉斯·布里克尔曼斯 | 申请(专利权)人: | 恩智浦有限公司 |
主分类号: | H03M1/12 | 分类号: | H03M1/12;H03M1/18;H03M1/08 |
代理公司: | 中科专利商标代理有限责任公司 11021 | 代理人: | 倪斌 |
地址: | 荷兰埃因霍温高科*** | 国省代码: | 暂无信息 |
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摘要: | |||
搜索关键词: | 数据 处理器 | ||
1.一种处理器,其特征在于,包括:
用于接收第一接收器信号的第一接收器节点;
用于接收第二接收器信号的第二接收器节点;
用于耦合到数字基带处理器的第一输出节点;
用于耦合到所述数字基带处理器的第二输出节点;
在所述第一接收器节点和所述第一输出节点之间延伸的第一现用数据管道,所述第一现用数据管道包括:
第一模数转换器,所述第一模数转换器包括
耦合到所述第一接收器节点的第一ADC输入端;以及
耦合到所述第一输出节点的第一ADC输出端;
其中所述第一模数转换器被配置成将第一数字信号提供到所述第一输出节点;
与所述第一现用数据管道相关联的第一参考节点;以及
在所述第二接收器节点和所述第二输出节点之间延伸的可配置的数据管道,所述可配置的数据管道包括:
可配置的管线复用器,所述可配置的管线复用器包括:
耦合到所述第二接收器节点的第一MUX输入节点;
耦合到所述第一参考节点的第二MUX输入节点;以及
MUX输出节点;以及
第二模数转换器,所述第二模数转换器包括:
耦合到所述MUX输出节点的第二ADC输入端;以及
耦合到所述第二输出节点的第二ADC输出端,
其中,当所述可配置的管线复用器被配置成将所述第二MUX输入节点耦合到所述MUX输出节点时,所述第二模数转换器被配置成将第一数字参考信号提供到所述第二输出节点。
2.根据权利要求1所述的处理器,其特征在于,所述第一参考节点耦合到接地端、参考端、共模端或偏压端中的一个。
3.根据权利要求1或权利要求2所述的处理器,其特征在于,另外包括数字基带处理器,所述数字基带处理器被配置成基于所述第一数字参考信号确定噪声信号,并且从所述第一数字信号中减去所述噪声信号以将噪声已消除的第一数字信号提供到基带处理器输出端。
4.根据权利要求3所述的处理器,其特征在于,所述噪声信号为所述第一数字参考信号。
5.根据权利要求1所述的处理器,其特征在于,另外包括数字基带处理器,所述数字基带处理器被配置成:
接收所述第一数字参考信号;
基于所述第一数字参考信号产生控制信令;以及
将所述控制信令提供到所述第一现用数据管道以配置所述第一现用数据管道。
6.根据权利要求5所述的处理器,其特征在于,所述数字基带处理器被配置成:
将所述第一数字参考信号与预定阈值进行比较;以及
基于所述比较的结果产生所述控制信令。
7.根据权利要求5或权利要求6所述的处理器,其特征在于,所述数字基带处理器被另外配置成接收所述第一数字信号,并且基于所述第一数字信号产生所述控制信令。
8.根据权利要求5所述的处理器,其特征在于,另外包括数字基带处理器,所述数字基带处理器被配置成接收表示在相应的参考节点处的电压的信令,并且将控制信令提供到所述第一现用数据管道,以基于所述所接收的信令配置所述第一现用数据管道。
9.根据权利要求5或权利要求6所述的处理器,其特征在于,所述第一现用数据管道另外包括第一调谐器,并且所述数字基带处理器被配置成将所述控制信令提供到所述第一调谐器,以便调适所述第一调谐器的带宽。
10.一种集成电路,其特征在于,包括根据权利要求1-9任一项所述的处理器。
11.一种电子装置,其特征在于,包括根据权利要求1-9任一项所述的处理器。
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