[发明专利]开关控制电路、开关电路及恒导通时间控制方法有效
申请号: | 201610340039.7 | 申请日: | 2016-05-19 |
公开(公告)号: | CN105790581B | 公开(公告)日: | 2019-05-07 |
发明(设计)人: | 徐峰;黄必亮;任远程;周逊伟 | 申请(专利权)人: | 杰华特微电子(杭州)有限公司 |
主分类号: | H02M3/156 | 分类号: | H02M3/156 |
代理公司: | 杭州知通专利代理事务所(普通合伙) 33221 | 代理人: | 应圣义 |
地址: | 311121 浙江省杭州市余*** | 国省代码: | 浙江;33 |
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摘要: | |||
搜索关键词: | 开关 控制电路 开关电路 恒导通 时间 控制 方法 | ||
1.一种开关控制电路,其特征在于,耦接开关主电路的主管和辅管,包括恒导通逻辑控制电路和电流检测电路,所述电流检测电路输入端耦接开关主电路,输出端耦接恒导通逻辑控制电路,参考电压与表征开关主电路输出电压的反馈电压进行比较,得到指令电流,所述电流检测电路接收指令电流并采样主管导通时的主管电流,将指令电流与主管电流进行比较,所述恒导通逻辑控制电路计时主管的导通时间并控制主管的开关状态;
当主管导通时间达到恒定导通时间时,检测电感电流是否达到指令电流,若电感电流未达到指令电流,则延长主管的导通时间,直到电感电流达到指令电流或超过指令电流一定阈值后,则主管关断。
2.根据权利要求1所述的开关控制电路,其特征在于,所述电流检测电路包括第一比较电路,所述第一比较电路输入端耦接开关主电路主管,输出端耦接恒导通逻辑控制电路,当主管导通时,采样开关主电路主管的主管电流并将主管电流与指令电流进行比较。
3.根据权利要求2所述的开关控制电路,其特征在于,所述第一比较电路包括第一比较器和第一电流采样电路,所述第一电流采样电路耦接主管,所述第一比较器的正输入端耦接所述第一电流采样电路,用于接收主管导通时的主管电流的信号,负输入端接收指令电流的信号,输出端耦接恒导通逻辑控制电路。
4.根据权利要求2所述的开关控制电路,其特征在于,所述电流检测电路包括第二比较电路,所述第二比较电路输入端耦接开关主电路辅管,输出端耦接恒导通逻辑控制电路,当辅管导通时,采样开关主电路辅管的辅管电流并将辅管电流与指令电流进行比较。
5.根据权利要求4所述的开关控制电路,其特征在于,所述第二比较电路包括第二比较器和第二电流采样电路,所述第二电流采样电路耦接辅管,所述第二比较器的正输入端接收指令电流,负输入端耦接第二电流采样电路,用于采样开关主电路的辅管导通时的辅管电流,输出端耦接恒导通逻辑控制电路。
6.根据权利要求4所述的开关控制电路,其特征在于,所述恒导通逻辑控制电路包括:
计时电路,耦接主管,用于计时主管的导通时间;
门电路,耦接计时电路的输出端和第一比较电路的输出端,只有当计时电路和第一比较电路输出均为高电平时,才为高电平;
触发器,耦接门电路的输出端和第二比较电路的输出端,当门电路输出为高电平时,所述触发器被复位到低电平;当第二比较电路输出为高电平时,所述触发器被置为高电平;
延时电路,耦接触发器的输出端,当触发器输出为高电平时,所述延时电路产生主管的驱动信号;当触发器输出为低电平时,所述延时电路产生辅管的驱动信号。
7.根据权利要求6所述的开关控制电路,其特征在于,还包括驱动电路,所述驱动电路耦接恒导通逻辑控制电路和开关主电路,用于接收恒导通逻辑控制电路的驱动信号并控制主管和辅管的导通或关断。
8.根据权利要求6所述的开关控制电路,其特征在于,延时电路包括上升沿延时电路、下降沿延时电路和反相器,所述上升沿延时电路耦接所述触发器输出端和主管的控制端,所述下降沿延时电路耦接所述触发器输出端和反相器输入端,所述反相器的输出端耦接辅管的控制端。
9.根据权利要求6所述的开关控制电路,其特征在于,所述触发器为RS触发器,R端耦接门电路输出,S端耦接第二比较电路输出,Q端耦接延时电路。
10.根据权利要求6所述的开关控制电路,其特征在于,所述门电路为与门电路。
11.根据权利要求1所述的开关控制电路,其特征在于,还包括第三比较器,其正输入端接收所述参考电压,其负输入端输入所述反馈电压,其输出端耦接电流检测电路的输入端。
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