[发明专利]固态储存装置的断电期间估计方法有效
申请号: | 201610151191.0 | 申请日: | 2016-03-16 |
公开(公告)号: | CN107204204B | 公开(公告)日: | 2020-01-31 |
发明(设计)人: | 曾士家;傅仁傑 | 申请(专利权)人: | 建兴储存科技(广州)有限公司 |
主分类号: | G11C16/22 | 分类号: | G11C16/22 |
代理公司: | 11006 北京律诚同业知识产权代理有限公司 | 代理人: | 梁挥;祁建国 |
地址: | 510663 广东省广州*** | 国省代码: | 广东;44 |
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摘要: | |||
搜索关键词: | 固态 储存 装置 断电 期间 估计 方法 | ||
一种固态储存装置的断电期间估计方法。该固态储存装置具有一非挥发性记忆体,包括多个区块。该方法包括下列步骤:于该固态储存装置断电之前计算一第一区块的一第一品质参数,并于一第一时间计数值时,对该第一区块进行一校正动作,获得该第一区块的一第一读取电压组,并记录该第一时间计数值;于该固态储存装置接收电源之后,对该第一区块进行该校正动作,获得该第一区块的一第二读取电压组;以及根据该第一品质参数、该第一读取电压组、该第二读取电压组与该第一时间计数值,获得一断电期间。
技术领域
本发明涉及一种固态储存装置及其控制方法,且特别涉及一种运用于固态储存装置的断电期间(power-off period)估计方法。
背景技术
众所周知,固态储存装置(solid state device)已经非常广泛的应用于各种电子产品,例如SD卡、固态硬碟等等。请参照图1,其所绘示为固态储存装置示意图。固态储存装置10包括:界面控制电路101以及非挥发性记忆体(non-volatile memory)105。其中,非挥发性记忆体105中更包含记忆体阵列109和阵列控制电路111。
固态储存装置10经由一外部总线12连接至主机(host)14,其中外部总线12可为USB总线、SATA总线、PCIe总线等等。再者,界面控制电路101经由一内部总线113连接至非挥发性记忆体105,用以根据主机14所发出的命令进一步操控阵列控制电路111,用以将主机14的写入数据存入记忆体阵列109。或者,根据主机14所发出的命令进一步操控阵列控制电路111,使得阵列控制电路111由记忆体阵列109中取得读取数据,经由界面控制电路101传递至主机14。
再者,记忆体阵列109是由多个记忆胞(memory cell)所组成。再者,根据每个记忆胞所储存的数据量,可进一步区分为每个记忆胞储存一位元的单层记忆胞(Single-LevelCell,简称SLC记忆胞)、每个记忆胞储存二位元的多层记忆胞(Multi-Level Cell,简称MLC记忆胞)以及每个记忆胞储存三位元的三层记忆胞(Triple-Level Cell,简称TLC记忆胞)。
在记忆体阵列109里,每个记忆胞内皆包括一浮栅晶体管(floating gatetransistor),而阵列控制电路111可控制热载子(hot carrier)注入浮栅极(floatinggate)的数量,即可控制浮栅晶体管的储存状态。换言之,一个记忆胞内的浮栅晶体管可记录二种储存状态即为SLC记忆胞;一个记忆胞内的浮栅晶体管可记四种储存状态即为MLC记忆胞;一个记忆胞内的浮栅晶体管可记录八种储存状态即为TLC记忆胞。
再者,浮栅晶体管的浮栅极可以储存热载子,而根据热载子储存量的多寡可决定该浮栅晶体管的临限电压(threshold voltage,简称VTH)。也就是说,具有较高的临限电压的浮栅晶体管需要较高的栅极电压(gate voltage)来开启(turn on)浮栅晶体管;反之,具有较低的临限电压的浮栅晶体管则可以用较低的栅极电压来开启浮栅晶体管。
因此,于固态储存装置的编程周期(program cycle)时,界面控制电路101利用阵列控制电路111控制注入浮栅的热载子量,即可改变浮栅晶体管的临限电压。而在读取周期(read cycle)时,阵列控制电路111提供读取电压至浮栅晶体管,并根据浮栅晶体管是否能被开启(turn on)来判断其储存状态。
请参照图2A,其所绘示为TLC记忆胞的储存状态示意图。TLC记忆胞的一个记忆胞可以根据不同的热载子的注入量而呈现八个储存状态“000”~“111”。在未注入热载子时,记忆胞可视为储存状态“000”,而随着热载子注入的量的增加,可再区分为其他七种储存状态。举例来说,储存状态“111”的记忆胞具有最高的临限电压准位,储存状态“000”的记忆胞具有最低的临限电压准位。再者,当记忆胞经过抹除周期之后,皆会回复至未注入热载子的储存状态“000”。
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