[发明专利]一种优化堆叠栅介质与锗界面的方法在审

专利信息
申请号: 201610053917.7 申请日: 2016-01-27
公开(公告)号: CN105529257A 公开(公告)日: 2016-04-27
发明(设计)人: 李成;池晓伟;陈松岩;黄巍 申请(专利权)人: 厦门大学
主分类号: H01L21/28 分类号: H01L21/28;H01L29/423;H01L29/51;H01L21/336
代理公司: 厦门南强之路专利事务所(普通合伙) 35200 代理人: 马应森
地址: 361005 *** 国省代码: 福建;35
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摘要:
搜索关键词: 一种 优化 堆叠 介质 界面 方法
【说明书】:

技术领域

发明涉及堆叠栅介质,尤其是涉及一种优化堆叠栅(HfO2/Al2O3)介质与锗界面的方 法。

背景技术

随着半导体技术的发展,晶体管的特征尺寸不断等比例缩小[1],栅极介质材料SiO2的厚 度越来越接近其极限物理厚度,采用HfO2等高K介质代替传统的SiO2栅介质已成为发展的 必然。此外,锗衬底由于具有较大的空穴迁移率(Si的四倍),基于这些优点,锗衬底高K 介质栅MOSFET器件已成为业内人士的研究热点[2-3]。但HfO2/Ge界面态密度过大已成为锗 衬底MOSFET器件进一步发展的一个重要问题[4-5]。研究人员已多方面尝试采用湿法退火 [6-7]、GeO2钝化、GeOxNy钝化及Si表面钝化等手段实现HfO2/Ge界面性能的优化。

此外,Al2O3因为具有较高的介电常数9和较好的阻隔效果而被广泛应用于Ge表面钝化 领域。目前为止,HfO2/Al2O3/Ge结构堆叠栅的研究已经取得了一定的进展[8-9],但Al2O3/Ge 的界面态仍有进一步优化的空间。

参考文献:

[1]奥地利,艾罗拉,张兴.用于VLSI模拟的小尺寸MOS器件模型:理论与实践[J]. 1999。

[2]RaviPillarisetty,Academicandindustryresearchprogressingermaniumnanodevices[J], NATURE,2011,479:324-328。

[3]INTERNATIONALTECHNOLOGYROADMAPFORSEMICONDUCTORS[J],2011 EDITIO。

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[8]ShankarSwaminathan,MichaelShandalov,YasuhiroOshima,etal.Bilayermetaloxide gateinsulatorsforscaledGe-channelmetal-oxide-semiconductordevices[J],Appl.Phys.Lett.2010, 96:082904。

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